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          <label id="pryje"></label>
          


          
	
  	
          
	
          
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	毛刺
          

          
	
          
    	
          
    	  	
          
              	
                                
          
                  

                                
          
                    
          組合邏輯設(shè)計中的毛刺現(xiàn)象
          
                                                            
            
                    	
          • 組合邏輯設(shè)計中的毛刺現(xiàn)象-和所有的數(shù)字電路一樣，毛刺也是FPGA電路中的棘手問題，它的出現(xiàn)會影響電路工作的穩(wěn)定性，可靠性，嚴(yán)重時會導(dǎo)致整個數(shù)字系統(tǒng)的誤動作和邏輯紊亂。
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          • 關(guān)鍵字：
                        毛刺  FPGA  電路                          
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          FPGA設(shè)計中毛刺產(chǎn)生原因及消除
          
                                                            
            
                    	
          • 毛刺問題在FPGA設(shè)計中非常關(guān)鍵，只有深刻理解毛刺的本質(zhì)，才有可能真正掌握設(shè)計的精髓，本文就FPGA設(shè)計中的毛刺問題進(jìn)行了深入的探討，分析其產(chǎn)生的原因和條件，給出了幾種常用的消除方法，希望對FPGA設(shè)計者有一定的參考作用。
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          • 關(guān)鍵字：
                        毛刺  同步脈沖  FPGA                          
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          FPGA設(shè)計的常見問題
          
                                                            
            
                    	
          • 只要輸入信號同時變化，（經(jīng)過內(nèi)部走線）組合邏輯必將產(chǎn)生毛刺。將它們的輸出直接連接到時鐘輸入端、清零或置位端口的設(shè)計方法是錯誤的，這可能會導(dǎo)致嚴(yán)重的后果。 所以我們必須檢查設(shè)計中所有時鐘、清零和置位等對毛刺敏感的輸入端口，確保輸入不會含有任何毛刺。
            • 
                    	                        
          • 關(guān)鍵字：
                        毛刺  置位信號  FPGA                          
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          該怎么減少高精度DAC中的加電/斷電毛刺脈沖
          
                                                            
            
                    	
          • 該篇將分析對象限定為一個DAC，其中的輸出緩沖器在正常模式下被加電：零量程或中量程。文章將分析一下DAC輸出在高阻抗模式中被加電的情況。
            • 
                    	                        
          • 關(guān)鍵字：
                        DAC  毛刺                          
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          基于FPGA的IRIG-B碼解碼器設(shè)計
          
                                                            
            
                    	
          • 摘要 針對基于單片機的IRIG—B碼解碼器解碼精度低、工作穩(wěn)定性差等問題，提出了一種基于FPGA的IRIG—B碼解碼器設(shè)計。在實現(xiàn)過程中著重分析了輸
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          • 關(guān)鍵字：
                        IRIG―B碼  解碼  毛刺                          
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          狀態(tài)機“毛刺”的產(chǎn)生及消除措施
          
                                                            
                                        
            
                    	
          • 狀態(tài)機“毛刺”的產(chǎn)生及消除措施,隨著EDA技術(shù)的高速發(fā)展, 以大規(guī)模和超大規(guī)模器件FPGA/CPLD為載體、以VHDL(硬件描述語言)為工具的電子系統(tǒng)設(shè)計越來越廣泛。有限狀態(tài)機(簡稱狀態(tài)機)作為數(shù)字系統(tǒng)控制單元的重要設(shè)計方案之一，無論與基于VHDL語言的其他
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          • 關(guān)鍵字：
                        措施  消除  產(chǎn)生  毛刺  狀態(tài)                          
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          線路的尖峰毛刺造成FPGA工作不正常
          
                                                            
            
                    	
          • 使用EP2C35 FPGA 設(shè)計了多個串口工作,出現(xiàn)了幾個問題. 第一次, 由于內(nèi)核電源1.2V 供電不是完整平面,而是帶狀線供電,EP2C35 在代碼容量大的情況下,而且輸入FPGA 信號變換頻繁, 造成整個EP2C35 所有的D觸發(fā)器停止翻轉(zhuǎn).
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          • 關(guān)鍵字：
                        FPGA  線路  尖峰  毛刺                            
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          狀態(tài)機“毛刺”的產(chǎn)生及消除方法程序
          
                                                            
                                        
            
                    	
          • 狀態(tài)機“毛刺”的產(chǎn)生及消除方法程序,　隨著EDA技術(shù)的高速發(fā)展, 以大規(guī)模和超大規(guī)模器件FPGA/CPLD為載體、以VHDL(硬件描述語言)為工具的電子系統(tǒng)設(shè)計越來越廣泛。有限狀態(tài)機(簡稱狀態(tài)機)作為數(shù)字系統(tǒng)控制單元的重要設(shè)計方案之一，無論與基于VHDL語言的其
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          • 關(guān)鍵字：
                        方法  程序  消除  產(chǎn)生  毛刺  狀態(tài)                          
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          實時頻譜分析儀可揭示難檢的毛刺和其它瞬態(tài)RF信號
          
                                                            
            
                    	
          • 數(shù)字射頻(RF)技術(shù)迅速發(fā)展帶來一個結(jié)果，就是頻譜越來越擁擠，使用效率也越來越高；與此同時，現(xiàn)代RF信號也變得異常復(fù)雜。為了改善容量、性能及保密性，一般會結(jié)合使用完善的RF技術(shù)，如突發(fā)、跳頻和自適應(yīng)調(diào)制，這些
            • 
                    	                        
          • 關(guān)鍵字：
                        頻譜分析儀  毛刺  RF信號  瞬態(tài)                            
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          FPGA設(shè)計中毛刺信號解析
          
                                                            
                                        
            
                    	
          • FPGA設(shè)計中毛刺信號解析,在FPGA的設(shè)計中，毛刺現(xiàn)象是長期困擾電子設(shè)計工程師的設(shè)計問題之一, 是影響工程師設(shè)計效率和數(shù)字系統(tǒng)設(shè)計有效性和可靠性的主要因素。由于信號在FPGA的內(nèi)部走線和通過邏輯單元時造成的延遲,在多路信號變化的瞬間，組合
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          • 關(guān)鍵字：
                        解析  信號  毛刺  設(shè)計  FPGA                          
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          高頻整流電路中的新型電壓毛刺無損吸收電路
          
                                                            
                                        
            
                    	
          • 0    引言     電壓毛刺是高頻變換器研制和生產(chǎn)過程中的棘手問題，處理得不好會帶來許多的問題，諸如：功率管的耐壓必須提高，而且耐壓越高，其通態(tài)電壓越大，功耗越大，這不僅使產(chǎn)品效率降低，而且使電路可靠性降低
            • 
                    	                        
          • 關(guān)鍵字：
                        電路  無損  吸收  毛刺  新型  整流  高頻  電壓                          
            • 
                   	
          
                    
          
                
          
                                
          
                    
          狀態(tài)機“毛刺”的產(chǎn)生及消除方法
          
                                                            
                                        
            
                    	
          • 狀態(tài)機“毛刺”的產(chǎn)生及消除方法,　隨著EDA技術(shù)的高速發(fā)展, 以大規(guī)模和超大規(guī)模器件FPGA/CPLD為載體、以VHDL(硬件描述語言)為工具的電子系統(tǒng)設(shè)計越來越廣泛。有限狀態(tài)機(簡稱狀態(tài)機)作為數(shù)字系統(tǒng)控制單元的重要設(shè)計方案之一，無論與基于VHDL語言的其
            • 
                    	                        
          • 關(guān)鍵字：
                        方法  消除  產(chǎn)生  毛刺  狀態(tài)                          
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          無縫互聯(lián)功能對于異常信號的真實再現(xiàn)
          
                                                            
                                        
            
                    	
          • 在實際的電路運行中，由于各種干擾和響應(yīng)的存在，實際電路往往存在各種缺陷信號和瞬變信號，如果在設(shè)計之初沒有考慮這些情況，往往會產(chǎn)生災(zāi)難性的后果。找到這些異常信號，根據(jù)這些信號的特性選擇合適的調(diào)理電路加以抑制和優(yōu)化，這一直是電子工程師們所頭疼的。本文以普源精電DS1302CA示波器及其新近推出的DG5000系列函數(shù)/任意波形發(fā)生器為例來介紹無縫互聯(lián)功能的實現(xiàn)方式。
            • 
                    	                        
          • 關(guān)鍵字：
                        任意波形發(fā)生器  示波器  毛刺  無縫互聯(lián)  201008                          
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          消除狀態(tài)機毛刺策略探討
          
                                                            
                                        
            
                    	
          • 　　隨著EDA技術(shù)的高速發(fā)展, 以大規(guī)模和超大規(guī)模器件FPGA/CPLD為載體、以VHDL(硬件描述語言)為工具的電子系統(tǒng)設(shè)計越來越廣泛。有限狀態(tài)機(簡稱狀態(tài)機)作為數(shù)字系統(tǒng)控制單元的重要設(shè)計方案之一，無論與基于VHDL語言的其他設(shè)計方案相比，還是與可完成相似功能的CPU設(shè)計方案相比，在運行速度的高效、執(zhí)行時間的確定性和高可靠性方面都顯現(xiàn)出強大的優(yōu)勢。因此狀態(tài)機在數(shù)字電子系統(tǒng)設(shè)計中的地位日益凸顯。
　　1 狀態(tài)機“毛刺”的產(chǎn)生
　　狀態(tài)機通常包含主控時序進(jìn)程、主控組合進(jìn)程和輔助
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          • 關(guān)鍵字：
                        EDA  有限狀態(tài)機  毛刺                          
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	共14條
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