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cpld/fpga
使用FPGA的超聲波測距資料合集免費下載
積分:0分
FPGA
超聲波測距
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wenliang37
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如何使用FPGA實現(xiàn)BP神經(jīng)網(wǎng)絡(luò)的仿真線設(shè)計
積分:0分
FPGA
BP
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wenliang37
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基于UDP協(xié)議和FPGA的點到點數(shù)據(jù)傳輸方案
積分:0分
FPGA
UDP
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wenliang37
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如何使用FPGA實現(xiàn)低成本網(wǎng)絡(luò)數(shù)據(jù)傳輸存儲系統(tǒng)
積分:0分
FPGA
低成本
數(shù)據(jù)傳輸
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wenliang37
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萊迪思 ECP5和ECP5-5G FPGA
積分:0分
萊迪思
FPGA
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ZongYu
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基于FPGA集群的NEST脈沖神經(jīng)網(wǎng)絡(luò)仿真器
積分:0分
FPGA
NEST
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wenliang37
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萊迪思CertusPro-NX 高級通用FPGA
積分:0分
萊迪思
FPGA
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ZongYu
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手把手教你學(xué)習(xí)FPGA—LED篇
積分:0分
FPGA
LED
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hejingfeng
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萊迪思L-ASC10
積分:0分
萊迪思
FPGA
電源
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ZongYu
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萊迪思Platform Manager 2
積分:0分
FPGA
萊迪思
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ZongYu
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基于FPGA的多路光電編碼器數(shù)據(jù)采集系統(tǒng)
積分:0分
FPGA
光電編碼器
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wenliang37
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萊迪思CrossLink
積分:0分
萊迪思
FPGA
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ZongYu
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萊迪思 MachXO2 FPGA
積分:0分
萊迪思
存儲
FPGA
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ZongYu
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萊迪思CrossLink-NX:用于嵌入式視覺處理的FPGA
積分:0分
萊迪思
FPGA
機器視覺
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ZongYu
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量子計算機仿真器Qulacs的多SATA FPGA實現(xiàn)
積分:0分
量子計算機
FPGA
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wenliang37
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萊迪思CertusPro-NX FPGA
積分:0分
萊迪思
FPGA
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ZongYu
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FPGA視頻教程之Quartus II的基礎(chǔ)知識免費下載
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FPGA
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wenliang37
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Altera FPGA的選型及開發(fā)
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Altera
FPGA
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wenliang37
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Altera FPGA_CPLD設(shè)計(實例源代碼)
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Altera
FPGA
CPLD
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wenliang37
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Altera FPGA CPLD學(xué)習(xí)筆記
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Altera
FPGA
CPLD
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Altera FPGA/CPLD設(shè)計(高級篇)
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Altera
FPGA/CPLD設(shè)計
(高級篇)
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基于fpga實現(xiàn)信號發(fā)生器
積分:0分
FPGA
信號發(fā)生器
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wenliang37
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如何使用Xilinx的FPGA對高速PCB信號實現(xiàn)優(yōu)化設(shè)計
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FPGA
PCB
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wenliang37
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XILINX ARTIX7系列FPGA芯片產(chǎn)品目錄
積分:0分
FPGA
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wenliang37
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iCE40 LP/HX系列FPGA:萊迪思半導(dǎo)體公司的創(chuàng)新可編程解決方案
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FPGA
萊迪思
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ZongYu
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CPLD/FPGA的基本知識
積分:0分
CPLD
FPGA
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wenliang37
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萊迪思Avant-X系列中端通用FPGA Data Sheet
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萊迪思
FPGA
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ZongYu
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Platform Manager 2 & L-ASC10 Data Sheet
積分:3分
FPGA
萊迪思
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ZongYu
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Altera FPGACPLD設(shè)計(高級篇)
積分:0分
FPGA
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wenliang37
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基于FPGA的五軸機器人手臂控制器
積分:0分
機械臂
微控制器
FPGA
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xiaxue
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基于英特爾? FPGA SmartNIC N6000-PL 平臺的英特爾? 加速虛擬蜂窩基站路由器解決方案,助力通信服務(wù)提供商 (CoSP) 提高服務(wù)創(chuàng)收能力
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英特爾
FPGA
SmartNIC
N6000-PL
虛擬蜂窩基站
路由器
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lijian
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利用英特爾Agilex FPGA 構(gòu)建更具成本效益、更高效的5G無線電
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英特爾
Agilex
FPGA
5G
無線電
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lijian
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量子計算機仿真器Qulacs的多SATA FPGA實現(xiàn)
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Qulacs
SATA
FPGA
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zhangsfan
下載
EEPW2023年6月刊
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fpga
sic
ZigBee
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lindar2000cn
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EEPW2023年5月刊
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智能工廠
fpga
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verilog計算modbus幀報文 調(diào)試了3天分享給大家
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modbus
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FPGA讀取EEPROM源代碼
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讀取
EEPROM源代碼
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ZYNQ(FPGA)與DSP之間SRIO通信
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FPGA設(shè)計中,Vivado 調(diào)用IP核詳細操作步驟
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