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MAE0621

積分：0分 MAE0621 替代RTL8211F RGMII 1000M Ethernet PHY | 18126125171

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MIPI D-PHY 一致性解決方案

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MIPI D-PHY 物理層一致性測試

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MIPI spec

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MIPI DSI/CSI測試方案

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mipi 顯示屏接口文檔

積分：0分 D-PHY Specification v01-00-00 | zhuanjifen

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78Q8430布板指南

積分：0分 Maxim 10BASE-T 100BASE-TX Fast Ethernet media-access controller MAC PHY transceiver Teridian | soothmusic

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【用戶指南】Altera收發(fā)器PHY IP核用戶指南(Altera Transceiver PHY IP Core User Guide)

積分：0分 Altera transceiver xcvr SERDES TX RX 10GBASE-R XAUI Interlaken PCI Express PIPE custom low latency deterministic latency PHY IP core | bobgeng

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【用戶指南】ALTDLL和ALTDQ_DQS宏功能模塊用戶指南(ALTDLL and ALTDQ_DQS Megafunctions User Guide)

積分：0分 Altera ALTDLL ALTDQ_DQS DQ DQS DLL delay-locked loops custom PHY custom interfaces delay chain setting phase offset control | bobgeng

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【用戶指南】10Gbps以太網媒體訪問控制器宏功能模塊用戶指南(10-Gbps Ethernet MAC MegaCore Function User Guide)

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【應用筆記】AN328:Stratix II、Stratix II GX、and Arria GX器件和DDR2 SDRAM的接口(AN 328: Interfacing DDR2 SDRAM with Stratix II, Stratix II GX, and Arria GX Devices)

積分：0分 Altera FPGA ddr2 sdram interface memory interface design flow example walkthrough legacy data path architecture altmemphy megacore legacy phy board level simulation stratix ii stratix ii gx arria | bobgeng

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【應用筆記】10Gpbs以太網MAC和XAUI PHY互操作性硬件演示參考設計(10-Gbps Ethernet MAC and XAUI PHY Interoperability Hardware Demonstration Reference Design)

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【應用筆記】AN359:POS-PHY Level 4 MegaCore功能模塊參數(shù)選擇計算器(AN 359: POS-PHY Level 4 MegaCore Function Parameter Selection Calculator)

積分：0分 Altera POS-PHY Level 4 MegaCore | bobgeng

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【應用筆記】PCI Express宏功能函數(shù)的外部PHY支持(External PHY Support in PCI Express MegaCore Functions)

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【應用筆記】AN462:使用ALTMEMPH宏功能模塊實現(xiàn)多存儲器接口(AN 462: Implementing Multiple Memory Interfaces Using the ALTMEMPHY Megafunction)

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【應用手冊】 AN 606: POS-PHY Level 4 (SPI-4.2) Loopback Reference Design

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eSATA的測量方法

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【應用手冊】Single-Port Triple-Speed Ethernet and On-Board PHY Chip Reference Design

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【應用手冊】Implementing the CPRI Protocol using the Deterministic Latency Transceiver PHY IP Core

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工業(yè)以太網解決方案

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Stratix V 器件Interlaken PHY IP 設計流程

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Teranetics采用泰克儀器驗證首個雙端口10GBASE-T PHY

積分：0分 TekTronix 10GBASE-T PHY | ylzhjy

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約束并分析Stratix IV, Stratix III, Arria II GX和Cyclone III器件外部存儲器接口時序

積分：0分 Altera Stratix IV Stratix III Arria II GX Cyclone III FPGA 外部存儲器接口 PHY | bobgeng

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usb2代碼

積分：0分 USB IP Core IOs HW SSRAM UTMI PHY Software Model | tvro_china

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an360 設計仿真模型for the POS-PHY Level 4 MegaCore

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ASIC to FPGA 設計方法和指導

積分：0分 Altera ASIC FPGA EDA PHY SPOC Quartus Ⅱ | tvro_china

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WiFi vs. WiMAX 個人收集之研究論文資料2

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Updating Simulation Models for the POS-PHY Level 4 MegaCore Function

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DS80C400 and PHY Reset

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Xilinx嵌入式雜志第二期

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