<meter id="pryje"><nav id="pryje"><delect id="pryje"></delect></nav></meter>
          <label id="pryje"></label>

          新聞中心

          Xilinx FPGA的Fast Startup

          作者:Joachim Meyer 時間:2011-11-11 來源:電子產(chǎn)品世界 收藏

            在眾多當代應(yīng)用中,嵌入式系統(tǒng)必須滿足極其苛刻的時序要求。其中之一就是啟動時間——即上電后電子系統(tǒng)進入可操作狀態(tài)所需要的時間。PCI Express產(chǎn)品或汽車應(yīng)用中基于CAN的電子控制單元(ECU)就是具有嚴格時序要求的電子系統(tǒng)的應(yīng)用實例。

          本文引用地址:http://www.ex-cimer.com/article/125814.htm

            標準PCI Express(PCIe)系統(tǒng)上電后僅100毫秒,系統(tǒng)的根組件就開始掃描總線以便弄清拓撲結(jié)構(gòu),并在這一過程中進行初始化配置。 如果PCIe設(shè)備沒有準備好響應(yīng)配置請求,根組件就找不到此PCIe設(shè)備,并認為它不存在。該設(shè)備將無法加入PCIe總線系統(tǒng)。[1]

            汽車應(yīng)用中的情形與此大體相仿。在基于CAN的網(wǎng)絡(luò)中,ECU進入睡眠模式,這時它們將停止運行并切斷電源連接。只有很少部分電路仍然保持戒備狀態(tài),以便探測喚醒信號。一旦出現(xiàn)喚醒事件,ECU就會重新連接電源并開始引導(dǎo)。雖然在喚醒事件后的頭一個100 毫秒內(nèi)允許錯過一些消息,但在此之后所有ECU都必須在網(wǎng)絡(luò)(如CAN網(wǎng)絡(luò))上做好充分的運行準備。

             Automotive、研究實驗室以及德國卡爾斯魯厄技術(shù)研究所之間合作展開了深入的研發(fā)工作,正在設(shè)法通過一種兩步配置方法解決這一問題。

            半導(dǎo)體行業(yè)的科技趨勢已經(jīng)能使廠家大大增加其器件中的資源。但比特流規(guī)模也在成比例地增長,配置器件需要的時間也是如此。因此,即使對于中等規(guī)模的,使用低成本配置方案也不可能滿足嚴格的啟動時序要求。圖1表示不同的® Spartan®-6 FPGA器件在使用低成本SPI/Quad-SPI配置接口時的配置時間。即使使用快速配置方案(即在40 MHz配置時鐘下運行的Quad-SPI),也只有小型FPGA器件才能達到100 毫秒的啟動時序要求。對于Xilinx Virtex®-6器件來說,這個結(jié)果看來更具挑戰(zhàn)性,因為這些器件提供了更豐富的FPGA資源。

            為了克服這個難題,F(xiàn)ast Startup分兩步配置FPGA器件,而非單步(整片)的全器件配置。按照這種新穎的思路,我們的策略是在上電時使用最高優(yōu)先級比特流僅載入時序關(guān)鍵模塊,然后再載入非時序關(guān)鍵模塊。這種方法最大程度地減少了初始配置數(shù)據(jù),從而最大程度地減少了在面向時序關(guān)鍵設(shè)計的FPGA器件啟動時間。

            FAST STARTUP對比部分重配置

            Fast Startup允許FPGA設(shè)計盡快啟動設(shè)計的關(guān)鍵模塊,關(guān)鍵模塊的啟動速度比標準全配置方法要快得多[2]。雖然,從本質(zhì)上來講Fast Startup利用了部分重配置,但它與這種方法的傳統(tǒng)概念所有不同。部分重配置的初衷是將完整設(shè)計作為可在運行時修改的初始配置使用。相反,F(xiàn)ast Startup已經(jīng)使用了一個初始的部分比特流,以在上電時僅僅配置FPGA器件的一個特定(很小的一部分)區(qū)域。第一次配置僅包含完整FPGA設(shè)計中必須配置和快速運行的那些部分。而剩下的部分則在以后、在運行時,利用部分重配置進行配置。圖2說明了這一順序概念。

            工具流程概述

            Fast Startup的工具流程依靠設(shè)計保存流程,來創(chuàng)建針對時序關(guān)鍵子系統(tǒng)及非時序關(guān)鍵子系統(tǒng)的部分比特流。

            設(shè)計保存流程將FPGA設(shè)計分割為邏輯模塊(稱為“分區(qū)”)。分區(qū)構(gòu)成了層次邊界,將內(nèi)部模塊與設(shè)計中的其他組件相互隔離。分區(qū)一旦實現(xiàn)(即完成布局和布線),就能被其他實現(xiàn)運行導(dǎo)入,以按照每個實例中完全相同的方式實現(xiàn)該分區(qū)的模塊[3]。

            因此,使用Fast Startup方法的第一步是將完整的FPGA設(shè)計分成兩部分:即含有時序關(guān)鍵子系統(tǒng)的高優(yōu)先級分區(qū)和針對其余組件的低優(yōu)先級分區(qū)。

            

           

            圖1-計算出的Spartan-6配置時間的對數(shù)表示(按最壞情況計算)

            

           

            圖2 – Fast Startup概念:順序配置


          上一頁 1 2 3 4 5 下一頁

          關(guān)鍵詞: 賽靈思 Xilinx FPGA

          評論


          相關(guān)推薦

          技術(shù)專區(qū)

          關(guān)閉
          看屁屁www成人影院,亚洲人妻成人图片,亚洲精品成人午夜在线,日韩在线 欧美成人 (function(){ var bp = document.createElement('script'); var curProtocol = window.location.protocol.split(':')[0]; if (curProtocol === 'https') { bp.src = 'https://zz.bdstatic.com/linksubmit/push.js'; } else { bp.src = 'http://push.zhanzhang.baidu.com/push.js'; } var s = document.getElementsByTagName("script")[0]; s.parentNode.insertBefore(bp, s); })();