基于LabVIEW和ARM嵌入式數(shù)據(jù)采集與遠(yuǎn)程傳輸控制系統(tǒng)
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2．2 ADC6620設(shè)計(jì)
AD6620的任務(wù)是將高速數(shù)據(jù)流變成當(dāng)前可實(shí)時(shí)處理的中低速數(shù)據(jù)流。在本設(shè)計(jì)中，AD6620數(shù)據(jù)輸入端代表指數(shù)含義的3位(EXP0～EXP2)接地，且工作在單輸入通道模式下(A／B=3．3 V)，以模式0接收來(lái)自于ARM的配置信息(MODE=GND)，采用并行方式輸出數(shù)據(jù)(PAR／SER=3．3 V)。
2．3 其它設(shè)計(jì)
本設(shè)計(jì)所采用的ARM開發(fā)板是由廣州友善之臂公司所生產(chǎn)的QQ2440V3，其上有一個(gè)44針的系統(tǒng)總線接口，它與FPGA連接起來(lái)完成數(shù)據(jù)與控制信息的傳輸。FPGA與SRAM的設(shè)計(jì)比較簡(jiǎn)單，這里不再贅述。本文引用地址：http://www.ex-cimer.com/article/152253.htm
3 數(shù)據(jù)采集系統(tǒng)的軟件設(shè)計(jì)
為完成系統(tǒng)任務(wù)，需要實(shí)現(xiàn)幾個(gè)方面的軟件設(shè)計(jì)：
a)正交數(shù)字下變頻器AD6620濾波器以及控制寄存器設(shè)計(jì)。
b)在FPGA上實(shí)現(xiàn)系統(tǒng)控制、SRAM讀寫地址生成、數(shù)據(jù)通道選擇等功能的Verilog HDL程序。
c)ARM上基于嵌入式Linux操作系統(tǒng)的數(shù)據(jù)采集硬件驅(qū)動(dòng)程序。
d)ARM上客戶端應(yīng)用程序。
e)遠(yuǎn)程主機(jī)上基于LabVIEW的服務(wù)器以及顯示、頻譜分析、存儲(chǔ)與回放程序。
3．1 AD6620濾波器及控制寄存器設(shè)計(jì)
AD公司專門針對(duì)AD6620芯片推出了濾波器設(shè)計(jì)軟件fltrdsn以及監(jiān)視控制軟件AD6620，但該軟件是基于計(jì)算機(jī)并口與AD6620芯片連接的，不適應(yīng)設(shè)計(jì)中遠(yuǎn)程數(shù)據(jù)傳輸與控制、多客戶端的任務(wù)要求?？梢岳迷撥浖⒃O(shè)計(jì)成功的濾波器以及配置文件保存下來(lái)，利用LabVIEW的文件處理功能自動(dòng)將信息提取出來(lái)，通過(guò)網(wǎng)絡(luò)遠(yuǎn)程配置AD6620。
3．2 FPGA邏輯設(shè)計(jì)
FPGA內(nèi)部邏輯電路結(jié)構(gòu)見圖2?？紤]到后續(xù)設(shè)計(jì)的需要，F(xiàn)PGA內(nèi)部使用ARM地址總線的低3位來(lái)選擇當(dāng)前操作的模塊，具體的地址與內(nèi)部模塊對(duì)應(yīng)關(guān)系見表1。
圖2中各模塊功能進(jìn)一步說(shuō)明如下：
a)Input_db_part：雙向數(shù)據(jù)總線分離。配合由Control_register送來(lái)的控制信號(hào)，在Conf_6620有效時(shí)將數(shù)據(jù)總線上的數(shù)據(jù)送至Config_6620模塊，完成AD6620配置，在Fetch_sram信號(hào)有效時(shí)將讀SRAM得到的數(shù)據(jù)傳送至ARM數(shù)據(jù)總線。
評(píng)論