基于高性能AD9640的抗干擾無線接收機設(shè)計

在無線接收機射頻前端硬件的實際制作中，中頻頻率的選擇、帶通濾波器的中心頻率與3dB帶寬、外部無源器件的使用等設(shè)計考慮，都需要隨著不同的系統(tǒng)應(yīng)用而仔細的規(guī)劃與調(diào)整，以便在適當?shù)某杀鞠逻_到規(guī)定的性能。本文以認知抗干擾為設(shè)計目標，主要討論了接收機鏈路的核心器件之一—高性能的ADC，敘述它們?nèi)绾螡M足對高性能的需求。此外，接收機系統(tǒng)的設(shè)計還包括器件的選擇和設(shè)計，整體排版布線以及調(diào)試過程等步驟。

　　ADC設(shè)計

　　天線接收到的射頻信號必須經(jīng)過A/D數(shù)字化，以便后面的數(shù)字處理芯片進行數(shù)字信號處理[1]。ADC影響接收機體系的功耗、工作頻率動態(tài)范圍、接收帶寬和總體成本，其性能更是能夠影響接收機結(jié)構(gòu)的設(shè)計。理想情況下，在接收機的鏈路天線后直接進行數(shù)據(jù)轉(zhuǎn)換，ADC對射頻信號直接進行抽樣，這樣很大程度上繞過了模擬器件。而本文接收機體系結(jié)構(gòu)的一個重要特點是將ADC盡量靠近射頻前端，在較高的中頻直接進行數(shù)字化，因此A/D設(shè)計是接收機設(shè)計的核心之一。

　　選定最優(yōu)采樣頻率

　　如果對采樣輸出信號進行濾波的低通濾波器可以做到矩形系數(shù)為1，在無混疊的采樣率范圍內(nèi)選定任何一個頻率都是可以的(不考慮采樣時鐘的抖動)。但是實際上，這樣的濾波器是做不出來的，即使是矩形系數(shù)接近于1的低通濾波器也很難實現(xiàn)。如果后續(xù)的低通濾波器在過渡帶里面沒有頻譜的平移轉(zhuǎn)換，那么，即使矩形系數(shù)大一些也不會改變原信號的頻譜結(jié)構(gòu)，這也就意味著平移頻譜之間的間隔應(yīng)該越大越好。對于無混疊的采樣率來說，并不是頻率越高間隔越大，頻譜間隔最大的無混疊采樣率在降低后續(xù)低通濾波器的設(shè)計難度上是最優(yōu)的。

　　本文首先討論無混疊采樣率與平移的頻譜間隔的關(guān)系，然后結(jié)合方案選擇一個最優(yōu)的采樣頻率。

　　對圖1中虛線所示的頻譜塊，其左間距表示為：

　　-fH+(m-1)fs-[fH-(m-1)fs]=2(m-1)fs-2fH (m=1, 2, 3…)

　　右間距表示為：

　　fL-(-fL+mfs)=-mfs+2fL

　　使頻譜間隔最大條件是頻譜塊的左間距等于右間距：

　　2mfs-2fH=-mfs+2fL

　　即

　比如天線接收的信號是75MHz中頻，帶寬1MHz的信號，所以使頻譜間隔最大的采樣頻率為：fs=133.3333、66.6667、33.3333、26.6667MHz…(m=1, 2, 3, 4…)。注意，上面所指的頻譜間隔最大是對于相應(yīng)的m而言的，對于不同的m來說，間隔的絕對值隨m的增大而減小。

　　由于超過100MHz的高精度A/D器件價格昂貴，我們選擇m=2，這時的無失真采樣頻率fs的范圍是50.3333MHz≤fs≤75.5100MHz。同時考慮到ADC采樣頻率與中頻濾波器的帶寬之間必須滿足一定的關(guān)系：

　　fs≥B+B×w

　　其中w是該中頻帶通濾波器的矩形系數(shù)，本文設(shè)為：w=3。此時，ADC采樣通帶不會發(fā)生混疊，但過渡帶將會混疊，直到ADC采樣頻率增大到上式右邊的兩倍后，過渡帶才不會混疊。從本質(zhì)上看，還是會“混疊”的，但此時“混疊”的信號已被衰減得很微弱，比如衰減到比通帶信號小70dB以上。

　　最后考慮到后續(xù)DDC器件進行速率轉(zhuǎn)換后輸出速率為8MHz(由于ADC和后續(xù)算法處理要求)，采樣得到的信號速率最好是2的整數(shù)倍，同時又考慮到采樣時對信號頻段確定和控制的方便，最優(yōu)的采樣頻率選定為64MHz。這個采樣頻率產(chǎn)生的頻譜間隔對后續(xù)濾波器的設(shè)計也是足夠的。

　　器件選擇

　　綜合采樣精度和速率的要求對ADC進行選擇：16位的ADC可以達到大約96dB的信噪比，但是精度達到16位同時速度超過60 MHz 的ADC價格非常昂貴且不易購買到;14位的ADC可以達到大約84dB的信噪比，也可以滿足要求，還可以買到速度更快的產(chǎn)品。本設(shè)計選擇14位雙通道A/D器件AD9640[2]進行采樣。其主要性能為：可選最大采樣速率80、105、125、150MSPS;采樣精度14位;無雜散動態(tài)范圍85dB@125MSPS;信噪比71.8dB@ 125MSPS;低功耗750mW@125MSPS。
　　其中采樣速率的改變可通過改變輸入時鐘來實現(xiàn)，從而可實現(xiàn)在不改變硬件的情況下通過軟件來擴展。

　　設(shè)計高性能ADC之前的“前端”或輸入配置，是獲取所需系統(tǒng)性能的關(guān)鍵所在。整個設(shè)計的優(yōu)化[3]取決于許多因素，其中包括應(yīng)用的特點、系統(tǒng)劃分，以及ADC 的構(gòu)架等。許多放大器都十分適合用于高速ADC 的前端電路。ADA4937 能被用于150MHz以下的頻率;由于它能處理很大的輸出共模電壓范圍，因此它的主要優(yōu)勢是應(yīng)用于ADC 的直流耦合應(yīng)用中。對于窄帶或諧振應(yīng)用，使濾波器與放大器的輸出阻抗匹配，來消除ADC 的輸入電容。通常使用一個多極點濾波器來消除感興趣頻率范圍外的寬帶噪聲。

　　接收機PCB設(shè)計

　基于圖2的接收機框圖(圖中DDC使用四通道數(shù)字下變頻器AD6635)和PCB設(shè)計的基本要求，可以提出本文接收機PCB排版布線的總體要求如下：

　　● 所有電源在PCB板頂層或/和底層應(yīng)留出散熱區(qū)[4];

　　● 所有盒子輸入輸出接口位于PCB板的底層;

　　● PCB板頂層和底層大面積敷銅并接地;

　　● 電源及其附屬元件靠近，獨立驅(qū)動電源平面，電源平面為電源分配網(wǎng)絡(luò)。元器件供電從電源平面獲取，根據(jù)需要在靠近管腳處濾波;

　　● 所有電源線進入盒子安裝“穿心電容”;

　　● 放大器直接接地，同時應(yīng)該屏蔽所有高增益放大器以防止它們產(chǎn)生振蕩。