40納米500MHz DSP核心的時鐘設(shè)計與分析
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4) 計算同級延時，
ESi,corner=Di,corner/ESDcorner
5) 理想上，每個接收端應(yīng)可跨角點(diǎn)地?fù)碛型鹊募墧?shù)，例如，對于接收端j，
ESj,corner1=ESj,corner2=…
圖6和圖7所展示的例子是相同級數(shù)以及兩種實現(xiàn)方式的擴(kuò)展。在圖6中，ESD擴(kuò)展擁有從18到23的一種更好分布。在圖7中，微捷碼自帶CTS結(jié)果顯示了從27到37的一種分布。
圖7使用微捷碼自帶CTS的ESD擴(kuò)展
新時鐘設(shè)計方法已經(jīng)實施于40納米DSP核心。事實證明，使用這種方法的CTS單元門數(shù)要比使用微捷碼自帶CTS工具的少了17%。魯棒性低偏斜時鐘樹分布現(xiàn)已成功實現(xiàn)。實驗結(jié)果顯示，新設(shè)計方法在降低保持緩沖器門數(shù)方面可起到很好效果。同時這種設(shè)計方法還可用于H-tree時鐘結(jié)構(gòu)。未來工作中，我們還將部署更多分析來改善功耗。
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