51單片機（二）：單片機內部定時/計數(shù)器和中斷系統(tǒng)
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表4 IE寄存器
EA：中斷允許總控制位。EA=0，禁止所有中斷；EA=1，開放所有中斷，但是否允許各中斷源的中斷請求，還要取決于各中斷源的中斷允許控制位的狀態(tài)。這點要注意，初學者往往容易忘了開放所有中斷，從而導致沒法進入中斷源。
ET2 ：時器/ 計數(shù)器T2 的中斷允許位。
ES ：串行口的中斷允許位。
EX1 ：外部中斷1（INT1） 的中斷允許位。
EX0 ：外部中斷0（INT0） 的中斷允許位。
以上7 個中斷允許控制位為0 時，禁止中斷，為1 時允許中斷。
表5 IP寄存器
PT2 ：定時器/ 計數(shù)器T1 中斷優(yōu)先級控制位。
PS ：串行口中斷優(yōu)先級控制位。
PT1 ：定時器/ 計數(shù)器T1 中斷優(yōu)先級控制位。
PX1 ：外部中斷1 優(yōu)先級控制位。
PT0 ：定時器/ 計數(shù)器T0 中斷控制位。
PX0 ：外部中斷0 中斷優(yōu)先級控制位。
以上6 個中斷優(yōu)先級控制位分別為“0”時為低級中斷，為“1”時為高級中斷。如果幾個同一優(yōu)先級的中斷源同時向CPU 申請中斷，CPU 通過內部順序查詢邏輯電路，按自然優(yōu)先級順序確定該響應哪個中斷請求。自然優(yōu)先級由硬件形成，其優(yōu)先級別從高到底為外部中斷0、定時器/ 計數(shù)器T0、外部中斷1、定時器/ 計數(shù)器T1、串行口中斷、定時器/ 計數(shù)器T2。
至此，對定時器控制相關的重要寄存器都介紹完畢了，接下來通過編寫程序來進行驗證實踐。
二、電路詳解
此講采用和上講一樣的電路，在此不做贅述（見圖1）。
圖1 定時器應用實驗電路圖
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