基于FPGA 的諧波電壓源離散域建模與仿真

電壓外環(huán)PI 環(huán)節(jié)可表示為：

式中u(t)———控制量

e(t)———系統(tǒng)的控制偏差

Ti———積分時(shí)間

Kp———比例系數(shù)

為了搭建離散域模型，在近似條件下得離散化方程為：

式中T———采樣周期

k———采樣序號(hào)，k = 1，2，…

e(k)———PI 環(huán)節(jié)的輸入信號(hào)

Ki = Kp /Ti———積分系數(shù)

將式(2) 與uk － 1的表達(dá)式進(jìn)行比較，則可得到第k 次采樣時(shí)刻的離散方程:

根據(jù)PI 的離散方程，可構(gòu)建VHS-ADC 模型。

以電壓外環(huán)PI 為例，其模型如圖4 所示。CMult為乘法器模塊，大小等于采樣時(shí)間T;Convert 為數(shù)據(jù)轉(zhuǎn)化模塊，將輸入信號(hào)轉(zhuǎn)化為合理的數(shù)據(jù)格式。數(shù)據(jù)格式由數(shù)據(jù)位數(shù)和小數(shù)位數(shù)確定，在保證仿真精度的前提下，盡量減小數(shù)據(jù)位數(shù)，節(jié)約硬件資源。

圖4 電壓外環(huán)PI 模型。

利用3 個(gè)加法器和1 個(gè)減法器，可實(shí)現(xiàn)限幅環(huán)節(jié)。減法器運(yùn)算結(jié)果為負(fù)時(shí)，輸出為0;運(yùn)算結(jié)果為正時(shí)，輸出為正常值。Constant1 和Constant2分別設(shè)置限幅模塊的上、下限，限幅環(huán)節(jié)的模型如圖5 所示。

圖5 限幅環(huán)節(jié)模型。

利用延遲模塊和邏輯模塊，可設(shè)置逆變器死區(qū)時(shí)間。輸入信號(hào)經(jīng)過Delay 模塊，被延遲4 個(gè)采樣周期時(shí)間，再與原信號(hào)進(jìn)行邏輯與運(yùn)算，就可得到帶有死區(qū)時(shí)間的PWM 信號(hào)，被Delay 模塊延遲的時(shí)間就是設(shè)置的死區(qū)時(shí)間。死區(qū)時(shí)間模型如圖6 所示。

圖6 死區(qū)時(shí)間的VHS-ADC 模型。

依靠平臺(tái)提供的co-simulink 接口，將搭建的離散域控制模型進(jìn)行編譯，并自動(dòng)生成代碼，下載到FPGA，生成一個(gè)bit 流文件，將含有bit 文件的協(xié)議同仿真模塊與諧波電壓源的主電路連接。當(dāng)在Simulink 中進(jìn)行仿真時(shí)，F(xiàn)PGA 上的實(shí)時(shí)運(yùn)算結(jié)果返回到Simulink 環(huán)境中，提高了仿真速度。