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          基于位線循環(huán)充電SRAM模式的自定時電路設(shè)計

          作者: 時間:2010-11-02 來源:網(wǎng)絡(luò) 收藏

          HBLSA-不僅可以降低位線的電壓擺幅,還可以有效地減小位線的電容負載。位線的負載電容很大程度上取決于位線上連接的MOS管數(shù)量。如圖1所示,在每一個Group中有M個存儲單元,而一共有N個Group,所以總共有M×N個存儲單元。對于一個傳統(tǒng)的結(jié)構(gòu)有如此的容量,那么其位線上一共會接M×N個MOS管。但對于HBLSA-來說,將連接到主位線和局部位線的MOS管加在一起也不過N+M+5個。其中,對于主位線一共連接N個MOS管,而局部位線一共連接M+5個MOS管,M為M個存儲單元的傳輸管,有1個來自與主位線連接的MOS管,另外4個來自局部的靈敏放大器。所以,不但位線擺幅顯著下降,而且位線電容負載也下降了。
          HBLSA-SRAM的讀寫功耗與傳統(tǒng)的SRAM比較如下:
          (1)對于寫入功耗
          傳統(tǒng)的SRAM:

          式中:PBL代表主位線上的功耗;PSBL代表局部位線上的功耗;CBL代表局部位線的電容負載;CSBL代表主位線的電容負載;CCVBL代表傳統(tǒng)結(jié)構(gòu)位線的電容負載;VBL代表局部位線的電壓擺幅。通過之前的分析,有(CBL+CSBL)CCVBL,VBLVDD。所以,顯然HBLSA-SRAM的寫入功耗小于傳統(tǒng)的SRAM。
          (2)對于讀出功耗
          傳統(tǒng)的SRAM:

          式中:VCVBL代表讀出傳統(tǒng)結(jié)構(gòu)的位線電壓擺幅??梢哉J為,VCVBL和VBL近似相等,所以HBLSA-SRAM的讀出功耗也小于傳統(tǒng)的SRAM。

          2 位線SRAM的自
          將位線SRAM的結(jié)構(gòu)與雙電路相結(jié)合,為了進一步減小CRSRAM的功耗和優(yōu)化器讀寫延時,提出位線SRAM的雙電路結(jié)構(gòu)(DMST CRSRAM)。其時序控制電路如圖2所示。

          本文引用地址:http://www.ex-cimer.com/article/180310.htm



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