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          低功耗8-bit 200MSPS時(shí)間交織流水線ADC
          
						
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				作者：張倬 王宗民 周亮 馮文曉
				時(shí)間：2013-11-27
				來源：電子產(chǎn)品世界
				
				
				
				
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          　　因?yàn)榻徊纥c(diǎn)總是都在-1/2 和1/2處，且1/4 或-1/4處的跳變高度比電容翻轉(zhuǎn)式的大，電荷轉(zhuǎn)移結(jié)構(gòu)能更好的實(shí)現(xiàn)校正。
          本文引用地址：http://www.ex-cimer.com/article/197924.htm

          　　當(dāng)Δ是正數(shù)時(shí)，電荷轉(zhuǎn)移結(jié)構(gòu)會(huì)造成失碼，但是對(duì)比于電容翻轉(zhuǎn)結(jié)構(gòu)在交叉點(diǎn)和跳變電的偏差，失碼引起的誤差對(duì)性能造成的影響較小。圖4給出不同電容失配情況下兩種結(jié)構(gòu)SNDR的變化。
          

          

          　　電荷轉(zhuǎn)移結(jié)構(gòu)也有缺點(diǎn)，最重要的一點(diǎn)是較小的反饋因子造成對(duì)放大器更高的要求。但是在8位100MHz流水線ADC中，放大器并不是困難，所以消耗一些電流來減小電容失配對(duì)系統(tǒng)性能造成的影響是有必要的。
          

          　　放大器
          

          　　本電路采用的不是傳統(tǒng)的兩級(jí)放大器。第一級(jí)是共源放大器，第二級(jí)是共源共柵放大器，如圖5所示。
          

          
				
            
                
			
								
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