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          EEPW首頁 >> 主題列表 >> 流水線

          一個用于流水線模數(shù)轉(zhuǎn)換器的高精度、低功耗采樣保持電路

          • 介紹了一個用于高精度模數(shù)轉(zhuǎn)換器,采用0.25μmCMOS工藝的高性能采樣保持電路。該采樣保持電路的采樣頻率為20MHz,允許最大采樣信號頻率為10MHz,在電源
          • 關(guān)鍵字: 流水線  高精度  低功耗  采樣保持電路  

          關(guān)于處理器流水線,此流水線非彼流水線

          •   本文將討論處理器的一個重要的基礎(chǔ)知識:“流水線”。熟悉計算機體系結(jié)構(gòu)的讀者一定知道,言及處理器微架構(gòu),幾乎必談其流水線。處理器的流水線結(jié)構(gòu)是處理器微架構(gòu)最基本的一個要素,猶如汽車底盤對于汽車一般具有基石性的作用,它承載并決定了處理器其他微架構(gòu)的細節(jié)。本文將簡要介紹處理器的一些常見流水線結(jié)構(gòu),讓您真正讀懂處理器流水線?! ??從經(jīng)典的五級流水線說起  流水線的概念來源于工業(yè)制造領(lǐng)域,以汽車裝配為例來解釋流水線的工作方式,假設(shè)裝配一輛汽車需要四個步驟:  第一步?jīng)_壓:制作車身外殼和底盤等部件?!?/li>
          • 關(guān)鍵字: 處理器  流水線  

          Xilinx哈夫曼編碼系統(tǒng)設(shè)計 

          • 在圖像處理、文件傳真、視頻壓縮編碼中,哈夫曼編碼是最常用的一種編碼方式。本文設(shè)計并實現(xiàn)了對一段數(shù)字序列進行哈夫曼編碼并將編碼結(jié)果串行輸出的電路模塊,電路由輸入數(shù)據(jù)的排序、數(shù)據(jù)的哈夫曼編碼、數(shù)據(jù)序列編碼的結(jié)果輸出三個核心模塊組成,在Xilinx平臺上通過硬件描述語言實現(xiàn)該電路。仿真結(jié)果表明,該電路編碼正確,并具有較高的工作頻率和編碼效率。
          • 關(guān)鍵字: 哈夫曼編碼  流水線  并行  201711  

          基于并行流水線技術(shù)的RS255/RS233譯碼器設(shè)計

          • 近年來,關(guān)于RS(255,223)碼譯碼器實現(xiàn)的算法得到了廣泛的關(guān)注,但是這些算法的實現(xiàn)速度都不太快,即便有速度稍高的,其占用硬件資源也較多,而一些占用硬件資源較少的算法速度卻很慢。本文采用基于ME算法的8倍并行設(shè)計方案,結(jié)合流水線技術(shù),克服了上述算法的缺陷,利用盡可能少的硬件資源獲得了極高的譯碼速度。
          • 關(guān)鍵字: ModelSim  RS糾錯編碼  流水線  

          基于PLB總線的H.264整數(shù)變換量化軟核的設(shè)計

          • 提出了在FPGA上實現(xiàn)H.264中整數(shù)變換量化的方法,設(shè)計了基于動態(tài)數(shù)據(jù)寬度和流水線技術(shù)的軟核(IP),在處理速度和硬件資源方面分別進行優(yōu)化。此軟核作為PowerPC的一個硬件加速模塊在Xilinx Virtex-ⅡPRO中進行了驗證。
          • 關(guān)鍵字: 動態(tài)數(shù)據(jù)寬度  流水線  軟核  

          數(shù)字電視CAS中DES加密模塊的FPGA實現(xiàn)

          • 一種基于FPGA的數(shù)據(jù)加密標(biāo)準(zhǔn)算法的實現(xiàn)。就資源優(yōu)先和性能優(yōu)先分別使用循環(huán)法和流水線法對DES加密算法進行了設(shè)計,并對其進行了比較。通過采用子密鑰簡單產(chǎn)生和ROM優(yōu)化S盒的方法,對流水線法進行改進,達到了資源占用率低、加密速度快的效果。
          • 關(guān)鍵字: 數(shù)據(jù)加密標(biāo)準(zhǔn)算法  DES  FPGA  流水線  

          基于流水線及混合濾波技術(shù)的H.264去塊效應(yīng)模塊設(shè)計

          • 引 言圖像的編解碼技術(shù)是多媒體技術(shù)的關(guān)鍵,H.264/AVC是國際上最先進的視頻壓縮技術(shù),其主要特點是采用小尺寸整數(shù)余弦變換、1/4像素的運動估計精度、多參考幀預(yù)測,基于上下文可變長度編碼和環(huán)路內(nèi)去塊效應(yīng)濾波器
          • 關(guān)鍵字: 流水線  濾波技術(shù)  效應(yīng)    

          基于FPGA流水線結(jié)構(gòu)并行FFT的設(shè)計與實現(xiàn)

          • 離散傅里葉變換DFT在通信、控制、信號處理、圖像處理、生物信息學(xué)、計算物理、應(yīng)用數(shù)學(xué)等領(lǐng)域中有著廣泛的應(yīng)用。FFT算法是作為DFT快速算法提出的,它將長序列的DFT分解為短序列的DFT,大大減少了運算量。FFT的FPGA實
          • 關(guān)鍵字: FFT  FPGA  流水線  并行處理  

          針對Flash存儲特性的航天器大容量固態(tài)存儲技術(shù)

          • 隨著航天任務(wù)的不斷豐富、航天探測技術(shù)的不斷提高(如探測器種類增多,相機分辨率提高等),中國空間站等重大戰(zhàn)略規(guī)劃的逐步實施,空間科技數(shù)據(jù)的采集速度與存儲總量需求大幅度攀升,對存儲器的容量、吞吐速率、數(shù)據(jù)管
          • 關(guān)鍵字: 固態(tài)存儲器  Flash存儲特性  并行總線  流水線  Flash存儲系統(tǒng)  

          淺談機器視覺技術(shù)優(yōu)化流水線上的產(chǎn)品質(zhì)量控制

          • ThyssenKruppKrause有限公司是位于德國Bremen的全球性企業(yè)。該公司在整條流水線上使用康耐視的視覺技術(shù)來優(yōu)化產(chǎn)品的質(zhì)量控制,因此在質(zhì)量和成本效益方面體現(xiàn)了重要的優(yōu)勢作為向汽車行業(yè)提供流水線開發(fā)和生產(chǎn)的復(fù)雜自
          • 關(guān)鍵字: 機器視覺    流水線    質(zhì)量控制  

          流水線技術(shù)在編程器中的提速應(yīng)用

          •   摘要:美國思科公司總裁約翰·錢伯斯他在談到新經(jīng)濟的規(guī)律時說,現(xiàn)代競爭已經(jīng)不是大魚吃小魚,而是快的吃慢的.在現(xiàn)代競爭中,效率有著決定性的作用。專業(yè)的燒錄器廠商是如何做到比山寨燒錄產(chǎn)品的快呢?   美國思科公司總裁約翰·錢伯斯他在談到新經(jīng)濟的規(guī)律時說,現(xiàn)代競爭已“不是大魚吃小魚,而是快的吃慢的.”在現(xiàn)代競爭中,效率有著決定性的作用。   做嵌入式開發(fā)的工程師都知道,一旦產(chǎn)品需要量產(chǎn),批量生產(chǎn)的燒錄器必不可少。在調(diào)試階段,工程師可以用串口下載來實現(xiàn)代碼
          • 關(guān)鍵字: 流水線  編程器  

          一種基于流水線的SpaceWire路由器研究

          •   近年來,隨著SpaceWire總線技術(shù)在航天航空領(lǐng)域的不斷應(yīng)用,SpaceWire路由器在理論和技術(shù)應(yīng)用方面也得到了飛速發(fā)展。國外,歐洲航天局 (ESA)已經(jīng)將速度為200 Mb/s抗輻射的SpaceWire路由器應(yīng)用到ESA的航天任務(wù)中。國內(nèi),目前對SpaceWire路由器的研究還處于初級階段,設(shè)計的 SpaceWire路由器最高速度也只能達到100 Mb/s。為了提高路由器的傳輸速度,這里提出了一種基于流水線技術(shù)的SpaceWire路由器。   1 SpaceWire路由器概述   Space
          • 關(guān)鍵字: SpaceWire  路由器  流水線  

          FPGA研發(fā)之道(10)架構(gòu)設(shè)計漫談(五)數(shù)字電路的靈魂-流水線

          •   流水線,最早為人熟知,起源于十九世紀(jì)初的福特汽車工廠,富有遠見的福特,改變了那種人圍著汽車轉(zhuǎn)、負責(zé)各個環(huán)節(jié)的生產(chǎn)模式,轉(zhuǎn)變成了流動的汽車組裝線和固定操作的人員。于是,工廠的一頭是不斷輸入的橡膠和鋼鐵,工廠的另一頭則是一輛輛正在下線的汽車。這種改變,不但提升了效率,更是拉開了工業(yè)時代大生產(chǎn)的序幕。   如今,這種模式常常應(yīng)用于數(shù)字電路的設(shè)計之中,與現(xiàn)在流驅(qū)動的FPGA架構(gòu)不謀而合。舉例來說:某設(shè)計輸入為A種數(shù)據(jù)流,而輸出則是B種數(shù)據(jù)流,其流水架構(gòu)如下所示:    ?   每個模塊只
          • 關(guān)鍵字: FPGA  架構(gòu)設(shè)計  流水線  

          一種基于FPGA的流水線FIR濾波器設(shè)計

          •   摘要:有限沖擊響應(yīng)(FIR)濾波器是數(shù)字通信系統(tǒng)中常用的基本模塊。文章設(shè)計了一種流水結(jié)構(gòu)的FIR濾波器,通過FPGA對其進行硬什加速控制。仿真結(jié)果驗證了所設(shè)計的FIR流水結(jié)構(gòu)濾波器功能的正確性。   0 引言   隨著數(shù)字通信技術(shù)的快速發(fā)展,高質(zhì)量的信息處理對濾波器的性能和資源占有量提出了更高的要求。有限沖擊響應(yīng)(FIR)數(shù)字有限沖激響應(yīng)濾波器在語音、譜分析等數(shù)字信號處理領(lǐng)域有著廣泛的應(yīng)用,是信號處理系統(tǒng)中重要的組成部分,其性能往往對整個系統(tǒng)的性能和功耗產(chǎn)生至關(guān)重要的影響。因此,如何最大程度地優(yōu)化
          • 關(guān)鍵字: FPGA  FIR濾波器  流水線  

          低功耗8-bit 200MSPS時間交織流水線ADC

          • 摘要:本文介紹了一款低功耗8位200MSPS的模數(shù)轉(zhuǎn)換器。ADC是由時間交織和逐級遞減技術(shù)來實現(xiàn)低功耗的。流水級和放大器的設(shè)計保證了低電流下滿足工藝、電壓、溫度(PVT)變化。本ADC采用0.35μm 雙層多晶硅柵三層金屬的CMOS工藝,在200MHz采樣頻率和41MHz輸入信號頻率下達到47.7dB的SNDR。
          • 關(guān)鍵字: ADC  放大器  無線通信  流水線  時鐘  201312  
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