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          CPLD芯片選型(一)

          作者: 時間:2017-06-06 來源:網(wǎng)絡(luò) 收藏

          經(jīng)過幾十年的發(fā)展,全球各大開發(fā)商和供貨商都開發(fā)出了多種可編程邏輯器件 . 比較典型的就是 公司的 FPGA 器件和 公司的 器件系列,他們開發(fā)較早,占有大部分市場?在歐洲用 的人多,而 公司占有日本和亞太地區(qū)的大部分市場,在美國則是平分秋色。以上兩家公司占有了全球 60% 以上的市場份額,他們共同決定了 PLD 技術(shù)的發(fā)展方向。 Lattice 公司在 1999 年收購了 Vantis ,成為第三大 PLD 供應(yīng)商。其它供貨商還有 Actel , Quicklogic , Lucent 等等,下面作一簡要介紹 :

          本文引用地址:http://www.ex-cimer.com/article/201706/349534.htm


          公司是 90 年代以后發(fā)展最快、最大的可編程邏輯器件供應(yīng)商之一。主要產(chǎn)品有 :MAX3000/7000 , FLEX10K , APEX20K , ACEX1K , Stratix , Cyclone 等;開發(fā)軟件為 MaxplusⅡ 和 QuartusⅡ 。其中 MaxplusⅡ 是公認的最成功的 PLD 開發(fā)平臺之一,配合使用 Altera 公司提供的免費 OEM HDL 綜合工具可以達到最高的效率。公司提供免費試用版或演示版 ( 當然商業(yè)版大都要收費的 ) ,可以免費從其公司網(wǎng)站上下載 MaxplusⅡ(BASELINE 版或?qū)W生版 ) ,或向其代理商索取該軟件,然后再從其專業(yè)網(wǎng)站上申請注冊文件 license 進行注冊以后便可使用。這套軟件能夠滿足一般學(xué)習(xí)和簡單開發(fā)的要求?


          公司是 FPGA 的發(fā)明者,也是全球最大的可編程邏輯器件的供應(yīng)商之一。產(chǎn)品種類較全,主要有 :XC9500/4000 , Coolrunner(XPLA3) , Spartan , Virtex 等;開發(fā)軟件為 Foundation 和 ISE 。 ISE(Integrated System Configuration) 提供從設(shè)計輸入、仿真、編譯、布局布線和下載的全程功能,其最新版本為 6 .1 版,支持 Xilinx 公司推出的所有最新的 FPGA 器件,如 Virtex-Ⅱ Pro , Virtex-Ⅱ , Spartan-Ⅱ E 和 coolrunner-Ⅱ 。該公司推出免費軟件 :WEB PACK 。同樣也需要在其專業(yè)網(wǎng)站上申請授權(quán)文件進行注冊才能使用。近年來, Xilinx 在其 FPGA 里固化了各種硬核,如存儲器,時鐘管理和算術(shù)功能,其最新的成果是在 FPGA 里集成了硬 CPU core 和高速串行 I/O core ,具有通過 Internet 重配置邏輯的功能。


          Lattice 是 ISP 技術(shù)的發(fā)明者, ISP 技術(shù)極大的促進了 PLD 產(chǎn)品的發(fā)展。與上兩家公司相比,其開發(fā)工具略遜一籌。中小規(guī)模的可編程邏輯器件較有特色。 1999 年推出可編程模擬器件,同年收購了 Vantis( 原 AMD 子公司 ) ,成為第三大可編程邏輯器件供應(yīng)商。于 2001 收購 Agere 公司 ( 原 Lucent 微電子部 ) 的 FPGA 部門。主要產(chǎn)品有 ispLSI2000/5000/8000 , MACH4/5 , ispMACH4000 等。

          Altera

          Altera公司作為全球最大的可編程邏輯器件供應(yīng)商之一,可提供MAX7000S(E)、MAX7000A(AE)、MAX7000B、FLEX6000A、FLEX10KA、FLEX 10KE 等系列產(chǎn)品。這些產(chǎn)品可用于組合邏輯、時序、算法、雙端口RAM、FIFO 的設(shè)計。在加ALTERA 公司的MAX+pulsII 9.62 開發(fā)軟件集設(shè)計輸入、處理、校驗和器件編程于一體,集成度高,開發(fā)周期短。
          EPM7000 系列 器件的性能特點
          •以第二代多陣列矩陣(MAX)結(jié)構(gòu)為基礎(chǔ),是一種高性能CMOS EEPROM 器件;
          •通過JTAG 接口可實現(xiàn)在線編程(ISP);
          •邏輯密度為600~5000 個可用編程門電路,128 個宏單元;
          •引腳到引腳的邏輯延時為5.0ns,計數(shù)器工作頻率可達到178MHz;
          •有集電極開路選擇,可編程宏單元觸發(fā)器;
          •具有專有的清除、時鐘、輸出使能控制;
          •包括一個可編程的程序加密位,全面保護專利設(shè)計。



          關(guān)鍵詞: Xilinx Altera 芯片 選型 CPLD

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