一種低成本小型化高性能寬帶本振合成裝置
作者 湯瑞 1.中國電子科技集團(tuán)有限公司第四十一研究所研發(fā)一部(安徽 蚌埠 233010) 2.電子信息測(cè)試技術(shù)安徽省重點(diǎn)實(shí)驗(yàn)室 通信測(cè)試技術(shù)(安徽 蚌埠 233010)
本文引用地址:http://www.ex-cimer.com/article/201806/382298.htm摘要:隨著移動(dòng)通信的高速發(fā)展,矢量信號(hào)發(fā)生器和分析儀的需求越來越大,高性能寬帶本振的高造價(jià)成為制約兩種儀器成本的主要因素之一。利用壓控振蕩器(VCO)實(shí)現(xiàn)高性能寬帶本振設(shè)計(jì),可以在降低模塊尺寸、降低模塊成本的前提下,實(shí)現(xiàn)高相噪、小型化的高性能本振。
*基金項(xiàng)目:國家科技重大專項(xiàng)(編號(hào):2016ZX03001007),安徽省重點(diǎn)研究與開發(fā)計(jì)劃(編號(hào):1704a0902031)
湯瑞(1988),男,碩士,助理工程師,研究方向:本振與射頻通道設(shè)計(jì)。
0 引言
移動(dòng)通信的發(fā)展帶動(dòng)了高性能、大帶寬的通信矢量信號(hào)發(fā)生器和分析儀的快速發(fā)展。本振的相位噪聲是制約發(fā)射機(jī)和接收機(jī)的關(guān)鍵性指標(biāo),也是衡量一臺(tái)儀器水平與檔次的重要標(biāo)志之一[1-2]。目前現(xiàn)有的具有高頻段、高相噪指標(biāo)的本振大部分采用基于YIG振蕩器的設(shè)計(jì)方案,此方案設(shè)計(jì)復(fù)雜,成本較高,用VCO設(shè)計(jì)的本振大多用于低端、經(jīng)濟(jì)型的產(chǎn)品中。如何用經(jīng)濟(jì)型的VCO 設(shè)計(jì)出高頻段高性能的本振以及把設(shè)計(jì)的高頻段高性能本振進(jìn)行小型化處理,對(duì)于既要求高指標(biāo),又要求低成本,而且便攜的測(cè)量?jī)x器來說已迫在眉睫。
1 方案設(shè)計(jì)
采用寬帶高性能VCO(ADI公司HMC586LC4B)外加寬帶放大器的方式做成的本振模塊,產(chǎn)生4.0 GHz~8.0 GHz,+12 dBm±1 dBm的本振信號(hào)輸出,是通信矢量信號(hào)源和分析儀整機(jī)射頻電路的核心模塊,其功能塊包括參考環(huán)電路、鑒相電路、Σ-Δ調(diào)制、分頻電路以及FPGA 控制電路等。設(shè)計(jì)的電路模塊的Σ-Δ調(diào)制器的寬度(16/24/32/48)可以通過調(diào)節(jié)對(duì)應(yīng)寄存器的值來控制,另外電路還包含掃頻功能。方案原理框圖如圖1所示。
方案中的各個(gè)模塊原理圖及功能簡(jiǎn)介如下:圖2為100 MHz參考環(huán)路模塊實(shí)現(xiàn)10 MHz高純參考通過鎖相環(huán)路變成100 MHz高頻參考,用作HMC984LP4E鑒相器的參考;圖3為FPGA控制電路模塊控制HMC983LP5E不同寄存器的送數(shù),實(shí)現(xiàn)鎖定不同頻率和掃頻功能;圖4為寬帶鎖相環(huán)路模塊通過HMC983LP5E分頻器、HMC984LP4E鑒相器、有源環(huán)路濾波器和寬帶耦合微帶電路實(shí)現(xiàn)4 GHz~8 GHz的寬帶鎖相環(huán)路。
模塊中使用的各個(gè)參數(shù)的值如下:
己知: fxtal= 100 MHz,R=2,L=48。
假設(shè)fvco= 4600.025 MHz,則4600.025 /(100 /2)= 92.005,所以Nint= 92。
由公式(1)可計(jì)算出fvco=140737488355.328,取Nfrac= 140737488355.328。
(1)
其中:
fvco:壓控振蕩器(VCO)頻率(單位Hz);
fxtal :晶振的頻率(單位Hz);
Nint :分頻數(shù)的整數(shù)部分;
Nfrac: 分頻數(shù)的小數(shù)部分;
R :參考頻率的分頻數(shù);
L : Σ-Δ調(diào)制器的寬度。
對(duì)應(yīng)寄存器因送入的值分別為5Ch,分?jǐn)?shù)分頻數(shù)存在兩個(gè)寄存器,Nfrac[17:0]的值為3A5E3h,Nfrac[47:18]的值為8312h。
由公式(2)可計(jì)算出分頻器的輸出頻率fout的值[3-5]。
(2)
Nint和Nfrac 可以通過設(shè)置相對(duì)應(yīng)的寄存器的值來設(shè)定,因此,當(dāng)需要得到某個(gè)輸出頻率時(shí),只要通過計(jì)算得到相對(duì)應(yīng)的整數(shù)和小數(shù)分頻數(shù),并把這兩個(gè)對(duì)應(yīng)的數(shù)值設(shè)定到對(duì)應(yīng)的寄有器,就可得到想要的輸出頻率。整數(shù)和小數(shù)分頻數(shù)是通過軟件計(jì)算得到并通過FPGA 按照dataSheet 的要求送入相應(yīng)的寄存器內(nèi)。
2 關(guān)鍵電路設(shè)計(jì)
2.1 高頻寬帶耦合器設(shè)計(jì)
設(shè)計(jì)初期采用3個(gè)17.8 Ω電阻組成功分網(wǎng)絡(luò),測(cè)試結(jié)果不理想,信號(hào)輸出平坦度無法滿足方案要求。之后,根據(jù)方案設(shè)計(jì)要求,進(jìn)行ADS仿真,設(shè)計(jì)出如圖5所示的微帶耦合器,直接放置到印制板上,減少了安裝步驟,而且效果理想。信號(hào)平坦度得到了優(yōu)化,達(dá)到了方案要求。
2.2 寬帶放大器電路設(shè)計(jì)
整機(jī)方案需要大于+10 dBm的本振信號(hào)作為混頻本振,鎖相環(huán)路本身產(chǎn)生的信號(hào)功率只有0 dBm左右,需要接入一個(gè)寬帶放大器才能保證輸出信號(hào),滿足整機(jī)對(duì)于本振信號(hào)的要求。寬帶放大器選擇FGB-1509(FIRSAR公司),該放大器的增益和增益平坦度、頻率范圍都可以滿足方案的需要。采用合適的偏置電路,使得該芯片正常工作,就可實(shí)現(xiàn)輸出+12 dBm±1 dBm。
3 測(cè)試結(jié)果
模塊燒入編寫好的FPGA工程后,接入整機(jī)調(diào)試平臺(tái),使用羅德與施瓦茨公司的FSW26測(cè)試輸出的信號(hào),相位噪聲指標(biāo)如圖6所示,載波6 GHz,頻偏10 kHz時(shí)為-102.81 dBc/Hz;如圖7所示,載波6 GHz,頻偏100 kHz時(shí)為106.71 dBc/Hz。
模塊輸出信號(hào)的功率和平坦度如圖8所示。
4 結(jié)論
運(yùn)用FPGA控制HMC983LP5E不同的分頻數(shù),得到需要的頻率點(diǎn),完成4 GHz到8 GHz的頻率源,實(shí)現(xiàn)了成本低、性能高的高頻寬帶本振模塊,達(dá)到了預(yù)期的方案目標(biāo)。方案用經(jīng)濟(jì)型的VCO 設(shè)計(jì)出高頻段高性能的本振并把設(shè)計(jì)的高頻段高性能本振進(jìn)行小型化處理,對(duì)于既要求高指標(biāo)又要求低成本而且便攜的測(cè)量?jī)x器來說至關(guān)重要, 現(xiàn)在這個(gè)方案已經(jīng)應(yīng)用到兩款產(chǎn)品中,兩款產(chǎn)品年生產(chǎn)100臺(tái)。
參考文獻(xiàn):
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本文來源于《電子產(chǎn)品世界》2018年第7期第30頁,歡迎您寫論文時(shí)引用,并注明出處。
評(píng)論