模數(shù)轉(zhuǎn)換器時(shí)鐘優(yōu)化:測試工程觀點(diǎn)
圖18. FPGA門驅(qū)動(dòng)電路影響AD9446-80的性能
選擇最佳的時(shí)鐘驅(qū)動(dòng)器是困難的。表2給出了市售的多個(gè)驅(qū)動(dòng)器門所增加抖動(dòng)的大致比較結(jié)果。表格下方給出的建議有助于獲得優(yōu)良的ADC性能。
表2. 時(shí)鐘驅(qū)動(dòng)器門及其增加的抖動(dòng)
邏輯系列 | 注釋 |
FPGA | 33 ps~50 ps(僅包括驅(qū)動(dòng)器門,未包括DLL/PLL內(nèi)部的門)1 |
74LS00 | 4.94 ps2 |
74HCT00 | 2.2 ps2 |
74ACT00 | 0.99 ps2 |
MC100EL16 PECL | 0.7 ps2 |
AD951x系列 | 0.22 ps2 |
NBSG16,ECL擺幅減少(0.4V) | 0.2 ps2 |
ADCLK9xx,ECL時(shí)鐘驅(qū)動(dòng)器系列 | 0.1 ps2 |
1制造商的說明書
2基于ADC SNR的下降換算的值
評(píng)論