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          FPGA技術(shù)在雷達(dá)信號模擬器中的應(yīng)用

          作者: 時間:2010-05-19 來源:網(wǎng)絡(luò) 收藏

            摘 要: 基于的各種雷達(dá)信號產(chǎn)生方法,介紹了在中實現(xiàn)直接數(shù)字頻率合成器(DDS)以及提高輸出信號質(zhì)量的方法,編程實現(xiàn)了頻率捷變、線性調(diào)頻以及相位編碼等雷達(dá)信號的產(chǎn)生。仿真結(jié)果表明,該方法能靈活地產(chǎn)生多種雷達(dá)信號,且質(zhì)量較好。

            需要模擬簡單脈沖調(diào)制、重頻調(diào)制(重頻參差、重頻抖動和重頻滑變)、載頻調(diào)制(線性/非線性調(diào)頻、頻率捷變)和相位調(diào)制(相位編碼)等樣式的雷達(dá)信號[1]。傳統(tǒng)的實現(xiàn)方法是采用直接數(shù)字合成器DDS實現(xiàn)。通過對DDS相關(guān)參數(shù)產(chǎn)生對應(yīng)的雷達(dá)中頻信號,其優(yōu)點(diǎn)是產(chǎn)生的信號質(zhì)量比較好,缺點(diǎn)是系統(tǒng)控制繁瑣、模擬的雷達(dá)信號參數(shù)相對固定、缺乏足夠的靈活性,對于非線性調(diào)頻和相位編碼信號很難達(dá)到令人滿意的效果。

            本文基于軟件無線電的思想,采用實現(xiàn)DDS功能,通過控制DDS參數(shù),在1片F(xiàn)PGA中實現(xiàn)了各種雷達(dá)信號的模擬。

            1 DDS基本原理

            DDS由相位累加器、只讀存儲器(ROM)、數(shù)模轉(zhuǎn)換器(DAC)和低通濾波器(LPF)組成。DDS的關(guān)鍵部分是相幅轉(zhuǎn)換部分,根據(jù)相幅轉(zhuǎn)換方式的不同,DDS大致可分為兩大類:(1)ROM查詢表法。ROM中存儲有不同相位對應(yīng)的幅度值,相位累加器輸出對應(yīng)的幅度序列,實現(xiàn)相幅轉(zhuǎn)換;(2)計算法。對相位累加器輸出的相位值通過數(shù)學(xué)計算的方法得到對應(yīng)的幅度值,實現(xiàn)相幅轉(zhuǎn)換,這里的計算方法有拋物線近似法、CORDIC法等。

            對于查詢表法,ROM里存儲了2N個點(diǎn)(一個周期)。工作過程如下:在時鐘脈沖fc的作用下,頻率控制字K由累加器累加得到相應(yīng)的相位碼,相位碼尋址ROM進(jìn)行相位/幅度變換輸出不同的幅度編碼,相當(dāng)于在ROM里每隔K個點(diǎn)取出一個點(diǎn),再經(jīng)過數(shù)模轉(zhuǎn)換器DAC得到相應(yīng)的階梯波,最后經(jīng)低平滑濾波器對階梯波進(jìn)行平滑,即得到由頻率控制字K決定的連續(xù)變化的模擬輸出波形,輸出頻率fout為:FPGA技術(shù)在雷達(dá)信號模擬器中的應(yīng)用

            式中,K為頻率控制字,N為相位寄存器字長。輸出頻率由頻率控制字及相位寄存器字長決定。

            理想情況下,由于采樣的原因,輸出信號頻譜存在一些雜散,譜線呈辛格函數(shù)形狀。DDS輸出信號雜散分量較大的主要原因有以下幾點(diǎn):一是相位截斷效應(yīng);二是存放在ROM中的波形幅度存在量化誤差;三是DAC的非理想特性。在DDS中,為了得到高的頻率分辨率,相位累加器的字長一般較大,而只讀存儲器ROM的容量有限,通常位輸出中只有高A位用來尋址ROM,從而產(chǎn)生相位截斷誤差,而DAC和ROM正弦波幅度字長也是有限的,同時,在DAC轉(zhuǎn)換過程中總存在如微分線性誤差等誤差,這樣就產(chǎn)生了量化誤差和DAC的非理想特性誤差。

            2 基于FPGA的

            基于FPGA的雷達(dá)信號產(chǎn)生器系統(tǒng)框圖如圖1所示。系統(tǒng)主要由單片機(jī)、FPGA、模數(shù)轉(zhuǎn)換器、低通濾波器、自動電平控制、RS-232通信接口、時鐘電路以及人機(jī)接口等部分組成。單片機(jī)完成系統(tǒng)控制、人機(jī)交互控制以及與上位計算機(jī)的信息交換[2]; FPGA實現(xiàn)DDS的模擬以及其他邏輯的產(chǎn)生[3-4];模數(shù)轉(zhuǎn)換器將數(shù)字信號轉(zhuǎn)換成模擬信號,經(jīng)低通濾波器濾波后獲得良好的波形信號;為了提高信號產(chǎn)生器帶負(fù)載的能力,自動電平控制部分保證輸出信號幅度在接入不同負(fù)載時變化不致太大。

          FPGA技術(shù)在雷達(dá)信號模擬器中的應(yīng)用

            系統(tǒng)工作時,單片機(jī)將由RS-232接口接收到的或由鍵盤設(shè)置的信號參數(shù)寫入FPGA,在FPGA中實現(xiàn)的DDS內(nèi)核根據(jù)設(shè)置的參數(shù)產(chǎn)生相應(yīng)的數(shù)字波形,經(jīng)D/A轉(zhuǎn)換、低通濾波和電平控制后輸出。


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