基于DVI接口的LED視頻控制系統(tǒng)研究
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虛線框內(nèi)的 FPGA 控制器內(nèi)部的程序流程圖如圖3 所示。主要完成的功能有四個。
圖3 FPGA控制器程序流程圖
一是數(shù)據(jù)重構。由于本設計采用占空比的方法來實現(xiàn) LED顯示屏的灰度,每個像素由紅色(R)、綠色(G)、藍色(B)各 8位的二進制數(shù)組成,所以計算機一幀的視頻數(shù)據(jù)信息,在 LED 屏上就需要分 8 次來顯示,依次為 bit0、bit1、bit2、…bit7,通過控制這些不同位視頻數(shù)據(jù)信息點亮 LED 時間的不同來實現(xiàn)灰度。因此,需要數(shù)據(jù)緩沖處理模塊(雙口RAM)對每幀圖像數(shù)據(jù)進行重構。
二是截取視頻源。由于本設計選取的視頻源分辨率為1024×768,刷新率為65Hz, LED屏大小為320×128。所以像素數(shù)據(jù)寫入雙口RAM的同時,需根據(jù)所要顯示的LED屏大小,對重構的像素數(shù)據(jù)進行相應截取并存入幀存儲器。
三是讀寫控制。當行同步信號HSYNC和數(shù)據(jù)使能信號DE同時有效時,讀/寫地址計數(shù)器同時開始計數(shù)。采用ping-pang邏輯,某一時刻幀存儲器A從緩沖區(qū)接收數(shù)據(jù)時,按照分區(qū)掃描的規(guī)則讀取幀存儲器B內(nèi)的像素數(shù)據(jù),并經(jīng)并/串轉(zhuǎn)換后發(fā)送至LED屏。兩者輪流切換,保證了數(shù)據(jù)的高速傳輸。
四是灰度掃描控制。本設計采用占空比控制方法來實現(xiàn) LED 屏的灰級,整個屏可以分成 8 個區(qū),每個區(qū) 16行,每一行每一列的數(shù)據(jù)可用 8位的二進數(shù)表示。對于每一區(qū)首先掃描顯示 16 行各列 8位灰度值的 D0 位,然后掃描顯示 16 行各列灰度值的 D1 位。依次類推,直到掃描顯示 16 行各列灰度值的 D7 位。且8個區(qū)的掃描是同時進行的。
結語
本設計通過對 DVI 接口技術的深入研究,探討了基于 DVI 接口的LED 視頻控制系統(tǒng)方案。該控制系統(tǒng)取代了傳統(tǒng)的VGA接入方式,運用顯卡的DVI接口作為數(shù)據(jù)源,不需要進行 A/D轉(zhuǎn)換和處理,減少了信號損失。因此,不論從信號質(zhì)量還是后處理考慮,都有利于提高整個顯示系統(tǒng)的性能。本文引用地址：http://www.ex-cimer.com/article/169112.htm
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