基于FPGA+DSP的多通道單端／差分信號采集系統(tǒng)設計

摘要 介紹了一種基于DSP+FPGA的平臺，主要利用ADS8517AD轉換芯片構成的具有32路單端通道或16路差分通道的信號采集存儲系統(tǒng)，該系統(tǒng)通道可以選擇切換，且采樣率也可以改變，具有較強的靈活性。

關鍵詞 DSP;FPGA;ADS8517;通道切換

在信號處理過程中，經常采用DSP+FPGA協(xié)同處理的方法。是因為DSP雖然可以實現較高速率的信號采集，但其指令更適于實現算法而不是邏輯控制，其外部接口的通用性較差。而FPGA時鐘頻率高、內部延時小，全部控制邏輯由硬件完成，速度快、效率高，適合于大數據量的傳輸控制，可以集成外圍控制、譯碼和接口電路，在高速數據采集方面有著DSP以及單片機無法比擬的優(yōu)勢，但缺點是難以實現一些復雜的算法。因此，若采用DSP+FPGA協(xié)同處理的方法，便可以使DSP的高速處理能力與FPGA的高速、復雜的組合邏輯和時序邏輯控制能力相結合，達到互補，使系統(tǒng)發(fā)揮最佳性能。

在目前的信號采集及測試系統(tǒng)中，由于應用背景的復雜，經常需要對多路信號進行采集，有的甚至需要對多路單端及差分信號進行采集，在某些情況下，為測試分析的方便，還需要對采樣率進行改變。文中介紹了一種采用DSP+FPGA協(xié)同處理的方法，并主要利用ADS8517這一A/D轉換芯片來實現多路可以選擇單端或差分輸入的信號采集系統(tǒng)的設計方法。

1 系統(tǒng)實現功能

該系統(tǒng)可以實現32個通道單端信號或16個通道差分信號的采集輸入，由DSP控制輸入信號是單端信號還是差分信號，以及各自使能輸入的通道，其中單端信號最多使能輸入32個通道，差分信號最多使能輸入16個通道。A/D在各個使能通道間采用類似時分復用的方法進行輪尋采樣，A/D采樣頻率200 kHz，DSP可設置采樣率分頻值，對采樣率進行改變，假如DSP設置采樣分頻值為D，使能輸入通道數為N，則每個通道實際采樣率為200 kHZ/(D·N)。

2 系統(tǒng)硬件設計

根據以上功能要求，整個系統(tǒng)的設計思路如圖1所示。其中DSP采用TI公司的TMS3206713B，FPGA采用Altera公司的CycloneIII系列，A /D采用TI公司的ADS8517。ADS8517的主要性能：(1)16位分辨率;(2)采樣頻率：200 kHz;(3)模擬輸入范圍±10 V;(4)輸出有串行和并行兩種方式。

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在整個系統(tǒng)中，FPGA根據DSP對各個通道是單端或者差分的設置，以及各個通道使能與否和采用率分頻值的設置，控制ADS8517以及多路選擇器，將A/D輸入的數據以及其對應的通道存入一個FIFO中，當FIFO半滿時向DSP發(fā)送中斷，由DSP讀取FIFO中A/D的采樣數據及其對應的通道號?？梢钥闯?，設計重點主要集中在多路選擇器的設計以及FPGA中硬件邏輯的設計。

2.1 多路選擇模塊設計

根據系統(tǒng)要實現的功能，多路選擇模塊的設計采用如圖2所示的設計思路，其中16選1多路器和4選1多路器分別采用ADI公司的ADG1206和ADG1204。由FPGA控制這些多路選擇器來選擇通道以及單端/差分模式，在設計選擇差分信號時，為方便，只支持A0～A15通道和A16～A31通道依次對應的差分，而不支持A0～A15通道中任意一個通道和A16～A31通道中任意一個通道的差分。

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