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          用下行鏈路實(shí)現(xiàn)遠(yuǎn)程邊界掃描測(cè)試

          作者: 時(shí)間:2012-09-07 來(lái)源:網(wǎng)絡(luò) 收藏

          于電纜中傳播延遲所造成的延遲。在TCKTARGET(t2)上升沿,目標(biāo)系統(tǒng)采樣TMS和TDI線。在 TCKTARGET(t4)下降沿,目標(biāo)系統(tǒng)更新自己的TDO輸出,并將其放到電纜上。由于電纜中的延遲,新TDO信號(hào)在t5時(shí)到達(dá)控制器。測(cè)試控制器在 TCKTESTER(t6)上升沿采樣新的TDO信息。這樣,從目標(biāo)系統(tǒng)的最后輸出到測(cè)試控制器的TDO 信號(hào)的傳輸時(shí)間,相當(dāng)于TCK周期的一半。

            假定TCK頻率為10MHz,或 100ns周期。此時(shí),TDO數(shù)據(jù)必須在 50 ns 時(shí)間內(nèi)從鏈路中的最后 DUT 傳送至測(cè)試控制器。如果假定電纜的傳播延遲為5 ns/m,則使用的電纜長(zhǎng)度決不能超過(guò)10m。

            現(xiàn)在,假定有一個(gè)遠(yuǎn)程目標(biāo)系統(tǒng),并且無(wú)法控制延遲。如果網(wǎng)絡(luò)連接造成100ms延遲,則必須使用只有5Hz (1/100 ms×1/2=5 Hz) 的TCK最高頻率,這樣會(huì)造成極長(zhǎng)時(shí)間的測(cè)試。因此,如果一個(gè)系統(tǒng)要使用長(zhǎng)電纜,或者經(jīng)歷網(wǎng)絡(luò)延遲,則必須在不會(huì)顯著減少測(cè)試時(shí)間情況下,找到一種克服延遲的方法。

            使TDO數(shù)據(jù)同步的虛擬單元

            為使 TCK 頻率運(yùn)行在一個(gè)合適速率上(依賴于通信信道的帶

          寬),并且考慮通信延遲,可以在目標(biāo)系統(tǒng) TDO 鏈的末端增加虛擬單元。這些單元并不存在,而只是通過(guò)調(diào)整測(cè)試軟件,將這些不存在的單元包含在掃描鏈中。這樣,測(cè)試軟件會(huì)將收到的目標(biāo)系統(tǒng) TDO 數(shù)據(jù)延遲一個(gè)時(shí)間,使 TDO 數(shù)據(jù)移過(guò)這些附加的單元(圖 5)。工具軟件會(huì)測(cè)量傳播延遲和通信鏈接的速度,以確定要在目標(biāo)系統(tǒng)掃描鏈中增加的單元數(shù)量。


            考慮這樣一個(gè)系統(tǒng),其中從模塊中收到 TDO 數(shù)據(jù)位的延遲為 1秒 ~ 2秒,而測(cè)試儀的 TCK 輸出產(chǎn)生一個(gè) 4 MHz 時(shí)鐘信號(hào)。此時(shí),上行鏈路模塊必須提供一個(gè)緩沖存儲(chǔ)器,以保存收到的所有 TDO 信息,直到測(cè)試儀準(zhǔn)備接收為止。緩沖區(qū)可能需要 4MB ~ 8MB存儲(chǔ)容量,可以使用 DDR 存儲(chǔ)器件。


            在上行鏈路模塊中,用 FIFO 內(nèi)存緩沖 TDO 數(shù)據(jù),并對(duì)測(cè)出的延遲作補(bǔ)償(圖 6)。一旦上行鏈路模塊開(kāi)始向模塊發(fā)送有關(guān)的 TDI 信息,它就會(huì)根據(jù)以 TCK 周期表述的通信延遲值,裝入虛擬單元計(jì)數(shù)器。

            與此同時(shí),上行鏈路模塊將從模塊接收到的 TDO 位暫時(shí)儲(chǔ)存在 FIFO 存儲(chǔ)器中。每個(gè) TCK 周期都會(huì)使虛擬單元計(jì)數(shù)器遞減,直至為零。此時(shí),控制器開(kāi)始以 TCK 速率將累積的 TDO 位連續(xù)移出。通過(guò)這種 TDO 鏈中增加虛擬單元與 FIFO 的組合,TDO 位就能與測(cè)試控制器的 TDO 輸入正確同步。

            我們的目標(biāo)是以單個(gè)數(shù)據(jù)包有效地為多個(gè)測(cè)試應(yīng)用傳輸測(cè)試數(shù)據(jù)。在上行鏈路譯碼過(guò)程中,可以將每個(gè) TCK 周期的測(cè)試信息保存為一個(gè) 16 位塊。這個(gè) 16 位塊包含信息(即 TDI、TMS 和可選信號(hào)),最多用于四個(gè)鏈。為有效使用通信信道的帶寬,下行鏈路模塊逐一將每個(gè)鏈的四個(gè) TDO 位都編碼為一個(gè) 16 位塊。

            為了確保下行鏈路模塊只傳送相關(guān)的 TDO 數(shù)據(jù),該模塊帶有一個(gè)狀態(tài)機(jī),由它決定目標(biāo) TAP 何時(shí)處于移位狀態(tài)。同樣,上行鏈路模塊也有一個(gè)狀態(tài)機(jī),實(shí)現(xiàn)與目標(biāo)系統(tǒng)發(fā)生的事件同步。

            用這種方式,上行鏈路可以識(shí)別有效的 TDO 數(shù)據(jù),并且只將有效位發(fā)送給測(cè)試控制器作比較。因此,上行鏈路模塊可以用一種內(nèi)含“虛擬元件”方法,對(duì)可能由于多個(gè) TCK 周期造成的來(lái)回傳輸延遲作出補(bǔ)償(圖 5 及圖 6)。

            測(cè)量延遲

            一個(gè)軟件工具在上行鏈路模塊和下行鏈路模塊間建立起通信信道,它進(jìn)行一個(gè)回環(huán)測(cè)試,以測(cè)量信道內(nèi)的延遲。在延遲計(jì)算基礎(chǔ)上,該工具為測(cè)試軟件將“看到”的邊界掃描鏈配置適當(dāng)數(shù)量的虛擬單元。軟件可以在計(jì)算中增加一些裕度,以確保一旦虛擬單元計(jì)數(shù)器歸零時(shí),F(xiàn)IFO 存儲(chǔ)器能給出有效的 TDO 數(shù)據(jù)。在一個(gè)已知延遲的點(diǎn)對(duì)點(diǎn)信道中,軟件工具可以方便地建立上行鏈路至下行鏈路的連接,并配置一個(gè)預(yù)設(shè)數(shù)量的虛擬單元。

            這種完成遠(yuǎn)程邊界掃描測(cè)試的方法有局限性,因?yàn)樾枰獙y(cè)試位的模式劃分成獨(dú)立的數(shù)據(jù)包,每個(gè)數(shù)據(jù)包的大小與所選的協(xié)議有關(guān)。這些數(shù)據(jù)包可能包含大比例的附加信息,從而降低傳輸?shù)奈恍省?BR>
            另外,該過(guò)程需要一個(gè)下行鏈路控制器,用于從每個(gè)數(shù)據(jù)包中提取 TDI 和 TMS 信息,并通過(guò)目標(biāo)系統(tǒng)分送這些信號(hào)。下行鏈路亦必須在傳送給測(cè)試控制器的上行鏈路以前,暫時(shí)儲(chǔ)存得到的 TDO 數(shù)據(jù)。

          參考文獻(xiàn)
          Reis, I and M Simonen, JTAG-testausj?rjestely, Finnish patent FI 110724 B, March 14, 2003.
          Reis, I and M Simonen, JTAG Testing Arrangement, US pa


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          關(guān)鍵詞: 下行鏈路 邊界掃描 IEEE1149

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