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          視頻解碼器SAA7111在圖像采集中的應(yīng)用

          作者:王艷超,趙金憲 時(shí)間:2008-07-18 來源:電子元器件應(yīng)用 收藏

            (2)輸出格式/延時(shí)控制0(10H)

          本文引用地址:http://www.ex-cimer.com/article/85909.htm

            該寄存器中的最高兩位OFTS1、OFTS0為輸出格式選擇位,用于決定四種輸出格式,其四種輸出格式的設(shè)置方法如表3所列。

           

            上電初始化時(shí),該寄存器應(yīng)設(shè)置為40H,其輸出模式為YUV4:2:2(16 bits)。

            (3)輸出控制1(11H)

            將該寄存器的第三位置1時(shí),VPO輸出有效;將第二位置1時(shí),HS和VS輸出有效。

            3 SAA7111的應(yīng)用電路

            圖4所示是SAA7111的典型應(yīng)用電路。根據(jù)上述設(shè)置,該設(shè)計(jì)從SAA7111的四個(gè)模擬視頻輸入端中選擇AI11作為視頻輸入接口,輸出端的高八位輸出亮度信號(hào),低八位輸出色度信號(hào)。在視頻輸入端需連接10 nF的電容和75 Ω的電阻。

           

            SAA7111的時(shí)鐘可以是外部時(shí)鐘和內(nèi)部時(shí)鐘。本系統(tǒng)采用外部時(shí)鐘輸入,XTAL引腳和XTAL1引腳間接入的一個(gè)頻率為24.576 MHz的石英晶體振蕩器,可用于產(chǎn)生系統(tǒng)所需要的工作時(shí)鐘。本設(shè)計(jì)由外部時(shí)鐘驅(qū)動(dòng)來產(chǎn)生行鎖定時(shí)鐘LLC(27 MHz)、LLC2(13.5 MHz)和時(shí)鐘參考信號(hào)CREF(13.5 MHz,相對LLC2有一定的延時(shí))。需要說明的是,時(shí)鐘的產(chǎn)生會(huì)受到片選信號(hào)CE的影響,只有當(dāng)CE為高電平時(shí)才有效,而在低電平時(shí),SAA7111被復(fù)位,該引腳不產(chǎn)生周期信號(hào)。

            為了降低電源紋波,每個(gè)電源輸入端都應(yīng)加100 nF的濾波電容。由于SAA7111是模數(shù)轉(zhuǎn)換器件,模擬電源和數(shù)字電源、模擬地與數(shù)字地都不能簡單共電。一般情況下,可使用電感單點(diǎn)一起接地。因?yàn)閿?shù)字電路的頻率較高,模擬電路的敏感度較強(qiáng),數(shù)字和模擬部分不能有信號(hào)電流的交互,而這個(gè)地線理論上會(huì)提供電源回路,所以為避免干擾,應(yīng)該使用電感阻止干擾信號(hào)的流回。

            4 結(jié)束語

            由于SAA7111將模數(shù)轉(zhuǎn)換、自動(dòng)鉗位、自動(dòng)增益控制、時(shí)鐘產(chǎn)生、多制式解碼等許多復(fù)雜功能集成到一塊之內(nèi),因而其結(jié)構(gòu)比較簡單,便于調(diào)試,可靠性也得到了極大提高,可為需要的各類應(yīng)用系統(tǒng)提供極大的方便。


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