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基于Visual DSP++4.0開發(fā)的TigerSHARC DSP多處理器系統(tǒng)及其應(yīng)用
- ADI公司的高性能數(shù)字信號處理器Tiger-SHARC系歹0包括ADSP-TS101S、ADSP-TS201S、ADSP-TS202S和ADSP-TS203S等芯片。它們被廣泛應(yīng)用于視頻和通信市場，包括3G蜂窩和寬帶無線基站以及國防軍事設(shè)備，如戰(zhàn)地雷達、航空器和聲納等。目前，TigerSHARC高性能數(shù)字信號處理器已成為多個DSP并行處理應(yīng)用的實用標準，對加快數(shù)字信號處理技術(shù)的發(fā)展和擴大DSP的應(yīng)用起到了十分突出的促進作用。Visual DSP++4.0是一種使用方便的集成調(diào)試開發(fā)軟件平臺，它支持ADI公
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基于VW2010的視頻壓縮存儲系統(tǒng)的軟硬件設(shè)計
- 基于VW2010的視頻壓縮存儲系統(tǒng)的軟硬件設(shè)計,MPEG-4 (ISO／IEC 14496)是基于第二代壓縮編碼技術(shù)制定的國際標準，該標準具有高壓縮比、可擴展性和可交互性等優(yōu)點。在MPEG-4應(yīng)用方面，由于它能以較少的帶寬傳輸高質(zhì)量的畫面，并可將多種多媒體通信加以綜合，所以有著很好的應(yīng)用前景。為此，本文針對實際需求，提出了采用VW2010編解碼芯片為核心的嵌人式MPEG-4音視頻壓縮存儲系統(tǒng)的設(shè)計方案，詳盡介紹了系統(tǒng)的設(shè)計原理，給出了VW2010芯片的HOST引導(dǎo)模式程序設(shè)計方法。
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MMC在便攜式數(shù)據(jù)采集系統(tǒng)中的應(yīng)用
- 介紹了多媒體卡MMC的工作原理、MMC的串行外設(shè)接口協(xié)議模式及在大容量便攜式數(shù)據(jù)采集系統(tǒng)中的應(yīng)用，最后給出了PIC16F73B微處理器與MMC的接口設(shè)計。
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面向系統(tǒng)LSI開發(fā)的高速、低功耗微型平臺
- 基于ARM CPU并集成了外圍功能(如實時操作系統(tǒng)定時器等)的μPLAT系列是一種基本系統(tǒng)級LSI開發(fā)平臺。高速及低功耗的μPLAT-92平臺專為W-CDMA、PDA及其它便攜式終端(如互聯(lián)網(wǎng)設(shè)備)應(yīng)用而開發(fā)。μPLAT-92是以硬IP為特征的硬件開發(fā)與集成環(huán)境的平臺總稱：μPLAT-92內(nèi)核包括一顆ARM920T CPU及運行操作系統(tǒng)所需的最少外圍I/O器件；電源管理IP及原型板也包括在內(nèi)。這不僅能提高系統(tǒng)級LSI的運行速度及降低其功耗，而且還能縮短規(guī)模不斷提高的大型系統(tǒng)級LSI的開發(fā)時間，并使用戶能專
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FPGA系統(tǒng)的供電要求和最新DC/DC穩(wěn)壓器解決方案
- FPGA系統(tǒng)的供電要求和最新DC/DC穩(wěn)壓器解決方案,隨著FPGA制造工藝尺寸持續(xù)縮小、設(shè)計配置更加靈活，以及采用FPGA的系統(tǒng)的不斷發(fā)展，原來只采用微處理器和ASIC的應(yīng)用現(xiàn)在也可以用FPGA來實現(xiàn)了。最近FPGA供應(yīng)商推出的新型可編程器件進一步縮小了FPGA和ASIC之間的性能差別。盡管這類器件的可配置性對設(shè)計工程師很有吸引力，但使用這些器件所涉及的復(fù)雜設(shè)計規(guī)則和接口協(xié)議，要求設(shè)計工程師經(jīng)過全面的培訓，并需要進行參考設(shè)計評估、設(shè)計仿真和驗證工作。另一方面，F(xiàn)PGA應(yīng)用中非常復(fù)雜的模擬設(shè)計，例如用于內(nèi)核
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在采用FPGA設(shè)計DSP系統(tǒng)中仿真的重要性
- 仿真是所有系統(tǒng)成功開發(fā)的基礎(chǔ)。通過在不同條件、參數(shù)值和輸入情況下對系統(tǒng)進行高級行為仿真，工程師可以迅速找到、分離并糾正系統(tǒng)的設(shè)計問題。因為在這一階段，比較容易區(qū)分設(shè)計問題和編程問題。通過在系統(tǒng)級工作，設(shè)計人員可以確定這一階段的問題是來自設(shè)計缺陷，而不是編程問題。此外，在信號處理系統(tǒng)設(shè)計中使用基于模型的方法大大縮短了“錯誤診斷延遲”時間――從設(shè)計中出現(xiàn)錯誤到發(fā)現(xiàn)錯誤并分離錯誤的時間。
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