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Xilinx變身平臺公司，面向數(shù)據(jù)中心和AI推出自適應平臺
- Xilinx開發(fā)者大會(XDF)日前在京舉行，公司新總裁兼首席執(zhí)行官Victor Peng先生親臨會場，介紹了Xilinx(賽靈思)的戰(zhàn)略及轉(zhuǎn)型成果?！ ictor說，他喜歡不斷設(shè)定目標，然后為此調(diào)整和轉(zhuǎn)變，去實現(xiàn)這個目標。Xilinx現(xiàn)在不再定位為FPGA公司，而是定位為平臺公司，并宣布了一個全新的品類，即自適應加速平臺ACAP?！ ∫驗殡S著數(shù)據(jù)爆炸，傳統(tǒng)市場和業(yè)務都受到了顛覆，而且還出現(xiàn)了人工智能，人們要以更加迅速地變化來滿足不斷變化的要求和標準。所以就像自然界能夠適應環(huán)境的物種一樣，在數(shù)字世界
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Xilinx推出首款新類別平臺—— Versal ： 利用軟件可編程性與可擴展的 AI 推斷技術(shù)支持快速創(chuàng)新
- 賽靈思開發(fā)者大會 (XDF) —自適應和智能計算的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc.)首席執(zhí)行官 Victor Peng 宣布推出 Versal? – 業(yè)界首款自適應計算加速平臺 (Adaptive Compute Acceleration Platform ，ACAP)，從而為所有的開發(fā)者開發(fā)任何應用開啟了一個快速創(chuàng)新的新時代。Versal ACAP 整合標量處理引擎、自適應硬件引擎和智能引擎以及前沿的存儲器和接口技術(shù)，能為所有的應用提供強大的異構(gòu)加速功能。不過，最重要的是， Vers
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Xilinx 推出全球最快的數(shù)據(jù)中心和AI加速器卡
- 自適應和智能計算的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc.，(NASDAQ: XLNX))今天推出了功能強大的加速器卡——Alveo，用來大幅提升云端和本地數(shù)據(jù)中心中業(yè)界標準服務器的性能。利用 Alveo，客戶在運行實時機器學習推斷以及視頻處理、基因組學、數(shù)據(jù)分析等關(guān)鍵的數(shù)據(jù)中心應用時，有望以較低時延實現(xiàn)突破性的性能提升。Alveo? U200 和 Alveo U250 由 Xilinx? UltraScale+? FPGA 提供強勁動力，現(xiàn)已開始接受量產(chǎn)訂單。與所有賽靈思技術(shù)一樣，客戶能對硬
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云端實時視頻流解決方案由賽靈思與華為率先在華提出
- 2018年10月12日，華為全聯(lián)接大會在上海召開，此次大會上自適應和智能計算的全球領(lǐng)先企業(yè)賽靈思公司(Xilinx, Inc.)、華為和 NGCodec宣布開發(fā)中國首款云端高效率視頻編碼 (HVEC) 解決方案。Xilinx開發(fā)了高度靈活的自適應處理平臺，可以為從端到邊緣再到云的各種應用的快速創(chuàng)新提供強大支持，它為此次方案的提出出了不少力。該解決方案獨家采用賽靈思 Virtex UltraScale+? FPGA 和 NGCodec 的全新 H.265 視頻編碼器。賽靈思 FPGA 助力 NGCode
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FPGA工作原理與簡介
- FPGA工作原理與簡介 如前所述，F(xiàn)PGA是在PAL、GAL、EPLD、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。它是作為ASIC領(lǐng)域中的一種半定制電路而出現(xiàn)的，即解決了定制電路的不足，又克服了原有可編程器件門電路有限的缺點?！ ∮捎贔PGA需要被反復燒寫，它實現(xiàn)組合邏輯的基本結(jié)構(gòu)不可能像ASIC那樣通過固定的與非門來完成，而只能采用一種易于反復配置的結(jié)構(gòu)。查找表可以很好地滿足這一要求，目前主流FPGA都采用了基于SRAM工藝的查找表結(jié)構(gòu)，也有一些軍品和宇航級FPGA采用Flash或者熔絲與反熔
- 關(guān)鍵字： FPGA Xilinx Altera
從設(shè)置、加載、啟動看Xilinx FPGA配置流程
- 盡管FPGA的配置模式各不相同，但整個配置過程中FPGA的工作流程是一致的，分為三個部分：設(shè)置、加載、啟動?！ 臀唤Y(jié)束配置開始 有多種方式使FPGA的配置進入這一過程。在上電時，電壓達到FPGA要求之前，F(xiàn)PGA的上電復位模塊將使FPGA保持在復位狀態(tài);外部控制PROG_B引腳出現(xiàn)一個低脈沖也可以使FPGA保持在復位狀態(tài)?！ ∏宄渲么鎯?nèi)容 這一步稱為初始化，當FPGA復位結(jié)束，配置存儲器的內(nèi)容會被自動清除。在這個步驟中，除配置專用接口外，F(xiàn)PGA I/O均被置于高阻態(tài)。在整個初始化過程中，I
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Enea在上海世界移動大會上演示基于Xilinx Zynq UltraScale +的Linux實時加速解決方案
- Enea?(NASDAQ OMX Nordic：ENEA)今天宣布將于6月27日至29日在上海移動世界大會上演示實時加速Linux解決方案， 該解決方案適用于5G和C-RAN(Cloud-RAN)場景，并通過高效的硬件利用率，廠商可實現(xiàn)降低CAPEX并提高性能。 該演示是基于Xilinx Zynq UltraScale +平臺的參考設(shè)計?！ ∷菔镜慕鉀Q方案展現(xiàn)出標準Linux環(huán)境與OSE RTOS實時域相結(jié)合。這完全符合無線接入網(wǎng)絡(RAN)中的運行時需求，在底層功能需具備確定性和高性能，同時具備更
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