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CompactPCI總線(xiàn)實(shí)現(xiàn)并行數(shù)據(jù)采集系統(tǒng)

CompactPCI總線(xiàn)實(shí)現(xiàn)并行數(shù)據(jù)采集系統(tǒng),針對(duì)產(chǎn)業(yè)控制系統(tǒng)的要求，先容了一種基于Compact PCI總線(xiàn)的數(shù)據(jù)采集系統(tǒng)，可以實(shí)現(xiàn)對(duì)模擬信號(hào)、串行數(shù)字信號(hào)和并行數(shù)字信號(hào)的采集。結(jié)合DSP芯片TSM320F2812和PCI接口芯片PCI9054的性能特點(diǎn)，具體討論了采集系統(tǒng)的硬件
關(guān)鍵字：數(shù)據(jù)采集系統(tǒng) 并行實(shí)現(xiàn) 總線(xiàn) CompactPCI

基于FPGA PCI的并行計(jì)算平臺(tái)實(shí)

基于FPGA PCI的并行計(jì)算平臺(tái)實(shí),本文介紹的基于PCI總線(xiàn)的FPGA計(jì)算平臺(tái)的系統(tǒng)實(shí)現(xiàn)：通過(guò)在PC機(jī)上插入擴(kuò)展PCI卡，對(duì)算法進(jìn)行針對(duì)并行運(yùn)算的設(shè)計(jì)，提升普通PC機(jī)對(duì)大計(jì)算量數(shù)字信號(hào)的處理速度。本設(shè)計(jì)采用5片F(xiàn)PGA芯片及相關(guān)周邊芯片設(shè)計(jì)實(shí)現(xiàn)這一并行高速
關(guān)鍵字：計(jì)算平臺(tái) 并行 PCI FPGA 基于

基于共享存儲(chǔ)器的多處理機(jī)并行快速通信

摘要：本文提出了當(dāng)多處理機(jī)系統(tǒng)工作時(shí)，為了實(shí)現(xiàn)快速有效的通信，采用使多處理器共享存儲(chǔ)囂方案。IDT7134雙口RAM是本方案選擇的共享存儲(chǔ)器。針對(duì)該方案，本文給出了接口電路的硬件設(shè)計(jì)和軟件設(shè)計(jì)。在接口電路設(shè)計(jì)中
關(guān)鍵字：快速通信并行處理機(jī) 共享存儲(chǔ)器基于

高速并行光互聯(lián)技術(shù)及其應(yīng)用

并行光互連技術(shù)　　伴隨著數(shù)字化的進(jìn)程，數(shù)據(jù)的處理、存儲(chǔ)和傳輸?shù)玫搅孙w速的發(fā)展。高帶寬的需求使得短距互聯(lián)成了系統(tǒng)發(fā)展的瓶頸。受損耗和串?dāng)_等因素的影響，基于銅線(xiàn)的電互聯(lián)的高帶寬情況下的傳輸距離受到了限制，
關(guān)鍵字：及其應(yīng)用技術(shù) 互聯(lián) 并行高速

FIR并行濾波器設(shè)計(jì)

FIR并行濾波器設(shè)計(jì),數(shù)字濾波器可以濾除多余的噪聲，擴(kuò)展信號(hào)頻帶，完成信號(hào)預(yù)調(diào)，改變信號(hào)的特定頻譜分量，從而得到預(yù)期的結(jié)果。數(shù)字濾波器在DVB、無(wú)線(xiàn)通信等數(shù)字信號(hào)處理中有著廣泛的應(yīng)用。在數(shù)字信號(hào)處理中，傳統(tǒng)濾波器通過(guò)高速乘法累
關(guān)鍵字：設(shè)計(jì) 濾波器并行 FIR

單片機(jī)并行擴(kuò)展口在小型漢字顯示屏中的應(yīng)用

【摘　要】　結(jié)合開(kāi)發(fā)漢字LED顯示屏與教授單片機(jī)課程的體會(huì)，介紹一種利用單片機(jī)8031的并行擴(kuò)展口構(gòu)成小型漢字LED顯示屏的方法。
關(guān)鍵詞：并行口擴(kuò)展單片機(jī) 漢字LED顯示
　　
1　引言
　在車(chē)站、機(jī)場(chǎng)、商
關(guān)鍵字：顯示屏應(yīng)用漢字小型并行擴(kuò)展單片機(jī)

降低任何嵌入式設(shè)計(jì)的體積和成本的常用方法是使用具有較少I(mǎi)/O引腳的通信總線(xiàn)。雖然從并行總線(xiàn)發(fā)展到串行總線(xiàn)可明顯減小體積和降低成本，但是從一種串行總線(xiàn)發(fā)展為另一種具有較少引腳的串行總線(xiàn)也很有用。用串行總線(xiàn)替代并行總線(xiàn)時(shí)，傳輸速度是一個(gè)關(guān)鍵參數(shù)。在小體積是最重要參數(shù)的設(shè)計(jì)中，使用具有較少引腳的串行總線(xiàn)很有優(yōu)勢(shì)。單片機(jī)集成超過(guò)12種不同的串行接口，本文將討論各串行接口的優(yōu)缺點(diǎn)。

降低任何嵌入式設(shè)計(jì)的體積和成本的常用方法是使用具有較少I(mǎi)/O引腳的通信總線(xiàn)。雖然從并行總線(xiàn)發(fā)展到串行總線(xiàn)可明顯減小體積和降低成本，但是從一種串行總線(xiàn)發(fā)展為另一種具有較少引腳的串行總線(xiàn)也很有用。用串行總線(xiàn)替代并行總線(xiàn)時(shí)，傳輸速度是一個(gè)關(guān)鍵參數(shù)。在小體積是最重要參數(shù)的設(shè)計(jì)中，使用具有較少引腳的串行總線(xiàn)很有優(yōu)勢(shì)。單片機(jī)集成超過(guò)12種不同的串行接口，本文將討論各串行接口的優(yōu)缺點(diǎn)。,降低任何嵌入式設(shè)計(jì)的體積和成本的常用方法是使用具有較少I(mǎi)/O引腳的通信總線(xiàn)。雖然從并行總線(xiàn)發(fā)展到串行總線(xiàn)可明顯減小體積和降低成本，但是
關(guān)鍵字：總線(xiàn) 串行具有體積并行使用降低發(fā)展接口參數(shù)

一種計(jì)算微波電路的并行算法

FDTD-Diakoptics將復(fù)雜的微波電路分割為若干較為簡(jiǎn)單的子電路，使用有限時(shí)域差分方法(FDTD)獨(dú)立求解每個(gè)子電路的時(shí)域特性，使用并行算法連接各子電路，最終得到整個(gè)電路的特性.本方法適用于結(jié)構(gòu)復(fù)雜、規(guī)模較大的微波
關(guān)鍵字：算法并行電路微波計(jì)算

基于單片機(jī)的多機(jī)并行通訊系統(tǒng)

在一些復(fù)雜的系統(tǒng)中，系統(tǒng)與分系統(tǒng)、分系統(tǒng)與設(shè)備等之間存在數(shù)據(jù)的傳遞問(wèn)題，往往采用通信的方式來(lái)解決。由于分系統(tǒng)、沒(méi)備等通信波特率的不同，特別是一些特殊波特率設(shè)備的存在，使得系統(tǒng)中設(shè)備間的相互通信不易實(shí)現(xiàn)
關(guān)鍵字：通訊系統(tǒng) 并行單片機(jī) 基于

基于閃爍存儲(chǔ)器的DSP并行引導(dǎo)裝載方法

基于閃爍存儲(chǔ)器的DSP并行引導(dǎo)裝載方法,TMS3.0VC5409 是TI公司推出的第一代的高性能、低價(jià)位、低功耗數(shù)字信號(hào)處理器（DSP）。與現(xiàn)在流行的TMS320C5409相比，性能提高了60%，功耗效率提高了 50%。它的應(yīng)用對(duì)象大多是要求能脫機(jī)運(yùn)行的內(nèi)嵌式系統(tǒng)，如機(jī)頂盒（
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高速并行RS解碼器

高速并行RS解碼器,　　1 引言　　Reed-Solomon(簡(jiǎn)稱(chēng)RS)碼是差錯(cuò)控制領(lǐng)域中一類(lèi)重要的線(xiàn)性分組碼，具有較強(qiáng)的糾正突發(fā)錯(cuò)誤和隨機(jī)錯(cuò)誤的能力，廣泛應(yīng)用于各種差錯(cuò)控制領(lǐng)域。RS解碼器可在FPGA或ASIC上實(shí)現(xiàn)IP核。但目前國(guó)內(nèi)RS編碼速度約為
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基于打印機(jī)并行接口的數(shù)據(jù)采集系統(tǒng)

基于打印機(jī)并行接口的數(shù)據(jù)采集系統(tǒng),　　方案分析　　在不影響原有設(shè)備正常工作的前提下，完成并行打印機(jī)的數(shù)據(jù)采集功能，考慮有以下2種方案：　　(1)在數(shù)據(jù)輸出到打印紙后，利用掃描儀識(shí)別打印紙上的數(shù)據(jù)，并將識(shí)別后的數(shù)據(jù)輸入到管理PC機(jī)的數(shù)據(jù)管理軟
關(guān)鍵字：數(shù)據(jù)采集系統(tǒng) 接口并行打印機(jī) 基于

基于流水線(xiàn)技術(shù)的并行高效FIR濾波器設(shè)計(jì)

摘要：基于流水線(xiàn)技術(shù)，利用FPGA進(jìn)行并行可重復(fù)配置高精度的FIR濾波器設(shè)計(jì)。使用VHDL可以很方便地改變?yōu)V波器的系數(shù)和階數(shù)。在DSP中采用這種FIR濾波器的設(shè)計(jì)方法可以充分發(fā)揮FPGA的優(yōu)勢(shì)。數(shù)字濾波器可以濾除多余的噪聲
關(guān)鍵字： FIR 流水線(xiàn)技術(shù) 并行濾波器設(shè)計(jì)

有源和無(wú)源濾波器混合并行方案在鐵路牽引站諧波治理工程中的應(yīng)用

1 研制慨況圖1 混合型補(bǔ)償裝置電路結(jié)構(gòu)　　在并聯(lián)式混合型補(bǔ)償裝置中，有源濾波器的主回路采用效率高、損耗小的電壓源脈寬調(diào)制(PWM)逆變器，有源濾波器的作用主要是產(chǎn)生補(bǔ)償諧波電流的電流IC，無(wú)源濾波器主要用于補(bǔ)
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FPGA的并行多通道激勵(lì)信號(hào)產(chǎn)生模塊

本文以并行多通道信號(hào)產(chǎn)生模型為依據(jù)，設(shè)計(jì)并實(shí)現(xiàn)了以FPGA為核心器件的并行多通道信號(hào)產(chǎn)生模塊，主要包括FPGA系統(tǒng)設(shè)計(jì)和多通道波形產(chǎn)生模塊設(shè)計(jì)。通過(guò)模塊測(cè)試后發(fā)現(xiàn)，該模塊具備產(chǎn)生高質(zhì)量并行多通道激勵(lì)信號(hào)的能力。
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