控制器 文章 進(jìn)入控制器技術(shù)社區(qū)
基于EPM1240的SDRAM控制器的設(shè)計(jì)
- 摘要：SDRAM的讀寫邏輯復(fù)雜，最高時(shí)鐘頻率達(dá)100 MHz以上，普通單片機(jī)無法實(shí)現(xiàn)復(fù)雜的SDRAM控制操作，復(fù)雜可編程邏輯器件CPLD具有編程方便，集成度高，速度快，價(jià)格低等優(yōu)點(diǎn)。因此選用CPLD設(shè)計(jì)SDRAM接口控制模塊，簡化
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MSP430x4xx系列微控制器的獨(dú)特時(shí)鐘設(shè)計(jì)
- 微控制器時(shí)鐘系統(tǒng)的設(shè)計(jì)對于系統(tǒng)的全局性能是十分關(guān)鍵的。為了得到廉價(jià)、準(zhǔn)確而穩(wěn)定的時(shí)鐘，在大多數(shù)情況下，可采用石英晶體或者是陶瓷振蕩器作為參考時(shí)鐘。這些器件的典型工作頻率范圍為100kHz到10MHz。然而，它們都
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MCU&USB設(shè)備控制器IP核的設(shè)計(jì)
- MCUUSB設(shè)備控制器IP核的設(shè)計(jì),摘要：用硬件描述語言verilog HDL設(shè)計(jì)實(shí)現(xiàn)了一種MCUUSB設(shè)備控制器IP核。論文首先簡要介紹了設(shè)計(jì)的背景,重點(diǎn)對自主研發(fā)的將MCUUSB控制器集成于一個(gè)芯片的設(shè)計(jì)和研究分析。最后給出nc-verilog功能仿真方案以及FPGA驗(yàn)
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基于LabWindows／CVI的便攜式電源控制器測試系統(tǒng)設(shè)計(jì)
- 摘要：為了實(shí)現(xiàn)對電源控制器(PCU)檢測的需求，提出了一種基于LabWindows／CVI的電源控制器的測試系統(tǒng)設(shè)計(jì)方案，并完成系統(tǒng)的軟硬件設(shè)計(jì)。該系統(tǒng)的硬件部分主要用來模擬PCU的各種輸入信號，軟件部分采用LabWindows／C
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控制器介紹
控制器是整個(gè)可視電話系統(tǒng)的控制核心。在系統(tǒng)啟動時(shí)，它負(fù)責(zé)初始化系統(tǒng)中的各軟硬件模塊。舉例說明：當(dāng)調(diào)制解調(diào)器開始數(shù)據(jù)傳輸后，主控制模塊初始化各內(nèi)部變量，然后通過通信口向?qū)Ψ剿?16 個(gè)同步標(biāo)記以及 H.245 的各種消息，完成能力交換、主從決定等，最后打開語音、視頻通道，初始化結(jié)束，正式通信開始。在通信過程中，主控制模塊維護(hù)其他各軟、硬件模塊的正常。其工作過程一般如下：終端A電源接通后，控制器首先從 [ 查看詳細(xì) ]
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