數(shù)字信號處理(dsp) 文章 進入數(shù)字信號處理(dsp)技術社區(qū)
基于DSP的加速度計的家用監(jiān)測設備設計
- 先進的半導體技術正為體積越來越小、功能愈加強大的家用醫(yī)療設備的發(fā)展鋪平道路。對于病人來說，更小的便攜式設備帶來的好處是更容易進行保健、更少去醫(yī)院以及進一步降低醫(yī)療費用。
- 關鍵字： DSP 家用監(jiān)測 加速度計
FPGA與DSP協(xié)同處理系統(tǒng)設計之：典型實例-整數(shù)DCT變換的設計與實現(xiàn)
- 本節(jié)旨在設計實現(xiàn)了視頻壓縮標準H.264算法中的整數(shù)DCT變換部分，幫助讀者了解并行流水設計技巧在算法優(yōu)化中的作用。
- 關鍵字： DSP 協(xié)同處理 FPGA 整數(shù)DCT變換 H.264
FPGA與DSP協(xié)同處理系統(tǒng)設計之：FPGA+DSP協(xié)同平臺的調(diào)試技巧和注意事項
- 作為雙芯片的協(xié)同系統(tǒng)，調(diào)試的開始階段需要對每個芯片進行單獨測試。這種情況下就需要避免另外一個芯片對調(diào)試產(chǎn)生影響，比較好的辦法就是讓它停止工作。
- 關鍵字： DSP 協(xié)同處理 FPGA 內(nèi)部邏輯分析儀 隔離調(diào)試
基于DSP的嵌入式導航計算機系統(tǒng)中CPLD器件軟件更新的實現(xiàn)
- 針對嵌入式導航計算機系統(tǒng)中CPLD器件軟件更新需求，提出了通過串行方式基于DSP的CPLD軟件更新方案，通過DSP的I／O口模擬CPLD的JTAG時序邏輯，將由串口接收到的CPLD配置信息文件，移入到其內(nèi)部邏輯中，從而實現(xiàn)軟件更新。分析研究了實現(xiàn)該方案需解決的硬件和軟件中的關鍵問題，設計實現(xiàn)了提出的CPLD器件軟件更新方案，并在實際的導航計算機系統(tǒng)中進行了驗證和應用。
- 關鍵字： CPLD器件軟件更新 DSP JTAG
基于FPGA+DSP的智能車全景視覺系統(tǒng)
- 為實現(xiàn)智能車全景視覺系統(tǒng)的應用研究平臺，設計了一種基于FPGA+雙DSP的實時6通道數(shù)字圖像采集與處理系統(tǒng)。該系統(tǒng)由兩片F(xiàn)PGA與兩個DSP組成。第一個FPGA進行多通道視覺圖像采集的同步控制、邏輯處理，第二片F(xiàn)PGA輔助DSP進行海量圖像數(shù)據(jù)的高速并行處理。
- 關鍵字： 全景視覺系統(tǒng) FPGA+DSP 數(shù)字圖像采集與處理系統(tǒng)
基于FPGA和多DSP的高速視覺測量系統(tǒng)的研究
- 針對高速視覺測量系統(tǒng)數(shù)據(jù)處理速度快、數(shù)據(jù)處理量大的特點，將FPGA技術與DSP技術相結(jié)合，研究了一種基于FPGA和多DSP的多通道并行處理的高速視覺測量系統(tǒng)。詳細介紹了FPGA技術與多DSP技術在數(shù)字圖像處理過程中的不同應用、高速視覺測量系統(tǒng)的總體結(jié)構以及各部分的工作原理。
- 關鍵字： 高速視覺測量系統(tǒng) DSP FPGA
基于FPGA的915 MHz射頻讀卡器設計
- 參照ISO/IEC 18000-6 Type B 協(xié)議設計了一款工作頻率為915 MHz的射頻讀卡器，采用FPGA完成協(xié)議中規(guī)定的數(shù)字信號處理，C8051F020單片機作為主控器。利用Verilog HDL硬件描述語言，搭建FPGA內(nèi)部各個小模塊及系統(tǒng)的驗證平臺，選用Altera公司Cyclone系列的EP1C6Q240C8芯片為目標器件，使用Quartus II進行綜合，并通過時序和功能驗證。
- 關鍵字： 射頻讀卡器 數(shù)字信號處理 FPGA
用矢量信號分析儀檢測非線性失真(一)
- 移動通信網(wǎng)絡所用功率放大器的一個關鍵性能參數(shù)為非線性失真。但過度的非線性失真會使誤碼率(BER)提高，導致移動通信網(wǎng)絡中所傳輸?shù)恼Z音及數(shù)據(jù)信號質(zhì)量下降。
- 關鍵字： 矢量信號發(fā)生器 RMS DSP
數(shù)字信號處理(dsp)介紹
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