數(shù)字信號處理器（dsp） 文章 進入數(shù)字信號處理器（dsp）技術(shù)社區(qū)
ADSP-21262型DSP的監(jiān)控設計
- 1 引言 隨著數(shù)字信號處理理論的日趨完善和超大規(guī)模集成電路技術(shù)的飛速發(fā)展,在各種實時處理應用需求的推動下,數(shù)字信號處理器(DSP)也得到了越來越廣泛的應用。 DSP的監(jiān)控是DSP開發(fā)和應用中十分重要的環(huán)節(jié)。目前在DSP的開發(fā)過程中,最常用的方式是通過購買處理器的JTAG仿真器和開發(fā)軟件包實現(xiàn)對DSP的調(diào)試和監(jiān)控。JTAG調(diào)試工具的功能十分強大,對于不熟悉DSP內(nèi)部結(jié)構(gòu)和細節(jié)的開發(fā)者而言是一種非常不錯的選擇。但是此種方法也有其缺陷：首先,開發(fā)成本比較昂貴,一般購買正版仿真器和軟件包的價格都在
- 關(guān)鍵字： DSP 監(jiān)控 JTAG PC
基于DSP的音頻會議信號合成算法研究
- 隨著在數(shù)字信號處理(DSP)算法和芯片處理能力以及通信網(wǎng)絡結(jié)構(gòu)優(yōu)化等方面的不斷發(fā)展，現(xiàn)代化通信已經(jīng)迅速普及。音頻會議是眾多通信系統(tǒng)的必備功能。有多個用戶參與的音頻會議，最簡單的模式可以使用令牌控制下的互斥模式，使只有擁有發(fā)言權(quán)的那個與會者才可以講話。在這種模式下，每個與會者某一時刻只能聽到一路音頻信號，這種“半雙工”模式對于音頻會議是不方便和不實際的。 真正的電話會議應當仿真多個與會者在一個會議室進行對話的情形。但是由于與會終端在物理上并不在一起，而每個終端只有一套音頻輸
- 關(guān)鍵字： DSP 音頻會議 音頻輸出 ITU-T 有無聲檢測
視頻監(jiān)控系統(tǒng)中ARM與DSP的HPI接口設計
- 1 引言 隨著網(wǎng)絡技術(shù)、圖像處理技術(shù)及嵌入式技術(shù)日趨成熟，視頻監(jiān)控技術(shù)得到廣泛的應用。銀行、工廠、政府、學校等部門，都設置有監(jiān)控系統(tǒng)。尤其是在國際上一系列恐怖事件后，人們更感到監(jiān)控系統(tǒng)的重要。而且要求視頻監(jiān)控設備有高清晰的視頻效果的同時，還能對現(xiàn)場進行實時控制。所以，此類設備不但要有更高的數(shù)據(jù)處理能力和處理精度，還要有強大的系統(tǒng)控制、管理能力以及高速的網(wǎng)絡數(shù)據(jù)傳輸速率。 目前，市面上主流的視頻監(jiān)控設備，大致可以分成兩類，一是基于通用微處理器，二是基于數(shù)字信號處理器DSP。兩種芯片在功能上有
- 關(guān)鍵字： ARM DSP HPI 視頻監(jiān)控
CEVA和ARM合作CEVA DSP + ARM多處理器SoC的開發(fā)支持
- 硅產(chǎn)品知識產(chǎn)權(quán) (SIP) 平臺解決方案和數(shù)字信號處理器 (DSP) 內(nèi)核授權(quán)廠商CEVA公司宣布與ARM合作，針對多處理器系統(tǒng)級芯片 (SoC) 解決方案的開發(fā)，在ARM? CoreSight? 技術(shù)實現(xiàn)CEVA DSP內(nèi)核的實時跟蹤支持。這種強化的支持將使得日益增多的采用基于CEVA DSP + ARM處理器的SoC客戶，在使用具有ARM Embedded Trace Macrocell? (ETM) 技術(shù)的處理器時，受益于完全的系統(tǒng)可視化，從而簡化調(diào)試過程及確?？?/li>
- 關(guān)鍵字： ARM CEVA DSP 多處理器 SoC SIP
DSP+FPGA在高速高精運動控制器中的應用
- 運動控制卡已經(jīng)在數(shù)控機床、工業(yè)機器人、醫(yī)用設備、繪圖儀、IC電路制造設備、IC封裝等領域得到了廣泛運用，取得了良好的效果。目前運動控制卡大部分采用8051系列的8位單片機，雖然節(jié)省了開發(fā)周期但缺乏靈活性，難以勝任高要求運作環(huán)境，而且運算能力有限。 DSP的數(shù)據(jù)運算處理功能強大，即使在很復雜的控制中，采樣周期也可以取得很小，控制效果更接近于連續(xù)系統(tǒng)。把DSP與PC的各自優(yōu)勢結(jié)合將是高性能數(shù)控系統(tǒng)的發(fā)展趨勢。本運動控制器采用TI公司的高性能浮點DSP作為主控芯片，通過ISA接口與PC
- 關(guān)鍵字： DSP FPGA 運動控制 插補 伺服
DSP在平行雙輪電動車控制系統(tǒng)中的應用
- 1 引 言 2001年，美國發(fā)明家Kamen發(fā)明了一種新型的方便快捷的兩輪交通工具“Segway”，行走平衡控制技術(shù)成為全球機器人控制技術(shù)的研究熱點。以平行雙輪電動車作為移動平臺為機器人的研究提供了技術(shù)支持，同時由于他的行為與火箭飛行和兩足機器人有很大的相似性，因而對其運動平衡控制研究具有重大的理論和實際意義。文獻[2]介紹了平行雙輪電動車的控制器電路，以C8051F020單片機為控制核心通過調(diào)整車體平臺的運行位置，從而使車體平臺始終保持平衡狀態(tài)。然而其并沒有考慮載人、載
- 關(guān)鍵字： DSP 平行雙輪電動車 微處理器 單片機 無刷直流電動機
基于構(gòu)件技術(shù)的嵌入式系統(tǒng)復用軟件設計
- 引言 對嵌入式軟件構(gòu)件平臺而言，其支撐平臺首先是一個嵌入式實時多任務操作系統(tǒng)，其次為整個軟件構(gòu)件的設計提供開發(fā)工具和集成環(huán)境。在支撐平臺的設計過程中，可以借鑒領域工程的思想，將整個嵌入式實時多任務操作系統(tǒng)設計成一個系統(tǒng)級的軟件構(gòu)件庫。這樣不但實現(xiàn)了嵌入式操作系統(tǒng)的可裁剪性，而且由于從嵌入式操作系統(tǒng)到應用程序的設計都是基于離散化的軟件構(gòu)件，因此方便了嵌入式控制應用軟件設計時的集成和調(diào)試。為了方便軟件構(gòu)件的管理，可以將系統(tǒng)級和應用級的軟件構(gòu)件庫綜合成一個功能完備的軟件構(gòu)件庫。它包括從嵌入式控制系統(tǒng)的
- 關(guān)鍵字： 嵌入式 軟件構(gòu)件平臺 操作系統(tǒng) DSP
Xilinx推出LogiCORE Turbo編解碼器解決方案
- 賽靈思公司（Xilinx, Inc.）推出針對LTE無線系統(tǒng)的性能優(yōu)化可編程Turbo編碼解決方案。利用Spartan® 和 Virtex®現(xiàn)場可編程門陣列（FPGA）嵌入的數(shù)字信號處理（DSP）能力, 新推出的Xilinx 3GPP LTE Turbo 編碼器和解碼器LogiCORE™ 產(chǎn)品提供了高達200 Mbps的吞吐能力，可滿足不斷演化的長期演進（LTE）標準對現(xiàn)代無線系統(tǒng)提出的語音和日益增長的數(shù)據(jù)通信要求。 Turbo碼最初專為3G無線系統(tǒng)的商用
- 關(guān)鍵字： Xilinx LTE Turbo FPGA DSP 編碼器 解碼器
基于TMS320C50的通用語音信號處理系統(tǒng)
- 語言是人類相互溝通信息的重要工個。隨著現(xiàn)代科學技術(shù)的發(fā)展,特別是語音通信和各種語音產(chǎn)品的廣泛普及,語音信號的數(shù)字化處理在越來越多的領域中發(fā)揮著巨大的作用。目前,各種以語言信號數(shù)字處理為特點的商品已經(jīng)進入市場,商品化的語音信號處理機也已問世,如KAY公司的CSL TM（Computerized Speech Lab）。 一個完備的語音信號處理系統(tǒng)不但要具備語音信號的采集和回放功能,而且更重要的是要能完成復雜的語音信號分析和處理算法。通常這些算法運算量大,且又要滿足實時或準實時的快速高效處理要求,因
- 關(guān)鍵字： DSP 語音 信號處理
多核設計需掌握關(guān)鍵技術(shù)
- 過去一段時間以來，收益遞減法則(Law of Diminishing Return)在傳統(tǒng)處理器架構(gòu)的進展方面已經(jīng)明顯體現(xiàn)出來。每一代新工藝幾何尺寸和新興微架構(gòu)的進步，在相應性能上所能帶來的增益正在逐漸減少──顯然，借助更快速度以實現(xiàn)摩爾定律的方法不再靈驗！功耗和微架構(gòu)改良的限制，使單一處理器的發(fā)展前景受挫，業(yè)界的關(guān)注焦點已轉(zhuǎn)向多處理器或多核芯片架構(gòu)的開發(fā)潛力。 由于多核主要是用于克服單處理器系統(tǒng)局限性的，所以很多人認為，采用多核純粹是出于性能方面的考慮。但以picoChip的經(jīng)驗來看，多核技術(shù)
- 關(guān)鍵字： 多核 收益遞減法則 DSP 處理器
一種實時信號處理系統(tǒng)的研究和實現(xiàn)
- 引言 近年來，實時信號處理的要求越來越高，所用系統(tǒng)要求具有處理大量數(shù)據(jù)的能力，這就要求系統(tǒng)硬件要達到很高的運算速度，并且軟件處理程序也要盡可能優(yōu)化，以保證系統(tǒng)的實時性。本文基于FPGA和ADSP-TS101S所實現(xiàn)的一種高速數(shù)據(jù)并行處理系統(tǒng)，可以進行實時連續(xù)波和脈沖波的處理，并將連續(xù)波的頻譜和脈沖波脈沖幅度信息、脈前時刻、脈寬及載頻打包輸出。整個系統(tǒng)的輸出延時被控制在1ms之內(nèi)。 系統(tǒng)任務及系統(tǒng)結(jié)構(gòu) 系統(tǒng)任務 系統(tǒng)頻譜分析電路組成結(jié)構(gòu)如圖1所示。前端輸入為高頻寬帶模擬信號經(jīng)過數(shù)
- 關(guān)鍵字： FPGA DSP 信號處理 DMAR DMA
數(shù)字信號處理器（dsp）介紹
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