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時(shí)鐘
時(shí)鐘 文章 進(jìn)入時(shí)鐘技術(shù)社區(qū)
AD9547網(wǎng)絡(luò)時(shí)鐘與同步方案
- AD9547是雙路/四路輸入網(wǎng)絡(luò)時(shí)鐘發(fā)生器/同步器,能為許多系統(tǒng)包括同步光網(wǎng)絡(luò)(SONET/SDH)提供同步.輸入基準(zhǔn)頻率從1 kHz 到750 MHz,頻率監(jiān)視1ppm,輸出頻率高達(dá)450MHz,主要應(yīng)用在網(wǎng)絡(luò)同步,OC-192的SONET/SDH時(shí)鐘,無(wú)線基站
- 關(guān)鍵字： 方案 同步 時(shí)鐘 網(wǎng)絡(luò) AD9547
高速數(shù)據(jù)轉(zhuǎn)換系統(tǒng)對(duì)時(shí)鐘和數(shù)據(jù)傳輸?shù)男阅芤?/a>
- 隨著今天模數(shù)轉(zhuǎn)換器的數(shù)據(jù)轉(zhuǎn)換采樣速度進(jìn)入到每秒千兆次采樣(GSPS)，系統(tǒng)需要能夠支持這樣高的轉(zhuǎn)換速度，模擬器件必須產(chǎn)生和放大高頻信號(hào)。除了模擬信號(hào)路徑外，設(shè)計(jì)師需要完全了解采樣時(shí)鐘和高比特率數(shù)據(jù)獲取電路方
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時(shí)鐘樹(shù)優(yōu)化與有用時(shí)鐘延遲
- 時(shí)鐘樹(shù)優(yōu)化與有用時(shí)鐘延遲在 “后端時(shí)序修正基本思路” 提到了時(shí)序優(yōu)化的基本步驟。其中，最關(guān)鍵的階段就是時(shí)鐘樹(shù)建立?；镜膬?yōu)化都優(yōu)先在數(shù)據(jù)路徑上進(jìn)行，并且希望路徑盡量的短，最好在一個(gè)時(shí)鐘周期之內(nèi)
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基于FPGA的時(shí)鐘設(shè)計(jì)
- 基于FPGA的時(shí)鐘設(shè)計(jì),對(duì)于一個(gè)設(shè)計(jì)項(xiàng)目來(lái)說(shuō)，全局時(shí)鐘是最簡(jiǎn)單和最可預(yù)測(cè)的時(shí)鐘。在PLD／FPGA設(shè)計(jì)中最好的時(shí)鐘方案是由專(zhuān)用的全局時(shí)鐘輸入引腳驅(qū)動(dòng)的單個(gè)主時(shí)鐘去鐘控設(shè)計(jì)項(xiàng)目中的每一個(gè)觸發(fā)器。只要可能就應(yīng)盡量在設(shè)計(jì)項(xiàng)目中采用全局時(shí)鐘
- 關(guān)鍵字： 設(shè)計(jì) 時(shí)鐘 FPGA 基于
PIC WWVB時(shí)鐘設(shè)計(jì)
- PIC WWVB時(shí)鐘設(shè)計(jì),有很多DIY WWVB在網(wǎng)絡(luò)上的時(shí)鐘設(shè)計(jì)的版本。商業(yè)的“原子”的鐘表價(jià)格便宜和廣泛使用，但我想試試我的手，在設(shè)計(jì)一個(gè)獲得接收到WWVB的洞察和了解一點(diǎn)點(diǎn)編程PIC單片機(jī)。我的版本是不是最簡(jiǎn)單的，但它工作得很
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時(shí)鐘介紹
時(shí)鐘的概念多用于數(shù)字語(yǔ)音交換機(jī)，因?yàn)閿?shù)字交換對(duì)于以時(shí)隙為單位的交換單位而言，其時(shí)間性的重要程度非常高。為保證交換機(jī)的正常工作，每套交換系統(tǒng)都必須配置精度極高的時(shí)鐘發(fā)生器，用于交換系統(tǒng)內(nèi)部工作。系統(tǒng)內(nèi)部的時(shí)鐘一般稱為內(nèi)時(shí)鐘。
如果兩套交換系統(tǒng)協(xié)調(diào)工作，那么必須要在兩套系統(tǒng)之家，也就是兩個(gè)內(nèi)時(shí)鐘之間進(jìn)行協(xié)調(diào)，保證兩個(gè)時(shí)鐘同步工作，這就是時(shí)鐘同步，對(duì)于每套系統(tǒng)的內(nèi)時(shí)鐘而言，另一套系統(tǒng)的內(nèi)時(shí)鐘即為外時(shí)鐘 [ 查看詳細(xì) ]
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