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EEPW首頁 >> 主題列表 >> 現(xiàn)場可編程門陣列(fpga)

現(xiàn)場可編程門陣列(fpga) 文章進入現(xiàn)場可編程門陣列(fpga)技術(shù)社區(qū)

一種基于FPGA核系統(tǒng)的智能429-422信號轉(zhuǎn)換模塊的設(shè)

摘要：介紹了一種智能信號轉(zhuǎn)換模塊的設(shè)計方法。這種智能模塊采用了基于FPGA嵌入式軟核系統(tǒng)，是基于NiosII軟核處理器的架構(gòu)，可以在模塊上完全實現(xiàn)外部總線信號之間相互轉(zhuǎn)換，無需驅(qū)動程序或操作系統(tǒng)的干預(yù)。同時對用
關(guān)鍵字： FPGA 429 422 系統(tǒng)

基于FPGA的移位寄存器流水線結(jié)構(gòu)FFT處理器設(shè)計與實現(xiàn)

0引言快速傅里葉變換(FFT)在雷達、通信和電子對抗等領(lǐng)域有廣泛應(yīng)用。近年來現(xiàn)場可編程門陣列(FPGA)...
關(guān)鍵字： FPGA 移位寄存器 FFT

基于動態(tài)可重構(gòu)FPGA的容錯技術(shù)研究

摘要：針對重構(gòu)文件的大小、動態(tài)容錯時隙的長短、實現(xiàn)的復(fù)雜性、模塊間通信方式、冗余資源的比例與布局等關(guān)鍵問題進行了分析。并對一些突出問題，提出了基于算法和資源多級分塊的解決方法，闡述了新方法的性能，及其
關(guān)鍵字： FPGA 動態(tài)可重構(gòu) 容錯技術(shù)研究

基于FPGA的IEEE 1394b高速數(shù)據(jù)傳輸系統(tǒng)

摘要：介紹了IEEE 1394h串行總線的特點，并以FPGA嵌入式處理器Nios II為控制核心，設(shè)計實現(xiàn)了一種1394b高速數(shù)據(jù)傳輸系統(tǒng)。闡述了該系統(tǒng)的硬件設(shè)計和軟件工作流程。實驗表明，該系統(tǒng)可靠性高、實時性好、具有廣泛的應(yīng)
關(guān)鍵字： 1394b FPGA IEEE 高速數(shù)據(jù)

基于FPGA和LabView的遙測信號模擬源設(shè)計

摘要：基于FPGA和LabView設(shè)計了用于某遙測組件測試的專用設(shè)備。運用DDS技術(shù)實現(xiàn)傳輸速率可變的LNDS信號，并使用LabView圖形編程工具，實現(xiàn)了數(shù)字信號源的交互界面，可以產(chǎn)生由上住機程控信號傳輸速率和數(shù)據(jù)內(nèi)容可變的
關(guān)鍵字： LabView FPGA 遙測信號模擬源

基于FPGA的攝像機傳感器接口實現(xiàn)

圖像傳感器，是組成數(shù)字?jǐn)z像頭的重要組成部分。如果沒有傳感器，就沒有圖像信號可進行處理。眾所周知傳感器是非標(biāo)準(zhǔn)化的。在采用的方案中，它們有以下的不同之處：　　轉(zhuǎn)換可見光或紅外光為電信號的方式；尤其
關(guān)鍵字：接口實現(xiàn) 傳感器攝像機 FPGA 基于

基于DSP與FPGA的藍牙數(shù)據(jù)采集系統(tǒng)

數(shù)據(jù)采集系統(tǒng)廣泛地應(yīng)用于工業(yè)、國防、圖像處理、信號檢測等領(lǐng)域。DSP處理器是一種高速的數(shù)字信號處理...
關(guān)鍵字： DSP FPGA 藍牙數(shù)據(jù) 采集系統(tǒng)

基于FPGA的圖像增強視頻處理系統(tǒng)

圖像增強處理有很強的針對性，沒有統(tǒng)一的評價標(biāo)準(zhǔn)，從一般的圖片、視頻欣賞角度來說，濾除噪聲、擴展對比度、銳化...
關(guān)鍵字： FPGA 圖像增強

基于FPGA高速并行采樣技術(shù)的研究

摘要：介紹一種基于四通道ADC的高速交錯采樣設(shè)計方法以及在FPGA平臺上的實現(xiàn)。著重闡述四通道高速采樣時鐘的設(shè)計與實現(xiàn)、高速數(shù)據(jù)的同步接收以及采樣數(shù)據(jù)的校正算法。實驗及仿真結(jié)果表明，同步數(shù)據(jù)采集的結(jié)構(gòu)設(shè)計和預(yù)
關(guān)鍵字： FPGA 高速并行采樣技術(shù)

基于FPGA的三模冗余容錯技術(shù)研究

摘要：基于SRAM的FPGA對于空間粒子輻射非常敏感，很容易產(chǎn)生軟故障，所以對基于FPGA的電子系統(tǒng)采取容錯措施以防止此類故障的出現(xiàn)是非常重要的。三模冗余(TMR)方法以其實現(xiàn)的簡單性和效果的可靠性而被廣泛用于對單粒子
關(guān)鍵字： FPGA 三模冗余容錯技術(shù)研究

用LatticeXP FPGA 橋接吉比特媒體獨立接口

吉比特媒體獨立接口是一種以太網(wǎng)接口，簡稱GMII（Gigabit Media Independent Interface）。簡化的吉比特媒體獨立接口稱為RGMII（Reduced Gigabit Media Independent Interface）。采用RGMII的目的是降低電路成本，使
關(guān)鍵字：獨立接口媒體比特 FPGA 橋接 LatticeXP

基于FPGA的智能小車設(shè)計

摘要：介紹基于FPGA的智能小豐設(shè)計，小車包括在FPGA上構(gòu)建以NiosⅡ嵌入式系統(tǒng)為核心的控制電路、傳感器電路、動力及轉(zhuǎn)向電路、LCM電路、溫度和濕度測量電路、無線數(shù)據(jù)收發(fā)電路。在NiosⅡ集成開發(fā)環(huán)境(IDE)縞寫C語言程
關(guān)鍵字：設(shè)計小車智能 FPGA 基于

萊迪思和HELION TECHNOLOGY發(fā)布了適用于LatticeECP3 FPGA系列的壓縮和加密IP核

　　萊迪思半導(dǎo)體公司和Helion Technology今日宣布一系列適用于LatticeECP3 FPGA系列的壓縮和加密的IP核現(xiàn)已上市。該系列具有有效載荷壓縮系統(tǒng)核，提高了有限信道帶寬的利用率，因此非常適合微波回程應(yīng)用、寬帶無線接入適用于802.16e（WiMAX）以及潛在的其他多鏈路多輸入-多輸出（MIMO）應(yīng)用中的使用。在LatticeECP3器件中，IP核可以從500Mbps無縫擴展至超過3Gbps，并可用于典型的網(wǎng)絡(luò)應(yīng)用中的第2層或第3層。IP核采用了非常強大和成熟的LZRW無損壓縮算法，它
關(guān)鍵字：萊迪思 FPGA

Altera、Apical和AltaSens聯(lián)合發(fā)布HD寬動態(tài)范圍視頻監(jiān)控芯片組

　　延續(xù)其在高清晰(HD)寬動態(tài)范圍(WDR)監(jiān)控攝像機解決方案上的領(lǐng)先優(yōu)勢，Altera公司、Apical有限公司(UK)以及AltaSens有限公司今天宣布，開始提供業(yè)界第一款HD WDR視頻監(jiān)控芯片組。這一獨特的芯片組結(jié)合了Altera Cyclone® IV E FPGA和安全芯片，支持Apical的HD WDR全圖像信號處理(ISP)流水線IP和AltaSens的1080p60 A3372E3-4T圖像傳感器。這一獨特的解決方案能夠方便的使用Apical IP，降低了用戶在全傳感器處理解
關(guān)鍵字： Altera 視頻監(jiān)控 FPGA

基于FPGA的多路圖像采集系統(tǒng)的軟件設(shè)計

摘要：分析了現(xiàn)有的視頻采集方案的研究現(xiàn)狀，對如何采用CCD攝像頭采集多通道、高分辨率、高質(zhì)量的圖像以及基于FPGA的嵌入式圖像采集系統(tǒng)的實現(xiàn)方法做了研究。與傳統(tǒng)圖像采集系統(tǒng)相比，該系統(tǒng)主要利用四片視頻解碼芯片
關(guān)鍵字： FPGA 多路圖像采集系統(tǒng) 軟件設(shè)計

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現(xiàn)場可編程門陣列(fpga)介紹

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現(xiàn)場可編程門陣列(fpga)電路

利用FPGA資源和最小模擬電路發(fā)電進行開關(guān)電源設(shè)計的方法
基于FPGA的機載顯示系統(tǒng)架構(gòu)設(shè)計與優(yōu)化
基于FPGA+DSP遠(yuǎn)程監(jiān)控器設(shè)計與實現(xiàn)
基于FPGA的LCD顯示遠(yuǎn)程更新

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