現(xiàn)場可編程門陣列（fpga） 文章 進入現(xiàn)場可編程門陣列（fpga）技術(shù)社區(qū)
基于DSP與雙目CMOS攝像頭的數(shù)字圖像處理系統(tǒng)
- 摘 要：介紹了基于浮點DSP處理器與雙CMOS攝像頭的數(shù)字圖像采集處理系統(tǒng),探討了系統(tǒng)的基本原理和設(shè)計方法,并給出了系統(tǒng)的實現(xiàn)方案。在該系統(tǒng)中,數(shù)據(jù)采集由兩個相互獨立的CMOS攝像頭完成,并由DSP進行圖像處理,FPGA協(xié)同DSP完成時序邏輯控制和組合邏輯控制。處理后的圖像可以通過1394接口輸出。該系統(tǒng)主要由FPGA和DSP實現(xiàn),設(shè)計靈活,具有很強的重構(gòu)性。 關(guān)鍵詞：圖像 圖像處理 DSP FPGA IEEE1394 傳統(tǒng)的數(shù)字圖像處理通常
- 關(guān)鍵字： DSP FPGA IEEE1394 單片機 嵌入式系統(tǒng) 圖像 圖像處理 消費電子 消費電子
G.726語音編解碼器在SoPC中的實現(xiàn)
- 摘 要：在對G.726語音編解碼標(biāo)準分析的基礎(chǔ)上給出了基于FPGA的DSP設(shè)計流程,利用MATLAB/Simulink、DSP Builder和SOPC Builder工具設(shè)計了G.726語音編解碼器,通過仿真實驗驗證了所設(shè)計的編解碼器模型的正確性,實現(xiàn)了編解碼器在SoPC系統(tǒng)中的綜合。 關(guān)鍵詞：ADPCM MATLAB/Simulink DSP Builder FPGA SoPC G.726是ITU前身CCITT于1990年在G.721和G.723標(biāo)準的基礎(chǔ)上提出的關(guān)于把64kbps非線性PCM信號
- 關(guān)鍵字： ADPCM Builder DSP FPGA MATLAB/Simulink SoPC 消費電子 消費電子
基于FPGA的IPV6數(shù)據(jù)包的拆裝實現(xiàn)
- 基于FPGA的IPV6數(shù)據(jù)包的拆裝實現(xiàn) 王志遠, 杜詩武, 曲 晶(信息工程學(xué)院 信息技術(shù)研究所,河南 鄭州 450002) 摘 要：介紹了一種運用FPGA將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分分離并重新封裝的方法。利用該方法,可以使IPV6數(shù)據(jù)包的拆裝處理速度達到2Gbit/s以上。 關(guān)鍵詞：FPGA IPV6數(shù)據(jù)包 拆裝 FIFO 筆者在參與國家“863”重大專題項目“高速密碼芯片及驗證平臺系統(tǒng)”的過程中,遇到了將IPV6數(shù)據(jù)包的包頭和數(shù)據(jù)部分拆開,然后把數(shù)據(jù)部分送密碼芯片進行加
- 關(guān)鍵字： FIFO FPGA IPV6數(shù)據(jù)包 拆裝
基于DSP和FPGA的ARINC429機載總線接口板的硬件設(shè)計
- 基于DSP和FPGA的ARINC429機載總線接口板的硬件設(shè)計 西安交通大學(xué)電子與信息工程學(xué)院(710049) 種稚萌 王 亮 韓崇昭 李 峰 摘 要：介紹了民用飛機機載數(shù)據(jù)總線ARINC429的硬件接口板,該接口板采用DSP和FPGA實現(xiàn)四路ARINC429信號收發(fā)通道,使整個系統(tǒng)的處理速度大大提高。 關(guān)鍵詞：ARINC429總線 DSP FPGA 機載數(shù)據(jù)總線 ARINC429在當(dāng)代的運輸機和相當(dāng)數(shù)量的民航客機 (如A310、A300、A600、B757、B767)中有著廣
- 關(guān)鍵字： ARINC429總線 DSP FPGA
基于FPGA實現(xiàn)FIR濾波器的研究
- 基于FPGA實現(xiàn)FIR濾波器的研究 武漢大學(xué)電氣工程學(xué)院(430072) 郭曉宇 潘 登 楊同中 摘 要：針對在FPGA中實現(xiàn)FIR濾波器的關(guān)鍵——乘法運算的高效實現(xiàn)進行了研究,給出了將乘法化為查表的DA算法,并采用這一算法設(shè)計了FIR濾波器。通過FPGA仿真驗證,證明了這一方法是可行和高效的,其實現(xiàn)的濾波器的性能優(yōu)于用DSP和傳統(tǒng)方法實現(xiàn)的FIR濾波器。最后介紹了整數(shù)的CSD表示和還處于研究階段的根據(jù)FPGA實現(xiàn)的要求改進的最優(yōu)表示。 關(guān)鍵詞：FPGA DA FIR濾波器 CSD
- 關(guān)鍵字： CSD DA FIR濾波器 FPGA
內(nèi)嵌ARM核的FPGA芯片EPXA10及其在圖像驅(qū)動和處理方面的應(yīng)用
- 內(nèi)嵌ARM核的FPGA芯片EPXA10及其在圖像驅(qū)動和處理方面的應(yīng)用 北京航空航天大學(xué)自動化科學(xué)與電氣工程學(xué)院(100083) 尹 娜 江 潔 張廣軍 摘 要：介紹了內(nèi)嵌 ARM核的FPGA芯片EPXA10的主要功能特點、內(nèi)部結(jié)構(gòu)及工作方式，通過其在圖像驅(qū)動和處理方面的應(yīng)用，體現(xiàn)了EPXA10邏輯控制實現(xiàn)簡單、對大量數(shù)據(jù)做簡單處理速度快以及軟件編程靈活的特點。 關(guān)鍵詞：ARM FPGA EPXA10 圖像驅(qū)動 圖像處理 隨著亞微米技術(shù)的發(fā)展，F(xiàn)PGA芯片密度不斷增加，并以強大的
- 關(guān)鍵字： ARM EPXA10 FPGA 圖像處理 圖像驅(qū)動
高速數(shù)字串行加法器及其應(yīng)用
- 高速數(shù)字串行加法器及其應(yīng)用 深圳南山區(qū)科技園中興通訊IC開發(fā)一部(518057) 鐘信潮上海盛立亞光網(wǎng)絡(luò)系統(tǒng)有限公司 薛小剛深圳南山區(qū)科技園中興通訊3G開發(fā)(518057) 王 誠 摘 要：與傳統(tǒng)加法器相比，數(shù)字串行加法器具有工作頻率高、占用資源少、設(shè)計靈活等優(yōu)點。介紹了數(shù)字串行加法器的原理，說明了該加法器在FPGA上的實現(xiàn)要點及其在匹配濾波器設(shè)計中的應(yīng)用。 關(guān)鍵詞：加法器 位并行 數(shù)字串行 FPGA 匹配濾波器 與傳統(tǒng)DSP相比，定制DSP具有速度更高、設(shè)計靈活、易于更改
- 關(guān)鍵字： FPGA 加法器 匹配濾波器 數(shù)字串行 位并行
利用Virtex-5 FPGA實現(xiàn)更高的性能
- 在FPGA系統(tǒng)設(shè)計中，要達到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx® 的Virtex™-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric™技術(shù)。以針對邏輯和算術(shù)功能的量化預(yù)期性能改進為例，我將探究ExpressFabric架構(gòu)的主要功能?；趯嶋H客戶設(shè)計的基準將說明Virtex-5ExpressFabric技術(shù)性能平均比前一
- 關(guān)鍵字： FPGA Virtex-5 單片機 嵌入式系統(tǒng)
利用Xilinx Platform Studio工具套件，快速、便捷地生成 BSP
- 具有嵌入式處理器的 平臺 FPGA 為您提供前所未有的靈活性、集成度和高性能。目前，在單個可編程邏輯設(shè)備中開發(fā)極其復(fù)雜且高度定制化的嵌入式系統(tǒng)已成為可能。 隨著芯片性能的不斷增加，如何使設(shè)計方法始終高效、多產(chǎn)，成為人們面臨的主要挑戰(zhàn)。嵌入式系統(tǒng)開發(fā)的關(guān)鍵活動之一是開發(fā)板支持包 (BSP)。利用 BSP，可以使嵌入式軟件應(yīng)用程序成功地初始化，并與連接到處理器的硬件資源進行通信。典型的 BSP 組件包括引導(dǎo)代碼、設(shè)備驅(qū)動程序代碼和
- 關(guān)鍵字： FPGA PowerPC 處理器的Virtex 單片機 嵌入式系統(tǒng)
實現(xiàn)直接數(shù)字頻率合成器的三種技術(shù)方案
- 摘 要：討論了DDS的工作原理及性能特點，介紹了目前實現(xiàn)DDS常用的三種技術(shù)方案，并對各方案的特點作了簡單的說明。 關(guān)鍵詞：直接數(shù)字頻率合成器 相位累加器 信號源 現(xiàn)場可編程門陣列 1971年，美國學(xué)者J.Tierney等人撰寫的"A Digital Frequency Synthesizer"一文首次提出了以全數(shù)字技術(shù)，從相位概念出發(fā)直接合成所需波形的一種新的頻率合成原理。限于當(dāng)時的技術(shù)和器件水平，它的性能指
- 關(guān)鍵字： 現(xiàn)場可編程門陣列 相位累加器 信號源 直接數(shù)字頻率合成器
基于矢量控制的高性能異步電機速度控制器的設(shè)計
- 摘 要：由于異步電機的矢量控制算法比較復(fù)雜,要達到高性能的目的,必須利用雙DSP,使其系統(tǒng)的整體性價比下降。為解決這一問題,本文利用現(xiàn)場可編程門陣列(FPGA),設(shè)計一種智能控制器來完成一系列復(fù)雜控制算法,實現(xiàn)了異步電機矢量控制速度控制器的專用集成電路。該電路對研制具有自主知識產(chǎn)權(quán)的矢量控制異步電機變頻調(diào)速專用芯片有著十分重要的意義。 關(guān)鍵詞：異步電機 矢量控制 現(xiàn)場可編程門陣列 智能控制器 控制算法 可靠性和實時性是對控制系統(tǒng)的
- 關(guān)鍵字： 單片集成 控制算法 矢量控制 現(xiàn)場可編程門陣列 異步電機 智能控制器
SYNPLICITY CERTIFY軟件全面支持XILINX VIRTEX-5 FPGA簡化ASIC原型驗證過程
- Synplicity宣布其Certify® ASIC RTL 原型設(shè)計軟件增強了對 Xilinx Virtex™-5 系列的 65 納米 FPGA 的支持。Certify 軟件是業(yè)界首款支持多個 FPGA 進行 ASIC 原型設(shè)計的產(chǎn)品。Certify 工具將多芯片分組技術(shù)與業(yè)界一流的 FPGA 綜合技術(shù)
- 關(guān)鍵字： ASIC原型驗證 CERTIFY軟件 FPGA SYNPLICITY VIRTEX-5 XILINX 單片機 嵌入式系統(tǒng)
利用Virtex-5 FPGA實現(xiàn)更高性能的方法
- 在FPGA系統(tǒng)設(shè)計中，要達到性能最大化需要平衡具有混合性能效率的元器件，包括邏輯構(gòu)造(fabric)、片上存儲器、DSP和I/O帶寬。在本文中，我將向你解釋怎樣能在追求更高系統(tǒng)級性能的過程中受益于Xilinx? 的Virtex?-5 FPGA構(gòu)建模塊，特別是新的ExpressFabric?技術(shù)。以針對邏輯和算術(shù)功能的量化預(yù)期性能改進為例，我將探究ExpressFabric架構(gòu)的主要功能。基于實際客戶設(shè)計的基準將說明Virtex-5ExpressFabric技術(shù)性能平均比前一代Virtex-4 FPGA要高
- 關(guān)鍵字： FPGA Virtex-5 單片機 邏輯構(gòu)造 嵌入式系統(tǒng)
可重構(gòu)計算技術(shù)將漸入民用領(lǐng)域
- 可重構(gòu)計算（Reconfigurable Computing） 技術(shù)是指在軟件的控制下，利用系統(tǒng)中的可重用資源（如FPGA等可重構(gòu)邏輯器件），根據(jù)應(yīng)用的需要重新構(gòu)造一個新的計算平臺，達到接近專用硬件設(shè)計的高性能。它避免了微處理器計算模式因為取指、譯碼等步驟導(dǎo)致的性能損失，同時也消除了專用集成電路（ASIC）計算模式因為前期設(shè)計制造的復(fù)雜過程帶來的高代價和不可重用等缺陷。 從某種意義上來說，可重構(gòu)計算技術(shù)并不是什么新技術(shù)，
- 關(guān)鍵字： FPGA 可重構(gòu)計算 嵌入式
FPGA實現(xiàn)的FIR算法在汽車動態(tài)稱重儀中的應(yīng)用
- 引言 車輛在動態(tài)稱重時，作用在平臺上的力除真實軸重外，還有許多因素產(chǎn)生的干擾力，如：車速、車輛自身諧振、路面激勵、輪胎驅(qū)動力等，給動態(tài)稱重實現(xiàn)高精度測量造成很大困難。若在消除干擾的過程中采用模擬方法濾波，參數(shù)則不能過大，否則將產(chǎn)生過大的延遲導(dǎo)致不能實現(xiàn)實時處理，從而造成濾波后的信號仍然含有相當(dāng)一部分的噪聲。所以必須采用數(shù)字濾波消除干擾。 FIR濾波的原理及實現(xiàn) 本文采用FIR數(shù)字濾波，其原理如公式1所示。 Y(n)= (1) 其中h(k)為系統(tǒng)濾波參數(shù)，x(n)為采集的信號，
- 關(guān)鍵字： FIR算法 FPGA 動態(tài)稱重儀 汽車電子 汽車電子
現(xiàn)場可編程門陣列（fpga）介紹
您好，目前還沒有人創(chuàng)建詞條現(xiàn)場可編程門陣列（fpga）!
歡迎您創(chuàng)建該詞條，闡述對現(xiàn)場可編程門陣列（fpga）的理解，并與今后在此搜索現(xiàn)場可編程門陣列（fpga）的朋友們分享。 創(chuàng)建詞條
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