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          MSP430系列MCU的動(dòng)態(tài)時(shí)鐘配置分析

          • 本文結(jié)合MSP430系列微處理器,詳細(xì)論述了通過(guò)控制改變MCU的時(shí)鐘頻率來(lái)降低功耗的設(shè)計(jì)方法?! ? 功耗產(chǎn)生的原因  在CMOS電路中,功耗損失主要包括靜態(tài)功耗損失和動(dòng)態(tài)功耗損失兩部分。其中靜態(tài)功耗主要是由反偏PN結(jié)
          • 關(guān)鍵字: 配置  分析  時(shí)鐘  動(dòng)態(tài)  系列  MCU  MSP430  

          電磁兼容實(shí)驗(yàn)室儀器配置

          • 產(chǎn)品必須符合EMC(電磁兼容)要求,歐洲規(guī)定:銷售違反電磁兼容法令(89/336/EEC)的產(chǎn)品將面臨高額罰款,因此,商家越來(lái)越重視產(chǎn)品的電磁兼容性問(wèn)題,為了降低成本,要根據(jù)公司需求和規(guī)模的不同,組建一個(gè)EMC實(shí)驗(yàn)室,本
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          可配置平臺(tái)化數(shù)字電視手機(jī)方案

          • 通過(guò)多核低功耗技術(shù)以及各種不同的IP模塊,VF1000不僅僅能夠滿足數(shù)字手機(jī)電視對(duì)低功耗視頻解碼芯片的需求,同時(shí)也適用于包括GPS、IPTVSTB、PMP甚至腕表電視這樣需要超低功耗解碼技術(shù)的各類應(yīng)用。“移動(dòng)電視和可
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          Cisco路由器配置大全

          • 隨著計(jì)算機(jī)應(yīng)用的不斷發(fā)展,許多企業(yè)計(jì)算機(jī)局域網(wǎng)規(guī)模在不斷擴(kuò)大,網(wǎng)絡(luò)的獨(dú)立網(wǎng)關(guān)或獨(dú)立網(wǎng)點(diǎn)數(shù)目也日益增多;同時(shí),由于應(yīng)用的發(fā)展,需要對(duì)網(wǎng)絡(luò)進(jìn)行優(yōu)化和改造,并且增加新的業(yè)務(wù),如語(yǔ)音和視頻通信等,因此,必須對(duì)原
          • 關(guān)鍵字: 大全  配置  路由器  Cisco  

          在Cisco路由器上配置VRF-aware IPsec VPN詳解

          • 之前通過(guò)場(chǎng)景實(shí)例向大家展示了用Virtual Routing and Forwarding (VRF,虛擬路由轉(zhuǎn)發(fā))將一個(gè)路由器分割成八個(gè)虛擬路由器的方法。當(dāng)時(shí)我向大家演示了如何配置VRF,在本文中我們繼續(xù)使用這個(gè)場(chǎng)景,并通過(guò)IPsec配置,將
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          交換機(jī)和路由器配置命令

          • 1、保存配置Router # write memoryRouter # write network tftp2、刪除配置Router # write erase3、基本檢測(cè)命令(telnet、ping、trace)Router 》 telnet paris/222.34.27.1Router 》 ping 182.105.130.110Router 》
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          思科路由器的四個(gè)配置步驟

          • 通常對(duì)思科路由器或者交換機(jī)進(jìn)行了修改,然后又需要將這些修改移除掉的情況?其實(shí),有很多種方法可以完成這一點(diǎn),可能很多人對(duì)思科路由器配置還不是特別的了解,今天我在這里拿出來(lái)和大家分享一下,希望對(duì)大家有用。
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          VxWorks網(wǎng)絡(luò)驅(qū)動(dòng)配置及分析

          • VxWorks網(wǎng)絡(luò)驅(qū)動(dòng)配置及分析,VxWorks支持兩種形式的網(wǎng)絡(luò)驅(qū)動(dòng),一種是BSD驅(qū)動(dòng)支持通用的BSD4.4網(wǎng)絡(luò),API,結(jié)構(gòu)等和大多數(shù)BSD網(wǎng)絡(luò)的驅(qū)動(dòng)類似.另一種是END網(wǎng)絡(luò)驅(qū)動(dòng),是VxWorks獨(dú)有的,根據(jù)VxWorksMUX接口編程,不過(guò)END驅(qū)動(dòng)在底層也要轉(zhuǎn)換成BSD的形式.VxWo
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          IPTV機(jī)頂盒的智能化配置和維護(hù)方案設(shè)計(jì)

          • IPTV接收終端,即IPTV機(jī)頂盒,是IPTV系統(tǒng)關(guān)鍵設(shè)備之一,其主要功能包括:支持LAN或xDSL網(wǎng)路傳輸、接收及處理IP數(shù)據(jù)和視頻流;支持H.264、MPEG-2、MPEG-4、WMV和Real等視頻解碼;支持相應(yīng)CA技術(shù);支持HTML網(wǎng)頁(yè)瀏覽及網(wǎng)
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          SAA7115視頻解碼芯片寄存器的配置與應(yīng)用

          • 摘要:為確保視頻傳輸過(guò)程中傳輸數(shù)據(jù)的正確性,設(shè)計(jì)了一個(gè)簡(jiǎn)單的視頻信號(hào)傳輸系統(tǒng)。在該系統(tǒng)中,對(duì)視頻解碼芯片的配置很關(guān)鍵。與其它普通視頻解碼芯片相比,SAA7115解碼芯片內(nèi)有自適應(yīng)的NTSC/PAL/SECAM制式的梳狀濾
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          嵌入式控制和監(jiān)測(cè)應(yīng)用的趨勢(shì):可重配置 I/O(RIO) 架構(gòu)

          • 嵌入式控制和監(jiān)測(cè)應(yīng)用的趨勢(shì):可重配置 I/O(RIO) 架構(gòu),多年來(lái),嵌入式系統(tǒng)設(shè)計(jì)人員一直都在使用FPGA(現(xiàn)場(chǎng)可編程邏輯門陣列)配合微處理器(MPU)及微控制器(MCU)進(jìn)行系統(tǒng)開發(fā)。FPGA已經(jīng)廣泛應(yīng)用于擴(kuò)展MPU I/O的功能,以及作為各種子系統(tǒng)和通信端口的連接接口。隨著FPGA容量
          • 關(guān)鍵字: I/O  RIO  架構(gòu)  配置  趨勢(shì)  控制  監(jiān)測(cè)  應(yīng)用  嵌入式  

          基于可重配置光分插復(fù)用器(ROADM)的嵌入式控制應(yīng)用

          •  對(duì)于城域網(wǎng)絡(luò)和長(zhǎng)途網(wǎng)絡(luò)來(lái)說(shuō),如果光傳送層具有遠(yuǎn)程重新配置的能力,則可以極大地降低運(yùn)營(yíng)成本。運(yùn)營(yíng)商也已經(jīng)意識(shí)到這種潛力,并在最近業(yè)務(wù)網(wǎng)絡(luò)的招標(biāo)中加入了對(duì)于可重配置光分插復(fù)用器(ROADM)以及多維光開關(guān)的要求
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          基于微處理器的FPGA的在線可重配置

          • 基于微處理器的FPGA的在線可重配置,可編程邏輯器件(PLD)廣泛應(yīng)用在各種電路設(shè)計(jì)中。基于查找表技術(shù)、SRAM工藝的大規(guī)模PLD/FPGA,密度高且觸發(fā)器多,適用于復(fù)雜的時(shí)序邏輯,如數(shù)字信號(hào)處理和各種算法的設(shè)計(jì)。類器件使用SRAM單元存儲(chǔ)配置數(shù)據(jù)。配置數(shù)據(jù)
          • 關(guān)鍵字: 配置  在線  FPGA  微處理器  基于  

          用FPGA實(shí)現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù)

          • 用FPGA實(shí)現(xiàn)Nios II嵌入式系統(tǒng)配置技術(shù),現(xiàn)場(chǎng)可編程門陣列(FPGA,F(xiàn)ield Programmable Gate Array)是一種高密度可編程邏輯器件,其邏輯功能是通過(guò)把設(shè)計(jì)生成的數(shù)據(jù)文件配置進(jìn)芯片內(nèi)部的靜態(tài)配置數(shù)據(jù)存儲(chǔ)器(SRAM )來(lái)實(shí)現(xiàn)的,具有可重復(fù)編程性,可以靈活實(shí)現(xiàn)各
          • 關(guān)鍵字: 系統(tǒng)  配置  技術(shù)  嵌入式  II  實(shí)現(xiàn)  Nios  FPGA  

          基于DSP的FPGA配置方法研究與實(shí)現(xiàn)

          • 基于DSP的FPGA配置方法研究與實(shí)現(xiàn),摘要:在數(shù)字電路中,F(xiàn)PGA+DSP的系統(tǒng)結(jié)構(gòu)應(yīng)用日益廣泛。為了減小此種結(jié)構(gòu)的體積和降低成本,對(duì)FPGA采用了被動(dòng)并行的配置方式。上電后,DSP首先完成自身程序的加載,之后充當(dāng)配置FPGA的主處理器,從FLASH芯片中讀取FP
          • 關(guān)鍵字: 方法研究  實(shí)現(xiàn)  配置  FPGA  DSP  基于  
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          配置介紹

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