配置 文章 進入配置技術(shù)社區(qū)
可配置技術(shù)影響SoC（系統(tǒng)級芯片）的設計
- 傳統(tǒng)上，系統(tǒng)級芯片（SoC）設計師必須應對剛性的非可配置核心技術(shù)。眾所周知，傳統(tǒng)的核心工藝在設計或制造過程中是不可配置的，并且不能按多種用途進行定制。反過來，這些工藝產(chǎn)生了如下的迫切需要：將定制程序包括進處理器，配置多種應用，能進行軟件開發(fā)的綜合工具，簡化機器語言編程。 隨著可配置的核心處理器的出現(xiàn)，SoC設計有望發(fā)生重大變化來改變這些設計問題。影響SOC設計能力的主要益處有：降低開發(fā)成本，減少芯片的重新設計、進入各類垂直市場更快，性能的獨特性和設計的靈活性，同時不損害系統(tǒng)的特性和性能。此外，S
- 關(guān)鍵字： SoC 系統(tǒng)級芯片 設計 配置 H264
Xilinx FPGA開發(fā)環(huán)境的配置
- 一、配置Modelsim ISE的Xilinx的仿真庫 1、編譯仿真庫: A、先將Modelsim安裝目錄C=Modeltech_6.2b下面的modelsim.ini改成存檔格式(取消只讀模式); B、在DOS環(huán)境中，進入Xilinx的根目錄，然后依次進入bin，nt目錄; C、compxlib -s mti_se -f all -l all -o C:Modeltech_6.2bxilinx_libs。 注意:需要根據(jù)你安裝的modelsi
- 關(guān)鍵字： FPGA Xilinx 仿真 開發(fā)環(huán)境 配置
DSP系統(tǒng)的建模和配置
- 嵌入式軟件開發(fā)需要對目標架構(gòu)及其使用有廣泛透徹的認識和了解。把嵌入式系統(tǒng)從概念轉(zhuǎn)化為能夠有效地在硬件環(huán)境中部署的高效解決方案，需要一系列步驟。整個過程包括：分析、架構(gòu)搭建、評估、硬件支持、設計、編碼、調(diào)試、集成、驗證和確認。在這個過程中，如果硬件資源沒有得到有效利用，或是軟件沒有針對硬件資源進行優(yōu)化，都可能對性能造成嚴重影響。 CEVA-X系列DSP內(nèi)核中采用的創(chuàng)新架構(gòu)需要完全新穎的方案，以充分利用可能的設計變量來控制總體性能。CEVA-X1620是CEVA-X內(nèi)核系列的第一款產(chǎn)品，采用非常先進的并行
- 關(guān)鍵字： 嵌入式系統(tǒng) 單片機 DSP 建模 配置 MCU和嵌入式微處理器
基于ARM的FPGA加載配置實現(xiàn)
- 引言 基于SRAM工藝FPGA在每次上電后需要進行配置，通常情況下FPGA的配置文件由片外專用的EPROM來加載。這種傳統(tǒng)配置方式是在FPGA的功能相對穩(wěn)定的情況下采用的。在系統(tǒng)設計要求配置速度高、容量大、以及遠程升級時，這種方法就顯得很不實際也不方便。本文介紹了通過ＡＲＭ對可編程器件進行配置的的設計和實現(xiàn)。 1 配置原理與方式 1.1 配置原理 在FPGA正常工作時，配置數(shù)據(jù)存儲在SRAM單元中，這個SRAM單元也被稱為配置存儲（Configuration RAM）。由于SRAM是易失性的存
- 關(guān)鍵字： ARM FPGA 單片機 配置 嵌入式系統(tǒng)
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