arm+fpga 文章 進(jìn)入arm+fpga技術(shù)社區(qū)
H.264/AVC中CAVLC編碼器的硬件設(shè)計(jì)與實(shí)現(xiàn)
- 設(shè)計(jì)了一種H.264標(biāo)準(zhǔn)的CAVLC編碼器,對原有軟件流程進(jìn)行部分改進(jìn),提出了并行處理各編碼子模塊的算法結(jié)構(gòu)。
- 關(guān)鍵字: 變長編碼 非零系數(shù)級編碼 FPGA
FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之:典型實(shí)例-整數(shù)DCT變換的設(shè)計(jì)與實(shí)現(xiàn)
- 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)了視頻壓縮標(biāo)準(zhǔn)H.264算法中的整數(shù)DCT變換部分,幫助讀者了解并行流水設(shè)計(jì)技巧在算法優(yōu)化中的作用。
- 關(guān)鍵字: DSP 協(xié)同處理 FPGA 整數(shù)DCT變換 H.264
FPGA/CPLD狀態(tài)機(jī)穩(wěn)定性研究
- 在FPGA/CPLD設(shè)計(jì)中,狀態(tài)機(jī)是最典型、應(yīng)用最廣泛的時序電路模塊,如何設(shè)計(jì)一個穩(wěn)定可靠的狀態(tài)機(jī)是我們必須面對的問題.
- 關(guān)鍵字: 時序電路 狀態(tài)機(jī) FPGA
FPGA與DSP協(xié)同處理系統(tǒng)設(shè)計(jì)之:FPGA+DSP協(xié)同平臺的調(diào)試技巧和注意事項(xiàng)
- 作為雙芯片的協(xié)同系統(tǒng),調(diào)試的開始階段需要對每個芯片進(jìn)行單獨(dú)測試。這種情況下就需要避免另外一個芯片對調(diào)試產(chǎn)生影響,比較好的辦法就是讓它停止工作。
- 關(guān)鍵字: DSP 協(xié)同處理 FPGA 內(nèi)部邏輯分析儀 隔離調(diào)試
基于FPGA的帶Cache的嵌入式CPU的設(shè)計(jì)與實(shí)現(xiàn)
- MIPS(Microprocessor without Interlocked Pipeline STages)是一種典型的RISC(Reduced InstructiON Set Computer)微處理器,在嵌入式系統(tǒng)領(lǐng)域中得到廣泛的應(yīng)用。MIPS32TM指令集開放,指令格式規(guī)整,易于流水線設(shè)計(jì),大量使用寄存器操作。與CISC(Complex Instruction Set Computer)微處理器相比,RISC具有設(shè)計(jì)更簡單、設(shè)計(jì)周期更短等優(yōu)點(diǎn),并可以應(yīng)用更多先進(jìn)的技術(shù),開發(fā)更快的下一代處理器。
- 關(guān)鍵字: 流水線CPU 時序設(shè)計(jì) FPGA
利用FPGA實(shí)現(xiàn)外設(shè)通信接口之: 典型實(shí)例-字符LCD接口的設(shè)計(jì)與實(shí)現(xiàn)
- 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)FPGA與字符LCD的接口,幫助讀者進(jìn)一步了解字符液晶的工作原理和設(shè)計(jì)方法。
- 關(guān)鍵字: 字符LCD接口 char_ram模塊 FPGA ModelSim
利用FPGA夾層卡實(shí)現(xiàn)I/O設(shè)計(jì)靈活性
- 面對似乎層出不窮的新 I/O 標(biāo)準(zhǔn),目前嵌入式系統(tǒng)設(shè)計(jì)人員繼續(xù)依靠 FPGA 來部署系統(tǒng)日益重要的外部 I/O 接口.
- 關(guān)鍵字: IO標(biāo)準(zhǔn) 可配置 FPGA
利用FPGA實(shí)現(xiàn)外設(shè)通信接口之: 典型實(shí)例-USB 2.0接口的設(shè)計(jì)與實(shí)現(xiàn)
- 本節(jié)旨在設(shè)計(jì)實(shí)現(xiàn)了FPGA通過FX2 USB 2.0接口芯片與PC機(jī)進(jìn)行高速數(shù)據(jù)通信,分為讀數(shù)據(jù)、寫數(shù)據(jù)和讀寫數(shù)據(jù)3部分內(nèi)容。幫助讀者進(jìn)一步了解USB接口芯片的工作原理和設(shè)計(jì)方法。
- 關(guān)鍵字: USB2.0 FX2 FPGA 高速數(shù)據(jù)傳輸
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