asic ip核 文章 進入asic ip核技術(shù)社區(qū)
SoC設(shè)計：復雜性為驗證提出更高要求
- 由于片上系統(tǒng)(SoC)設(shè)計變得越來越復雜，驗證面臨著巨大的挑戰(zhàn)。大型團隊不斷利用更多資源來尋求最高效的方法，從而將新的方法學與驗證整合在一起，并最終將設(shè)計與驗證整合在一起。雖然我們知道實現(xiàn)驗證計劃幾乎占去了整個芯片設(shè)計工作的2/3，但是我們還是發(fā)現(xiàn)有團隊遲交芯片，錯過計劃的流片最終期限。這種疏忽可能造成嚴重的商業(yè)后果，因為這意味著硬件和軟件錯誤經(jīng)常被遺漏，直到設(shè)計周期的晚期。 為了創(chuàng)建一個全面的驗證解決方案，我們首先必須認識到設(shè)計工程師和驗證工程師所面臨的分歧和挑戰(zhàn)。在這個過程中，我們發(fā)現(xiàn)某些
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如何選擇適當?shù)木€性穩(wěn)壓器
- 線性穩(wěn)壓器通常被設(shè)計工程師作為輔助措施 ，并且經(jīng)常被選用于產(chǎn)品開發(fā)的后期階段。設(shè)計工程師比較關(guān)注的是如何使復雜的基頻(BB) 或射頻( RF )ASIC 發(fā)揮作用，而不是其所選線性穩(wěn)壓器的功率/性能。 線性穩(wěn)壓器的選擇依據(jù)通常性能列表中的主要規(guī)格，而不是位于數(shù)據(jù)表封面以內(nèi)的非常關(guān)鍵的核心和性能參數(shù)。規(guī)格經(jīng)常很容易令人誤解 — 封面上所列的規(guī)格只代表主要參數(shù)，但如果不與其他連接參數(shù)相結(jié)合時，便失去了價值。 例如，接地電流是這些參數(shù)中的一個。出現(xiàn)這
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IP核：中國芯片設(shè)計業(yè)的機遇
- 利用商業(yè)化IP來設(shè)計大規(guī)模的復雜系統(tǒng)是中國芯片設(shè)計業(yè)實現(xiàn)跨越式發(fā)展的一種機遇。 利用商業(yè)化IP(硅知識產(chǎn)權(quán))來設(shè)計大規(guī)模的復雜系統(tǒng)是中國芯片設(shè)計業(yè)實現(xiàn)跨越式發(fā)展的一種機遇。原因有四點。 第一，IP核交易成為IC設(shè)計企業(yè)加快產(chǎn)品研發(fā)進程、提升產(chǎn)品質(zhì)量的捷徑；第二，IP重用技術(shù)前景廣闊，受到IC設(shè)計企業(yè)的重視；第三，IP核已經(jīng)成為IC設(shè)計企業(yè)的一種重要的知識產(chǎn)權(quán)；第四，我國擁有眾多的代工廠，為推廣國家IP核標準和復用提供了資源保證。 我
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Nios SoC系統(tǒng)中的BCH編解碼IP核的設(shè)計
- 引 言 循環(huán)碼是最重要的一類線性分組糾錯碼，而BCH碼又是目前發(fā)現(xiàn)的性能很好且應用廣泛的循環(huán)碼，它具有嚴格的代數(shù)理論，對它的理論研究也非常透徹。BCH碼的實現(xiàn)途徑有軟件和硬件兩種。軟件實現(xiàn)方法靈活性強且較易實現(xiàn)，但硬件實現(xiàn)方法的工作速度快，在高數(shù)據(jù)速率和長幀應用場合時具有優(yōu)勢。FPGA(現(xiàn)場可編程門陣列)為DSP算法的硬件實現(xiàn)提供了很好的平臺，但如果單獨使用一片F(xiàn)PGA實現(xiàn)BCH編解碼，對成本、功耗和交互速度都不利。最新的SoC(片上系統(tǒng))設(shè)計方法可以很好地解決這個問題。
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如何成功地完成ASIC原型驗證
- 原型驗證---用軟件的方法來發(fā)現(xiàn)硬件的問題 在芯片tap-out之前，通常都會計算一下風險，例如存在一些的嚴重錯誤可能性。通常要某個人簽字來確認是否去生產(chǎn)。這是一個艱難的決定。ASIC的產(chǎn)品NRE的費用持續(xù)上升。一次失敗的ASIC流片將會推遲數(shù)個月的上市時間。誰愿意承擔簽字的責任呢? 一些BUG通過仿真和Emulation是抓不到的。傳統(tǒng)的驗證方法認為設(shè)計的功能符合功能定義就是對的。 但功能定義到底對不對呢？唯一的辦法就是建立一個真實的硬件：原型。 基于FPGA的原型 --- 一個虛擬
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“首個”無線傳感器網(wǎng)絡(luò)SoC問世
- Dust Networks公司在Electronica大會上發(fā)布了世上首個無線傳感器網(wǎng)絡(luò)系統(tǒng)級芯片(SoC)。Dust Networks在這張名為“智能塵埃”的芯片上集成了構(gòu)建分配式傳感器網(wǎng)絡(luò)所需的所有硬件和軟件功能，并表示它的功耗比Zigbee要低5倍，使系統(tǒng)不再需要路由器，而且使在現(xiàn)有網(wǎng)絡(luò)上添加新傳感器的總成本降低了10倍。 Dust Networks公司創(chuàng)始人之一，電氣工程師Rob Conant說：“我們的ASIC的功耗比使用802.15.4無線電
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Bluesocket借助Wind River Linux平臺加快產(chǎn)品上市速度
- 全球領(lǐng)先的設(shè)備軟件優(yōu)化（DSO）廠商風河系統(tǒng)公司日前宣布，Bluesocket通過采用Wind River Platform for Network Equipment, Linux Edition，顯著加快了產(chǎn)品上市速度，并且能夠更專注于其核心競爭力的提高。Wind River Platform for Network Equipment, Linux Editio
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瑞薩開發(fā)出具有45nm及以上工藝的微處理器和SoC器件
- 瑞薩科技布，開發(fā)出一種具有45 nm（納米）及以上工藝的微處理器和SoC（系統(tǒng)級芯片）器件、低成本制造能力的超高性能晶體管技術(shù)。新技術(shù)利用瑞薩開發(fā)的專有混合結(jié)構(gòu)（在2006年12月以前發(fā)布的一種先進技術(shù)）改善了CMIS（注1）晶體管的性能。瑞薩已經(jīng)在2007年6月12日于日本京都舉行的2007年超大規(guī)模集成電路技術(shù)專題研討會（2007 Symposium on VLSI Technology）上闡述了這一新的、增強的混合結(jié)構(gòu)，并演示了測試數(shù)據(jù)。 像以前的技
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視頻監(jiān)控的數(shù)字革命
- 視頻監(jiān)控的歷史可以追溯到上個世紀的60年代。1965年，美國有媒體建議政府在公共場所安裝監(jiān)控攝像頭，對犯罪進行預防和監(jiān)控，到1969年第一個警用攝像頭出現(xiàn)在紐約市政大廳的周邊高樓上。到今天，監(jiān)控攝像頭在全球任意一個大都市的公共場所都是隨處可見。 在這40年里，監(jiān)控系統(tǒng)經(jīng)歷了可錄像、CCD傳感器和數(shù)字多路技術(shù)三次革新，如今隨著數(shù)字技術(shù)的發(fā)展和網(wǎng)絡(luò)的普及，傳統(tǒng)的閉路電視（CCTV）和錄像系統(tǒng)的弊端日漸明顯，更加智能的IP數(shù)字視頻監(jiān)控成為大勢所趨。
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瑞薩推出用于汽車導航系統(tǒng)的高性能第三代SoC SH7775
- 瑞薩科技公司（Renesas Technology Corp.）宣布，推出適用于下一代汽車導航系統(tǒng)等高性能汽車信息系統(tǒng)的SoC解決方案SuperH™*1系列SH7775。樣品交付將于2007年7月從日本開始。 SH7775集成了SuperH系列的頂級SH-4A CPU內(nèi)核，具有1GIPS的（每秒十億條指令）以上的高處理性能。該器件是一款高性能SoC（系統(tǒng)級芯片）產(chǎn)品，集成了許多汽車導航系統(tǒng)所需的全面外設(shè)功能。其中包括專為地圖繪制優(yōu)化的新開發(fā)的圖形引擎、用于高水平繪圖處理的3D圖形引擎
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Synplicity宣布推出突破性ASIC驗證解決方案
- Synplicity 公司日前宣布推出其具有創(chuàng)新性的ASIC 與 ASSP 驗證解決方案Identify® Pro。采用 Synplicity 的TotalRecall™ 技術(shù)的Identify Pro軟件為基于 FPGA 的 ASIC 與 ASSP原型設(shè)計提供了完全可視化，從而使設(shè)計人員能以接近于最終設(shè)備的運行速度來查找、修改并驗證功能故障。Id
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Zarlink上市RF收發(fā)器SoC面向人體醫(yī)療器件
- 加拿大卓聯(lián)半導體(ZarlinkSemiconductorLimited)上市了面向植入人體的醫(yī)療器件的RF收發(fā)器SoC（系統(tǒng)芯片）“ZL70101”。主要用于心臟起搏器、心臟除顫器、藥泵和生理監(jiān)測儀。配備最高數(shù)據(jù)處理速度為800kbit/秒的MAC（MediaAccessController）。利用MICS（MedicalImplantCommunicationService）使用的402～405MHz頻帶工作。 新產(chǎn)品配備有“wake-up”信號接收器，將睡眠模式下的消耗電流控制
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基于VHDL語言的IP核驗證
- 引言 在IC(integrated circuit．集成電路)發(fā)展到超大規(guī)模階段的今天，基于IP(Intellectual Property，知識產(chǎn)權(quán))核的IC設(shè)計及其再利用是保證SoC(system onchip，片上系統(tǒng))開發(fā)效率和質(zhì)量的重要手段。如果能對IP核進行驗證、測試和集成．就可以加速SoC的設(shè)計，而這需要從以下5個方面進行考慮。 代碼純化．指在代碼設(shè)計中及完成后進行自定義的、IEEE標準的、設(shè)計重用的、可綜合性和可測試性等方面的規(guī)則檢查；
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基于IP核的FPGA設(shè)計方法
- 前 言 幾年前設(shè)計專用集成電路(ASIC) 還是少數(shù)集成電路設(shè)計工程師的事, 隨著硅的集成度不斷提高,百萬門的ASIC 已不難實現(xiàn), 系統(tǒng)制造公司的設(shè)計人員正越來越多地采用ASIC 技術(shù)集成系統(tǒng)級功能(System L evel In tegrete - SL I) , 或稱片上系統(tǒng)(System on a ch ip ) , 但ASIC 設(shè)計能力跟不上制造能力的矛盾也日益突出?，F(xiàn)在設(shè)計人員已不必全部用邏輯門去設(shè)計ASIC, 類似于用集成電路( IC) 芯片在印制板上的設(shè)計,ASIC 設(shè)計人員可以應用等
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asic ip核介紹
您好，目前還沒有人創(chuàng)建詞條asic ip核!
歡迎您創(chuàng)建該詞條，闡述對asic ip核的理解，并與今后在此搜索asic ip核的朋友們分享。 創(chuàng)建詞條
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