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IP承載網(wǎng)絡(luò)規(guī)劃設(shè)計(jì)探討
- 毋庸置疑，現(xiàn)代通信網(wǎng)絡(luò)的發(fā)展，是由業(yè)務(wù)需求和市場需求來決定的，而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)（IP網(wǎng)絡(luò)）的發(fā)展歷程，這其中市場推動(dòng)的痕跡非常明顯：這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò)技術(shù)，在九十年代
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基于Nios II步進(jìn)電機(jī)控制器IP核的設(shè)計(jì)與實(shí)現(xiàn)
- 摘要 根據(jù)Nios II處理器的Avalon總線規(guī)范，設(shè)計(jì)了一款面向步進(jìn)電機(jī)的控制器IP核。該定制IP核采用軟、硬件協(xié)同設(shè)計(jì)的方法，功能符合Avalon總線的讀寫傳輸時(shí)序，具有完備的步進(jìn)電機(jī)驅(qū)動(dòng)能力。仿真結(jié)果表明，該IP核具有
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三模冗余在ASIC設(shè)計(jì)中的實(shí)現(xiàn)方法
- 摘要：星載計(jì)算機(jī)系統(tǒng)處于空間輻照環(huán)境中，可能會(huì)受到單粒子翻轉(zhuǎn)的影響而出錯(cuò)，三模冗余就是一種對單粒子翻轉(zhuǎn)有效的容錯(cuò)技術(shù)。通過對三模冗余加固電路特點(diǎn)的分析，提出了在ASIC設(shè)計(jì)中實(shí)現(xiàn)三模冗余的2種方法。其一是通
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IP承載網(wǎng)絡(luò)規(guī)劃設(shè)計(jì)分析
- 毋庸置疑，現(xiàn)代通信網(wǎng)絡(luò)的發(fā)展，是由業(yè)務(wù)需求和市場需求來決定的，而不是技術(shù)的發(fā)展。我們回頭看看互聯(lián)網(wǎng)（IP網(wǎng)絡(luò)）的發(fā)展歷程，這其中市場推動(dòng)的痕跡非常明顯：這一種六七十年代就已經(jīng)誕生的IP網(wǎng)絡(luò)技術(shù)，在九十年代
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MCU&USB設(shè)備控制器IP核的設(shè)計(jì)
- MCUUSB設(shè)備控制器IP核的設(shè)計(jì),摘要：用硬件描述語言verilog HDL設(shè)計(jì)實(shí)現(xiàn)了一種MCUUSB設(shè)備控制器IP核。論文首先簡要介紹了設(shè)計(jì)的背景,重點(diǎn)對自主研發(fā)的將MCUUSB控制器集成于一個(gè)芯片的設(shè)計(jì)和研究分析。最后給出nc-verilog功能仿真方案以及FPGA驗(yàn)
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使用新SRAM工藝實(shí)現(xiàn)嵌入式ASIC和SoC的存儲(chǔ)器設(shè)計(jì)
- 使用新SRAM工藝實(shí)現(xiàn)嵌入式ASIC和SoC的存儲(chǔ)器設(shè)計(jì),基于傳統(tǒng)六晶體管(6T)存儲(chǔ)單元的靜態(tài)RAM存儲(chǔ)器塊一直是許多嵌入式設(shè)計(jì)中使用ASIC/SoC實(shí)現(xiàn)的開發(fā)人員所采用的利器，因?yàn)檫@種存儲(chǔ)器結(jié)構(gòu)非常適合主流的CMOS工藝流程，不需要增添任何額外的工藝步驟。如圖1a中所示的那樣
- 關(guān)鍵字： SoC 存儲(chǔ)器 設(shè)計(jì) ASIC 嵌入式 SRAM 工藝 實(shí)現(xiàn) 使用
彩色TFT液晶顯示控制電路設(shè)計(jì)/其ASIC實(shí)現(xiàn)
- 摘要：介紹了一種用于高級型數(shù)碼相機(jī)的彩色TFT液晶顯示控制電路的設(shè)計(jì)。文中首先簡單給出了控制電路的設(shè)計(jì)要求，然后重點(diǎn)介紹電路中各模塊的設(shè)計(jì)以及FPGA驗(yàn)證。整個(gè)電路作為數(shù)碼相機(jī)專用集成電路芯片的一部分采用TSM
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基于嵌入式Linux的TFT LCD IP及驅(qū)動(dòng)的設(shè)計(jì)
- 系統(tǒng)總體設(shè)計(jì)方案本系統(tǒng)的總體設(shè)計(jì)框圖如圖1所示。
圖1 系統(tǒng)框圖
Nios II處理器在SDRAM中開辟幀緩沖(Frame buffer)，可以是單緩沖也可以是雙緩沖。以單緩沖為例。處理器將一幀圖像數(shù)據(jù)(640times;480times;2Byt - 關(guān)鍵字： IP 驅(qū)動(dòng) 設(shè)計(jì) LCD TFT 嵌入式 Linux 基于
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