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FPGA技術(shù)在雷達(dá)信號模擬器中的應(yīng)用
- 摘要：基于FPGA的各種雷達(dá)信號產(chǎn)生方法,介紹了在FPGA中實(shí)現(xiàn)直接數(shù)字頻率合成器(DDS)以及提高輸出信號...
- 關(guān)鍵字： FPGA 雷達(dá)信號模擬器 QuartusⅡ
FPGA在彈上信息處理機(jī)中的應(yīng)用
- 引言 信息處理機(jī)(圖1)用于完成導(dǎo)彈上多路遙測信息的采集、處理、組包發(fā)送。主要功能包括高速1553B總線的數(shù)據(jù)收發(fā)、RS422接口設(shè)備的數(shù)據(jù)加載與檢測、多路數(shù)據(jù)融合和數(shù)據(jù)接收、處理、組包發(fā)送的功能。其中，總線數(shù)據(jù)和其他RS422接口送來的數(shù)據(jù)同時進(jìn)行并行處理;各路輸入信息按預(yù)定格式進(jìn)行融合與輸出;數(shù)據(jù)輸出速率以高速同步RS422口的幀同步脈沖為源，如果高速同步RS422口異常不影響總線數(shù)據(jù)和其它RS422口的數(shù)據(jù)融合與輸出功能。在CPU發(fā)生異?；蚩偩€數(shù)據(jù)異常時不影響其它RS422口數(shù)據(jù)的融合與輸
- 關(guān)鍵字： 軍事電子 FPGA
NEC Display Solutions 公司3D電影投影儀采用賽靈思 FPGA
- 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc. (NASDAQ:XLNX) )日前宣布NEC子公司NEC Display Solutions有限公司的三款DLP 數(shù)字影院投影儀產(chǎn)品， 均采用了賽靈思Virtex®-5 FPGA系列產(chǎn)品。 DLP 數(shù)字影院投影儀符合美國數(shù)字影院計(jì)劃 (DCI1) 標(biāo)準(zhǔn)，擁有一系列優(yōu)異的高安全特性，能夠滿足各種不同輸入信號的要求。該系統(tǒng)能忠實(shí)再現(xiàn)輸入源，而且集成的德州儀器 (TI) 高分辨率 2K(2,048 × 1,080 點(diǎn))DL
- 關(guān)鍵字： Xilinx Virtex FPGA DLP
每分鐘美化3600幅畫面的大師
- 在人手一支照相手機(jī)、數(shù)碼相機(jī)或者DV的年代，每個人都可以都在隨時隨地捕捉和制作畫面。在HDTV日漸盛行的年代，我們希望自己看到的每一幅畫面都絢麗多姿。不過，并非每個人都是攝影大師，我們許多人弄出來的畫面并不那么漂亮。過去，攝影大師都要借助于暗房技術(shù)來制作出精美的照片。如今，高水平的攝影愛好者都懂得使用Photoshop這類軟件來美化照片。現(xiàn)在的問題是，如果要對HDTV電視畫面進(jìn)行美化，有多少Photoshop大師也不夠用啊! 有一位大師，他不僅懂得怎樣讓一幅畫面變得更美，而且發(fā)明了一種可以植入芯
- 關(guān)鍵字： DarbeeVision FPGA IP GPU
滿足嵌入式系統(tǒng)應(yīng)用的多核處理器SoC設(shè)計(jì)
- 隨著嵌入式處理需求的快速增長，系統(tǒng)架構(gòu)正朝著多處理器設(shè)計(jì)的方向發(fā)展，以解決單處理器系統(tǒng)復(fù)雜度太高和計(jì)...
- 關(guān)鍵字： FPGA SoC 嵌入式系統(tǒng) 多核處理器 賽靈思 MicroBlaze
德州儀器推出新型 FPGA 擴(kuò)展板
- 日前，德州儀器 (TI) 宣布推出專用于 DK-LM3S9B96 開發(fā)套件的新型 Stellaris FPGA 擴(kuò)展板，可顯著加速開發(fā)低成本安全接入控制系統(tǒng)及其它需要高速外部處理單元接口的應(yīng)用。這款全新電路板使開發(fā)人員能夠輕松評估 Stellaris 微處理器 (MCU) 高靈活性外設(shè)接口 (EPI) 的高帶寬機(jī)器對機(jī)器 (M2M) 并行接口功能。EPI 的 M2M 模式可支持高達(dá) 32 位的數(shù)據(jù)寬度以及高達(dá)每秒 150 MB 的數(shù)據(jù)速率，專用于幫助低成本安全接入控制應(yīng)用的開發(fā)人員將攝像系統(tǒng)或低分辨率
- 關(guān)鍵字： TI FPGA 開發(fā)套件
DNLMS濾波器的FPGA實(shí)現(xiàn)
- 自適應(yīng)濾波器的研究是近年來研究的熱門方向，在PFGA中實(shí)現(xiàn)高速的自適應(yīng)濾波器的設(shè)計(jì)更是一個熱點(diǎn)，在此采用DSP Builder系統(tǒng)建模的方法，在FPGA中實(shí)現(xiàn)了歸一化LMS算法，實(shí)驗(yàn)結(jié)果表明：用DSPBuilder設(shè)計(jì)的8階DNLMS算法比用底層的VHDL代碼設(shè)計(jì)效率更高，靈活性更大，速度更快。同樣比通用的DSP芯片設(shè)計(jì)的8階NLMS濾波器處理速度快了20多倍。如果將8階NLMS濾波器擴(kuò)展到512階或者1 024階，可以很好地應(yīng)用于自適應(yīng)回聲消除等很多自適應(yīng)濾波的領(lǐng)域。
- 關(guān)鍵字： 實(shí)現(xiàn) FPGA 濾波器 DNLMS
一種基于FPGA的新型數(shù)字電壓表研究與設(shè)計(jì)
- 數(shù)字電壓表是大學(xué)物理教學(xué)和實(shí)驗(yàn)中的重要儀表，其數(shù)字化是指將連續(xù)的模擬電壓量轉(zhuǎn)換成不連續(xù)、離散的數(shù)字...
- 關(guān)鍵字： FPGA 數(shù)字電壓表 A/D
基于FPGA的多路正弦波信號發(fā)生器專用芯片設(shè)計(jì)
- 基于開源思想與SOPC技術(shù)，采用32位開源軟核處理器OR1200和開源軟核DDS，在FPGA上實(shí)現(xiàn)了頻率、相位可預(yù)置并且可調(diào)的3路正弦波信號發(fā)生器專用芯片的設(shè)計(jì)。該專用芯片基于OR1200固化專用程序?qū)崿F(xiàn)，通過UART傳輸控制數(shù)據(jù)，可同時控制3路正弦波的產(chǎn)生，其頻率范圍為1 Hz~100 MHz，步進(jìn)頻率為1 Hz，相位范圍為0°~359°。設(shè)計(jì)方案在DE2-70開發(fā)板上進(jìn)行了實(shí)際驗(yàn)證，證明了設(shè)計(jì)的正確性和可行性。
- 關(guān)鍵字： FPGA 多路 正弦波信號 發(fā)生器
基于CPLD的IEEE1149.1 USB下載電纜設(shè)計(jì)
- 引言隨著片上系統(tǒng)(SoC，SystemonChip)時代的到來，包括復(fù)雜可編程邏輯器件(CPLD，ComplexProgrammab...
- 關(guān)鍵字： FPGA CPLD USB下載電纜 IEEE1149.1
賽靈思ISE 12設(shè)計(jì)套件用智能時鐘門控技術(shù)降低動態(tài)功耗30%
- 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司(Xilinx, Inc.)日前推出 ISE 12軟件設(shè)計(jì)套件，實(shí)現(xiàn)了具有更高設(shè)計(jì)生產(chǎn)力的功耗和成本的突破性優(yōu)化。ISE 設(shè)計(jì)套件首次利用“智能”時鐘門控技術(shù)，將動態(tài)功耗降低多達(dá) 30%。此外，該新型套件還提供了基于時序的高級設(shè)計(jì)保存功能、為即插即用設(shè)計(jì)提供符合 AMBA 4 AXI4 規(guī)范的IP支持，同時具備第四代部分重配置功能的直觀設(shè)計(jì)流程，可降低多種高性能應(yīng)用的系統(tǒng)成本。 在為所有 Xilinx Virtex-6 和 Spartan-
- 關(guān)鍵字： Xilinx FPGA 軟件設(shè)計(jì)套件
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