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          便攜式產(chǎn)品具有低功耗意識的FPGA設(shè)計方法

          • ILGOO系列低功耗FPGA產(chǎn)品Actel公司的ILGOO系列器件是低功耗FPGA產(chǎn)品,是在便攜式產(chǎn)品設(shè)計中替代ASIC...
          • 關(guān)鍵字: 便攜式產(chǎn)品  CPLD  低功耗  FPGA  ILGOO  

          基于CPCI總線的通用FPGA信號處理板的設(shè)計

          • 隨著雷達信號處理技術(shù)的不斷發(fā)展以及現(xiàn)代國防對雷達技術(shù)的需求,系統(tǒng)對雷達信號處理的要求也越來越高,需要實時處理更加龐大的數(shù)據(jù)。先進的雷達信號處理設(shè)備不僅要求性能高、功能多樣化,而且要求信號處理設(shè)備
          • 關(guān)鍵字: CPCI  FPGA  總線  信號處理板    

          Actel子公司為xTCA產(chǎn)品實現(xiàn)兼容性和互用性

          •   愛特公司 (Actel Corporation) 獨資的子公司Pigeon Point Systems宣布,延續(xù)其xTCA?板級及模塊管理控制器產(chǎn)品的兼容性和互用性舉措。在2009 ATCA Summit會議上,Pigeon Point Systems使用Polaris Networks公司的ATCA測試器,現(xiàn)場對基于Actel Fusion? 混合信號FPGA和Renesas H8S微控制器的最新Pigeon Point管理解決方案xTCA SlotFest進行形式測試(form
          • 關(guān)鍵字: Actel  FPGA  管理組件  xTCA  

          基于FPGA二次群分接器的實現(xiàn)

          • 1.引言
            為了提高傳輸速率,擴大通信容量,減少信道數(shù)量,通常把多路信號復(fù)用成一路信號進行傳輸。在多種復(fù)用方式中,時分復(fù)用是一種常用的方式。時分復(fù)用是多路信號按照時間間隔共享一路信道進行傳輸。復(fù)接是
          • 關(guān)鍵字: 實現(xiàn)  FPGA  基于  FPGA  

          模塊化FPGA設(shè)計在某雷達接收機中的應(yīng)用

          • 0 引言
            目前基于FPGA和DSP結(jié)構(gòu)的軟件無線電技術(shù)被廣泛應(yīng)用在數(shù)字接收機設(shè)計中,雷達接收機領(lǐng)域的數(shù)字化技術(shù)也在日趨發(fā)展,如何借助數(shù)字化的軟硬件優(yōu)勢設(shè)計出易實現(xiàn)、靈活,并滿足不同性能指標和目的的數(shù)字接收
          • 關(guān)鍵字: FPGA  模塊化  雷達接收機  中的應(yīng)用    

          使用NI LabVIEW FPGA 與智能 DAQ的自動高電壓電擊

          • Author(s):
            David Hakey - Medtronic, Inc.
            Patrick J. Ryan - Medtronic, Inc.
            Johnny Maynes - Medtronic, Inc. Industry:
            Electronics, Biotechnology Products:
            NI-VISA, LabVIEW, FPGA Module, PXI-7811R
          • 關(guān)鍵字: LabVIEW  FPGA  DAQ  自動    

          基于FPGA的軟件無線電平臺設(shè)計 

          • 軟件無線電的出現(xiàn),是無線電通信從模擬到數(shù)字、從固定到移動后,由硬件到軟件的第三次變革。簡單地說,軟件無...
          • 關(guān)鍵字: FPGA  軟件無線電平臺  

          基于FPGA的QPSK及OQPSK信號調(diào)制解調(diào)電路

          • 0引言調(diào)制識別技術(shù)在軍事、民用領(lǐng)域都有十分廣泛的應(yīng)用價值,近年來一直受到人們的關(guān)注。隨著更多...
          • 關(guān)鍵字: FPGA  QPSK  OQPSK  調(diào)制  解調(diào)  

          以FPGA為橋梁的FIFO設(shè)計方案及其應(yīng)用

          • 引言在利用DSP實現(xiàn)視頻實時跟蹤時,需要進行大量高速的圖像采集。而DSP本身自帶的FIFO并不足以支持...
          • 關(guān)鍵字: FPGA  FIFO  SDRAM  DSP  

          基于CPLD/FPGA的多功能分頻器的設(shè)計與實現(xiàn)

          • 引言 分頻器在CPLD/FPGA設(shè)計中使用頻率比較高,盡管目前大部分設(shè)計中采用芯片廠家集成的鎖相環(huán)資源 ,但是對于要求奇數(shù)倍分頻(如3、5等)、小數(shù)倍(如2.5、3.5等)分頻、占空比50%的應(yīng)用場合卻往往不能滿足要求。
          • 關(guān)鍵字: CPLD  FPGA  多功能  分頻器    

          基于DSP和FPGA的調(diào)幅廣播信號監(jiān)測系統(tǒng)

          • 基于DSP和FPGA的調(diào)幅廣播信號監(jiān)測系統(tǒng), 引言  隨著通信與廣播電視業(yè)務(wù)的發(fā)展,無線電頻譜迅速、大量的被占用,頻道擁擠和相互間干擾日趨嚴重,為了能有效地利用無線電頻譜,減少相互間的干擾,信號監(jiān)測業(yè)務(wù)隨之成為必要。調(diào)幅廣播信號監(jiān)測系統(tǒng)是用于實
          • 關(guān)鍵字: 信號  監(jiān)測  系統(tǒng)  廣播  調(diào)幅  DSP  FPGA  基于  DSP  FPGA  

          Altera 推出業(yè)界首款串行 RapidIO 2.1 IP 解決方案

          •   Altera 公司 (NASDAQ: ALTR) 今天宣布推出業(yè)界首款支持 RapidIO® 2.1 規(guī)范的知識產(chǎn)權(quán) (IP) 內(nèi)核。Altera 的串行 RapidIO IP 內(nèi)核可支持多達四條通道,每條通道速率為 5.0 GBaud,從而滿足了無線市場日益增長的帶寬和可靠性需求。該 IP 內(nèi)核專門針對擁有多個嵌入式收發(fā)器的 Stratix® IV FPGA 而優(yōu)化,并得到了Quartus® II 軟件 v9.1 的支持。   RapidIO 2.1 規(guī)范在許多應(yīng)用中均可實
          • 關(guān)鍵字: Altera  RapidIO  FPGA  Quartus  

          擴大嵌入式領(lǐng)域勢力范圍 FPGA廠商積極備戰(zhàn)

          •   隨著經(jīng)濟情勢與市場環(huán)境的改變,歷經(jīng)長足發(fā)展的可編程邏輯組件(PLD)正憑借著成熟的技術(shù)將觸角深入量產(chǎn)型的消費及嵌入式市場,并以更加經(jīng)濟的開發(fā)成本持續(xù)搶占傳統(tǒng)ASIC/ASSP市場.   "ASIC/ASSP的商業(yè)模式愈來愈難以為繼,"愛特(Actel)公司應(yīng)用工程師陳冠志指出.巨額的芯片制造成本是首先面臨的關(guān)卡."300mm晶圓廠的成本以驚人的速度增長,在45nm節(jié)點約需30億美元;而到了32nm節(jié)點,估計會達到100億美元."另一方面,全球市場的動蕩情況,也
          • 關(guān)鍵字: Altera  FPGA  40nm  

          Xilinx推出EasyPath-6 FPGA

          •   全球可編程邏輯解決方案領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. )日前宣布隆重推出EasyPath?-6 FPGA,該產(chǎn)品為高性能 FPGA 進入量產(chǎn)器件提供了六周內(nèi)即可實現(xiàn)的總成本最低、風險最小的的解決方案, 在所有FPGA降低成本解決方案中轉(zhuǎn)入量產(chǎn)時間最快。新款 EasyPath FPGA 無最低訂購量限制,讓客戶可根據(jù)最終市場需求下訂單,且成本較購買等量的 FPGA 低 35%。   此外,雖然大多數(shù)成本降低的方案會讓設(shè)計選項受到限制,迫使客戶接受未經(jīng)優(yōu)化的部件或封裝, 然而
          • 關(guān)鍵字: Xilinx  FPGA  EasyPath  

          基于FPGA的人工神經(jīng)網(wǎng)絡(luò)實現(xiàn)方法的研究

          • 基于FPGA的神經(jīng)網(wǎng)絡(luò)實現(xiàn)方法已成為實際實時應(yīng)用神經(jīng)網(wǎng)絡(luò)的一種途徑。本文就十多年來基于FPGA的ANN實現(xiàn)作一個系統(tǒng)的總結(jié),例舉關(guān)鍵的技術(shù)問題,給出詳細的數(shù)據(jù)分析,引用相關(guān)的最新研究成果,對不同的實現(xiàn)方法和思想進行討論分析,并說明存在的問題以及改善方法,強調(diào)神經(jīng)網(wǎng)絡(luò)FPGA實現(xiàn)的發(fā)展方向和潛力及提出自己的想法。另外,還指出基于FPGA實現(xiàn)神經(jīng)網(wǎng)絡(luò)存在的瓶頸制約,最后對今后的研究趨勢作出估計。
          • 關(guān)鍵字: FPGA  人工神經(jīng)網(wǎng)絡(luò)  實現(xiàn)方法    
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