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          EEPW首頁 >> 主題列表 >> cpld/fpga

          基于SRAM工藝FPGA的保密性問題

          • 在現(xiàn)代電子系統(tǒng)設(shè)計(jì)中,由于可編程邏輯器件的卓越性能、靈活方便的可升級(jí)特性,而得到了廣泛的應(yīng)用。由于大規(guī)模高密度可編程邏輯器件多采用SRAM工藝,要求每次上電,對(duì)FPGA器件進(jìn)行重配置,這就使得可以通過監(jiān)視配置
          • 關(guān)鍵字: 保密性  問題  FPGA  工藝  SRAM  基于  

          基于FPGA的快速9/7整形離散小波變換系統(tǒng)

          • 美國空間數(shù)據(jù)系統(tǒng)咨詢委員會(huì)(簡(jiǎn)稱CCSDS)于2005年推出一套適用于空間領(lǐng)域的圖像壓縮標(biāo)準(zhǔn),標(biāo)準(zhǔn)使用了離散...
          • 關(guān)鍵字: 小波變換  FPGA  CCSDS圖像壓縮  

          軟件無線電設(shè)計(jì)中ASIC、FPGA和DSP的選擇

          • ASIC、FPGA和DSP的應(yīng)用領(lǐng)域呈現(xiàn)相互覆蓋的趨勢(shì),使設(shè)計(jì)人員必須在軟件無線電結(jié)構(gòu)設(shè)計(jì)中重新考慮器件選擇...
          • 關(guān)鍵字: FPGA  ASIC  DSP  軟件無線電  

          Modbus通信協(xié)議的FPGA實(shí)現(xiàn)

          • Modbus協(xié)議是一個(gè)應(yīng)用廣泛的工業(yè)現(xiàn)場(chǎng)總線協(xié)議,鑒于其簡(jiǎn)單、開放、幀格式緊湊等優(yōu)點(diǎn),于2008年正式成為我國國家標(biāo)準(zhǔn)。介紹一種通過Cyclone系列FPGA實(shí)現(xiàn)Modbus RTU模式的方法,首先給出一個(gè)可以通用于Modbus主設(shè)備和從設(shè)備的協(xié)議接口單元,然后基于該接口設(shè)計(jì)了一個(gè)通用的Modbus從設(shè)備協(xié)處理器。實(shí)踐證明該方法能夠滿足工業(yè)環(huán)境的通訊要求,此外,該方法在其他FPGA上也具有一定通用性和推廣價(jià)值。
          • 關(guān)鍵字: 實(shí)現(xiàn)  FPGA  協(xié)議  通信  Modbus  功率模塊  

          Altera Stratix V FPGA提供RLDRAM 3存儲(chǔ)器支持

          •   Altera公司今天發(fā)布Stratix® V系列FPGA,適用于支持Micron技術(shù)公司的下一代低延時(shí)DRAM (RLDRAM® 3存儲(chǔ)器)。Stratix V FPGA采用新的存儲(chǔ)器體系結(jié)構(gòu),降低延時(shí),高效實(shí)現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡(luò)設(shè)備生產(chǎn)商提供存儲(chǔ)器接口解決方案,支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。   Micron公司業(yè)務(wù)開發(fā)高級(jí)經(jīng)理Bruce Franklin表示:“Micron的下一代RLDRAM 3存儲(chǔ)器專門設(shè)
          • 關(guān)鍵字: Altera  FPGA  Stratix  

          基于 CPLD EPM570T100C5的通用直流調(diào)速模塊設(shè)計(jì)

          • 基于 CPLD EPM570T100C5的通用直流調(diào)速模塊設(shè)計(jì),本文針對(duì)常見調(diào)速應(yīng)用,采用可控硅做為調(diào)速元件,采用EPM570T100C5設(shè)計(jì)和實(shí)現(xiàn)了一個(gè)通用直流調(diào)速模塊,為實(shí)現(xiàn)遠(yuǎn)距離控制內(nèi)置了RS 485通信和簡(jiǎn)單通信協(xié)議。采用EPM570T100C5作為控制核心,電路簡(jiǎn)潔,輸出控制脈沖精確
          • 關(guān)鍵字: 調(diào)速  模塊  設(shè)計(jì)  直流  通用  CPLD  EPM570T100C5  基于  

          基于CPLD器件設(shè)計(jì)的單穩(wěn)態(tài)電路

          • 基于CPLD器件設(shè)計(jì)的單穩(wěn)態(tài)電路,隨著電子技術(shù)特別是數(shù)字集成電路技術(shù)的迅猛發(fā)展,市面上出現(xiàn)了FPGA、CPLD等大規(guī)模數(shù)字集成電路,并且其工作速度和產(chǎn)品質(zhì)量不斷提高。利用大規(guī)模數(shù)字集成電路實(shí)現(xiàn)常規(guī)的單穩(wěn)態(tài)集成電路所實(shí)現(xiàn)的功能,容易滿足寬度、精
          • 關(guān)鍵字: 穩(wěn)態(tài)  電路  設(shè)計(jì)  器件  CPLD  基于  

          基于CPLD的水下沖擊波記錄儀的設(shè)計(jì)

          • 基于CPLD的水下沖擊波記錄儀的設(shè)計(jì),1.引言
              
            隨著大規(guī)模集成電路和單片機(jī)的迅速發(fā)展,復(fù)雜可編程邏輯器件(CPLD)具有使用靈活、可靠性高、功能強(qiáng)大的優(yōu)點(diǎn),在電子產(chǎn)品設(shè)計(jì)中得到了廣泛的應(yīng)用。CPLD可實(shí)現(xiàn)在系統(tǒng)編程,重復(fù)多次,而且還兼容IEEE1
          • 關(guān)鍵字: 記錄儀  設(shè)計(jì)  沖擊波  水下  CPLD  基于  

          節(jié)省電池能量的系統(tǒng)斷電電路CPLD

          • 節(jié)省電池能量的系統(tǒng)斷電電路CPLD,今天,大多數(shù)的CPLD(復(fù)雜可編程邏輯器件)都采用可減少功耗的工作模式,但當(dāng)系統(tǒng)未使用時(shí),應(yīng)完全切斷電源以保存電池能量,從而實(shí)現(xiàn)很多設(shè)計(jì)者的終極節(jié)能目標(biāo)。圖1描述了如何在一片CPLD 上增加幾只分立元件,實(shí)現(xiàn)一
          • 關(guān)鍵字: 電路  CPLD  斷電  系統(tǒng)  電池  能量  節(jié)省  

          基于CPLD的專用鍵盤接口芯片的方案設(shè)計(jì)

          • 基于CPLD的專用鍵盤接口芯片的方案設(shè)計(jì),在單片機(jī)應(yīng)用系統(tǒng)中,存在多種形式的外部數(shù)據(jù)輸入接口界面,例如RS-232C串行通信、鍵盤輸入等[1,4] 。其中利用鍵盤接口輸入數(shù)據(jù),是實(shí)現(xiàn)現(xiàn)場(chǎng)實(shí)時(shí)調(diào)試、數(shù)據(jù)調(diào)整和控制最常用的方法。單片機(jī)的外圍鍵盤擴(kuò)展電路有多種實(shí)
          • 關(guān)鍵字: 芯片  方案設(shè)計(jì)  接口  鍵盤  CPLD  專用  基于  

          ARM920T基于Linux平臺(tái)下的FPGA驅(qū)動(dòng)開發(fā)

          • ARM920T基于Linux平臺(tái)下的FPGA驅(qū)動(dòng)開發(fā),Linux操作系統(tǒng)的全稱是GNU/Linux,它是由GNU工程和Linux內(nèi)核兩個(gè)部分共同組成的一個(gè)操作系統(tǒng)。該系統(tǒng)中所有組件的源代碼都是自由的,可以有效保護(hù)學(xué)習(xí)成果,因而在嵌入式領(lǐng)域得到了廣泛的應(yīng)用。

            FPGA是英文Field
          • 關(guān)鍵字: 驅(qū)動(dòng)  開發(fā)  FPGA  平臺(tái)  基于  Linux  ARM920T  

          基于FPGA的線性卷積的實(shí)時(shí)實(shí)現(xiàn)

          • 摘要:從實(shí)際工程應(yīng)用出發(fā),研究了在基于FPGA上快速傅里葉變換實(shí)現(xiàn)線性卷積的方法,并搭建了一個(gè)基于Altera的EP2S60硬件處理平臺(tái),利用Altera提供的FFT IP核,在100 MHz系統(tǒng)時(shí)鐘下,數(shù)據(jù)吞吐率可達(dá)100 Ms/s,
            關(guān)鍵
          • 關(guān)鍵字: FPGA  線性卷積    

          基于FPGA的快速9/7整形離散小波變換系統(tǒng)設(shè)計(jì)

          • 摘要:CCSDS圖像數(shù)據(jù)壓縮標(biāo)準(zhǔn)中采用9/7整形離散小波變換為核心算法,該算法結(jié)構(gòu)簡(jiǎn)單,易于硬件設(shè)計(jì)實(shí)現(xiàn)。文中基于FPGA設(shè)計(jì)實(shí)現(xiàn)了9/7整數(shù)離散小波變換系統(tǒng),設(shè)計(jì)中使用內(nèi)部RAM存儲(chǔ)方式,減小了對(duì)存儲(chǔ)器的需求量,同
          • 關(guān)鍵字: FPGA  離散小  波變換  系統(tǒng)設(shè)計(jì)    

          如何選用軟件無線電結(jié)構(gòu)設(shè)計(jì)器件

          • 電子產(chǎn)品世界,為電子工程師提供全面的電子產(chǎn)品信息和行業(yè)解決方案,是電子工程師的技術(shù)中心和交流中心,是電子產(chǎn)品的市場(chǎng)中心,EEPW 20年的品牌歷史,是電子工程師的網(wǎng)絡(luò)家園
          • 關(guān)鍵字: 軟件無線電  ASIC  FPGA  

          Altera公布第二季度業(yè)績(jī),季度股利增長(zhǎng)

          •   Altera公司今天宣布,第二季度銷售達(dá)到4.693億美元,比2010年第一季度增長(zhǎng)17%,比2009年第二季度增長(zhǎng)68%。新產(chǎn)品銷售持續(xù)增長(zhǎng)36%。2010年第二季度凈收入為1.806億美元,每股攤薄后收益0.58美元,與之相比,2010年第一季度凈收入為1.532億美元,每股攤薄后收益0.50美元,2009年第二季度凈收入達(dá)到0.474億美元,每股攤薄后收益為0.16美元。   本年度到目前為止,運(yùn)營現(xiàn)金流為3.786億美元。Altera本季度末流動(dòng)資金和短期投入達(dá)到21億美元。   Alte
          • 關(guān)鍵字: Altera  28nm  FPGA  
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