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cpld／fpga 文章進入cpld／fpga技術社區(qū)

基于CPLD和ISA總線的數(shù)據(jù)采集系統(tǒng)設計

摘要：介紹一種基于復雜可編程邏輯器件(CPLD)的數(shù)據(jù)采集系統(tǒng)，并給出詳細的設計方案。計算機通過ISA總線實現(xiàn)與數(shù)據(jù)采集系統(tǒng)的指令和數(shù)據(jù)傳輸。通過VHDL編程實現(xiàn)CPLD對12位串行模數(shù)轉換器ADS7816的控制。最后，給出該
關鍵字： CPLD ISA 總線數(shù)據(jù)采集

CPLD在臭氧電源中的應用

摘要：利用壓控振蕩器CD4046和可編程邏輯器件EPM7128構成控制系統(tǒng)，通過調節(jié)逆變輸出脈沖的占空比和頻率，實現(xiàn)臭氧電源輸出電壓和頻率的調節(jié)，從而達到對臭氧電源輸出功率的調節(jié)。調試結果表明該系統(tǒng)滿足實時性和功耗
關鍵字： CPLD 臭氧電源中的應用

FPGA和ARM的Profibus-DP主站通信平臺設計

摘要：提出一個使用FPGA和ARM微控制器實現(xiàn)Profibus-DP主站(1類)通信平臺的解決方案；解析了Profibus-DP通信協(xié)議，重點是令牌輪轉協(xié)議；給出了該主站通信平臺的系統(tǒng)構建。該通信平臺可以獨立實現(xiàn)Profibus-DP主站(1類)
關鍵字： Profibus-DP FPGA ARM 通信

基于FPGA的偽隨機序列發(fā)生器設計

摘要：討論了應用移位寄存器在Ahera的FPGA芯片中實現(xiàn)線性和非線性偽隨機序列的方法，該算法基于m序列本原多項式來獲得線性m序列和非線性m子序列移位寄存器的反饋邏輯式。文中給出了以Altera的QuartusⅡ為開發(fā)平臺，并
關鍵字： FPGA 偽隨機序列發(fā)生器

FPGA芯片在高速數(shù)據(jù)采集緩存系統(tǒng)中的應用

摘要：給出了以FPGA為核心邏輯控制模塊的高性能數(shù)據(jù)采集系統(tǒng)的設計方法，并在QuartusII8．0集成環(huán)境中進行軟件設計和系統(tǒng)仿真，最后給出了新型緩存系統(tǒng)中主要功能模塊的仿真圖形。
關鍵詞：FPGA；高速；數(shù)據(jù)采集；緩
關鍵字： FPGA 芯片高速數(shù)據(jù) 采集

TMS320F2812與CPLD的視頻采集系統(tǒng)接口設計

摘要：介紹基于TMS320F2812和CPLD的數(shù)字視頻采集系統(tǒng)的接口設計。該系統(tǒng)采用同步分離電路、TMS320F2812、EPM7128、TMS320C6416、IDE硬盤存儲器以及顯示器接口等芯片，利用TMs320F2812中的ADC采樣速度和轉換精度高的優(yōu)
關鍵字：接口設計系統(tǒng) 采集 CPLD 視頻 TMS320F2812

基于Simulink的數(shù)據(jù)鏈系統(tǒng)仿真及性能分析

未來戰(zhàn)場必是網(wǎng)絡中心戰(zhàn)格局下的系統(tǒng)一體化作戰(zhàn)，用于制導的武器數(shù)據(jù)鏈是其中重要一環(huán)。通常武器數(shù)據(jù)鏈用...
關鍵字： Simulink 數(shù)據(jù)鏈系統(tǒng) 仿真 FPGA

基于FPGA+DSP的雷達回波發(fā)生器設計

雷達回波發(fā)生器利用現(xiàn)代仿真技術生成蘊含雷達目標和環(huán)境信息的模擬雷達信號，用來對雷達系統(tǒng)進行性能測試和評估。根據(jù)通用性、靈活性要求，提出了一種基于DSP+FPGA的雷達回波發(fā)生器的設計方法；簡要介紹了設計思想，詳細闡述了系統(tǒng)的硬件組成和軟件設計，并給出了測試結果并總結了該雷達回波發(fā)生器的一些優(yōu)點。
關鍵字： FPGA DSP 雷達回波發(fā)生器

ISPl362在基于FPGA的紅外成像系統(tǒng)中的應用

摘要：ISPl362是飛利浦推出的一款USB可編程控制芯片，其內部集成了一個高級主控制器，一個外設控制器，主機和設備控制器兼容USB 2．O協(xié)議，支持12 Mb／s的全速傳輸和1．5 Mb／s的低速傳輸；芯片有三種工作模式，即主
關鍵字： ISPl FPGA 362 紅外成像系統(tǒng)

一種基于FPGA的可編程電壓源系統(tǒng)設計

0引言可編程電源指某些功能或參數(shù)可以通過計算機軟件編程進行控制的電源?？删幊屉娫吹膶崿F(xiàn)方法...
關鍵字： FPGA 可編程電壓源設計 Cyclone

Altera量產(chǎn)發(fā)售低成本低功耗Cyclone IV FPGA

　　Altera公司今天宣布，開始批量發(fā)售Cyclone® IV FPGA。公司還宣布開始提供基于Cyclone IV GX的收發(fā)器入門開發(fā)套件。Altera的Cyclone IV FPGA設計用于無線、固網(wǎng)、廣播、工業(yè)和消費類市場等低成本、小型封裝應用。與前一代Cyclone產(chǎn)品相比，這些器件前所未有的同時實現(xiàn)了低成本和高性能，功耗降低25%，滿足了大批量低成本串行協(xié)議解決方案的需求。　　Altera器件市場資深總監(jiān)Luanne Schirrmeister評論說：“我們比競爭產(chǎn)品
關鍵字： Altera FPGA Cyclone 開發(fā)套件

基于FPGA的TDI-CCD時序電路設計

摘要：介紹TDI-CCD的特點、工作原理，根據(jù)項目所使用的TDI-CCD的使用要求，設計一種基于Altera公司的現(xiàn)場可編程門陣列(FPGA)EP3C-25Q240的TDI-CCD驅動時序電路，驅動時序使用VHDL語言編寫，在QuartusⅡ平臺上進行時序
關鍵字： TDI-CCD FPGA 時序電路設計

基于FPGA快速A 律壓縮編碼的設計與實現(xiàn)

摘要:本文針對A律13折線法的算法特點，提出一種并行數(shù)據(jù)處理算法，實現(xiàn)了編碼的流水線操作。運用VHDL語言將其在FPGA中實現(xiàn)，借助quartus II6.0平臺進行驗證，并對驗證結果進行分析，評估了系統(tǒng)的性能，證實了該算法的
關鍵字： FPGA 壓縮編碼

基于PC104總線和CPLD的測頻模件設計

摘要：根據(jù)某測試系統(tǒng)的需要，設計基于PCl04總線和CPLD的高精度測頻模件，采用多周期同步測頻法實現(xiàn)對所測頻段的等精度測量。設計了該測頻模件的硬件電路，并給出用CPLD實現(xiàn)數(shù)字頻率計的詳細VHDL源代碼。采用原理圖的
關鍵字： CPLD 104 PC 總線

基于ARM和FPGA的微加速度計數(shù)據(jù)采集系統(tǒng)設計

摘要：基于常用的MEMS慣性器件微型加速度計，介紹一種采用ARM和FPGA架構來采集加速度數(shù)值的設計方案，微加速度計的模擬輸出信號經(jīng)A／D芯片轉換后由FPGA進行處理和緩存，然后ARM接收FPGA的輸出數(shù)據(jù)并對數(shù)據(jù)進行顯示和
關鍵字： FPGA ARM 微加速度計數(shù)據(jù)采集

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利用FPGA資源和最小模擬電路發(fā)電進行開關電源設計的方法
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