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基于CPLD/FPGA的VHDL語(yǔ)言電路優(yōu)化設(shè)計(jì)

VHDL(VeryHighSpeedIntegratedCircuitHardwareDescriptionLanguage)是IEEE工業(yè)標(biāo)準(zhǔn)硬件描述語(yǔ)言...
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Altera榮膺邁瑞公司“優(yōu)秀供應(yīng)商獎(jiǎng)”

　　Altera公司今天宣布，公司榮獲深圳邁瑞生物醫(yī)療電子股份有限公司 2009年度“優(yōu)秀供應(yīng)商獎(jiǎng)”，這是過去四年中Altera第三次獲得這一獎(jiǎng)項(xiàng)，這是對(duì)Altera為邁瑞持續(xù)優(yōu)異地提供業(yè)界一流的技術(shù)、服務(wù)和支持的認(rèn)可。　　邁瑞公司供應(yīng)鏈副總裁曾映表示：“Altera與我們有著長(zhǎng)期的合作關(guān)系，他們提供領(lǐng)先的技術(shù)以及專業(yè)的服務(wù)和支持，幫助邁瑞不斷創(chuàng)新并贏得市場(chǎng)。我們非常高興授予他們優(yōu)秀供應(yīng)商獎(jiǎng)。” 　　Altera亞太地區(qū)副總裁兼董事總經(jīng)理Erhaan
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基于DSP+FPGA架構(gòu)的在線棉結(jié)檢測(cè)裝置

為了在梳棉機(jī)上實(shí)現(xiàn)在線檢測(cè)監(jiān)控棉網(wǎng)中的棉結(jié)雜質(zhì)，提出了一種基于 DSP+FPGA架構(gòu)的硬件圖像處理在線檢測(cè)裝置，取代傳統(tǒng)的 PC-Base檢測(cè)模式；采用符合梳棉機(jī)機(jī)械結(jié)構(gòu)的光源設(shè)計(jì)和控制接口，完成對(duì)現(xiàn)場(chǎng)的實(shí)時(shí)監(jiān)控；利用DSP的擴(kuò)展能力實(shí)現(xiàn)網(wǎng)絡(luò)數(shù)據(jù)傳輸。介紹了該裝置的檢測(cè)原理、光源系統(tǒng)設(shè)計(jì)、DSP+FPGA處理架構(gòu)、 PLC接口以及終端設(shè)計(jì)，該系統(tǒng)可應(yīng)用于高速運(yùn)動(dòng)的棉網(wǎng)監(jiān)控及其它高速運(yùn)動(dòng)物體的實(shí)時(shí)監(jiān)控，在檢測(cè)技術(shù)與自動(dòng)化裝置研究領(lǐng)域具有重要的實(shí)用意義和廣泛的應(yīng)用前景。
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基于FPGA的PXA270外設(shè)時(shí)序轉(zhuǎn)換接口設(shè)計(jì)

1引言ARCNET協(xié)議應(yīng)用于高速動(dòng)車組列車通信網(wǎng)絡(luò)時(shí)，產(chǎn)生中央控制單元處理器PXA270與專用協(xié)議控制器...
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基于CPLD的函數(shù)信號(hào)發(fā)生器設(shè)計(jì)

摘要：針對(duì)傳統(tǒng)信號(hào)源精度低的特點(diǎn)，提出一種新的函數(shù)信號(hào)發(fā)生器設(shè)計(jì)方案。這里介紹的函數(shù)信號(hào)發(fā)生器由CPLD、單片機(jī)控制模塊、鍵盤、LED顯示、D／A轉(zhuǎn)換模塊組成。采用直接數(shù)字頻率合成(DDFS)技術(shù)，用單片機(jī)控制CPLD的
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基于CPLD的數(shù)據(jù)采集與顯示接口電路仿真設(shè)計(jì)

摘要：常規(guī)數(shù)據(jù)采集與顯示方法是應(yīng)用CPU或DSP通過軟件控制數(shù)據(jù)采集的模／數(shù)轉(zhuǎn)換，這樣將會(huì)頻繁中斷系統(tǒng)的運(yùn)行，從而降低系統(tǒng)的運(yùn)算速度，數(shù)據(jù)采集的速度也將受到限制。通過CPLD實(shí)現(xiàn)由硬件控制模／數(shù)轉(zhuǎn)換和數(shù)據(jù)顯示，
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基于FPGA的具有數(shù)字顯示的水溫測(cè)控系統(tǒng)

摘要：電壓、電流、溫度等模擬量的監(jiān)測(cè)在工業(yè)生活中都有很廣泛的應(yīng)用，通過監(jiān)測(cè)到的數(shù)據(jù)，可以對(duì)其進(jìn)行及時(shí)調(diào)整，為人們的生產(chǎn)生活帶來了便利與保證。系統(tǒng)主電路采用Actel公司提供的Fusion系列FPGA，用以實(shí)現(xiàn)溫度控制
關(guān)鍵字： FPGA 數(shù)字顯示測(cè)控系統(tǒng)

基于FPGA的IRIG-B編碼器實(shí)現(xiàn)

摘要：旨在設(shè)計(jì)一款基于FPGA的IRIG-B時(shí)間系統(tǒng)。該系統(tǒng)采用FPGA作為控制器，GPS引擎M12T作為標(biāo)準(zhǔn)時(shí)鐘源，利用M12T輸出的100 pps信號(hào)觸發(fā)IRIG-B編碼模塊，完成DC碼編碼。在DC碼的基礎(chǔ)上，通過正弦查找表實(shí)現(xiàn)了IRIG-B交
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基于Actel FPGA的多串口擴(kuò)展方案

　　隨著現(xiàn)代電子技術(shù)的發(fā)展，接口技術(shù)在設(shè)計(jì)中占據(jù)越來越重要的地位。多串口動(dòng)態(tài)擴(kuò)展通信技術(shù)在現(xiàn)場(chǎng)工業(yè)控制、智能家居等領(lǐng)域應(yīng)用越來越廣泛。在當(dāng)前的多串口的擴(kuò)展應(yīng)用中，雖然市面上有部分的多串口擴(kuò)展芯片，但是其可擴(kuò)展的串口數(shù)量有限并且擴(kuò)展的個(gè)數(shù)是固定的，而且這些擴(kuò)展芯片普片存在著價(jià)格比較昂貴、芯片體積較大在電路板中占據(jù)很大的空間，功耗過高等問題。　　基于Actel FPGA的多串口擴(kuò)展設(shè)計(jì)采用了Actel公司高集成度，小體積，低功耗，低系統(tǒng)成本，高安全性和可靠性的小容量FPGA-A3P030進(jìn)行設(shè)計(jì)，把若干接
關(guān)鍵字： Actel FPGA 多串口 201003

基于FPGA的永磁同步電機(jī)控制器設(shè)計(jì)

摘要：提出一種基于FPGA的永磁同步電機(jī)控制器的設(shè)計(jì)方案，該設(shè)計(jì)可應(yīng)用于具有高動(dòng)態(tài)性能要求的永磁同步電機(jī)伺服控制系統(tǒng)。為提高伺服控制系統(tǒng)的實(shí)時(shí)性，簡(jiǎn)化電路及節(jié)省成本，該系統(tǒng)設(shè)計(jì)采用Ahera公司生產(chǎn)的CycloneII
關(guān)鍵字： FPGA 永磁同步電機(jī) 制器設(shè)計(jì) PMSM

基于CPLD的多次重觸發(fā)存儲(chǔ)測(cè)試系統(tǒng)設(shè)計(jì)

摘要：提出一種基于CPLD的多次重觸發(fā)存儲(chǔ)測(cè)試系統(tǒng)設(shè)計(jì)方案，詳細(xì)介紹系統(tǒng)硬件設(shè)計(jì)以及CPLD內(nèi)部控制原理，并對(duì)CPLD控制電路仿真。該系統(tǒng)體積小、功耗低，能夠?qū)崟r(shí)記錄多次重觸發(fā)信號(hào)，每次信號(hào)記錄均有負(fù)延遲，讀取出
關(guān)鍵字： CPLD 觸發(fā) 存儲(chǔ)測(cè)試系統(tǒng)設(shè)計(jì)

基于FPGA的超聲波氣體流量計(jì)中AGC的實(shí)現(xiàn)

摘要：為能充分利用數(shù)字技術(shù)可靠性高、靈活性強(qiáng)等優(yōu)點(diǎn)，將自動(dòng)增益控制AGC引入數(shù)字域，并針對(duì)超聲波氣體流量計(jì)中接收信號(hào)的特點(diǎn)，給出一種基于EPlK30TCl44-3的全數(shù)字AGC設(shè)計(jì)方案。測(cè)試結(jié)果表明該系統(tǒng)設(shè)計(jì)可以實(shí)現(xiàn)40
關(guān)鍵字： FPGA AGC 超聲波氣體流量計(jì)

一種基于FPGA的永磁同步電機(jī)控制器的設(shè)計(jì)

摘要：提出一種基于FPGA的永磁同步電機(jī)控制器的設(shè)計(jì)方案，該設(shè)計(jì)可應(yīng)用于具有高動(dòng)態(tài)性能要求的永磁同步電機(jī)...
關(guān)鍵字： FPGA 永磁同步電機(jī)控制器 PMSM

基于FPGA和USB2.0的高速CCD聲光信號(hào)采集系統(tǒng)

0引言在現(xiàn)代通信和雷達(dá)領(lǐng)域中，寬帶、高增益、實(shí)時(shí)并行處理是現(xiàn)代接收機(jī)的重要標(biāo)志。因而，這種具有...
關(guān)鍵字： FPGA USB2.0 高速CCD 聲光信號(hào)采集

利用FPGA實(shí)現(xiàn)HDB3編解碼功能

摘要：HDB3(三階高密度雙極性)碼具有無直流分量、低頻成分少、連零個(gè)數(shù)不超過3個(gè)、便于提取時(shí)鐘信號(hào)等特點(diǎn)。通過對(duì)HDB3編解碼原理進(jìn)行分析和研究，提出一種基于FPGA的HDB3編解碼實(shí)現(xiàn)方法，給出Verilog HDL語(yǔ)言的實(shí)現(xiàn)
關(guān)鍵字： FPGA HDB3 編解碼