cpld／fpga 文章進(jìn)入cpld／fpga技術(shù)社區(qū)

基于DSP＋FPGA的便攜數(shù)字存儲(chǔ)示波表設(shè)計(jì)

本文提出了一種基于DSP＋FPGA的嵌入式便攜數(shù)字存儲(chǔ)示波表的設(shè)計(jì)方案，充分利用微控制器技術(shù)和ASIC技術(shù)實(shí)現(xiàn)了嵌入式實(shí)時(shí)處理，很好地達(dá)到了體積小、重量輕、功能強(qiáng)、可靠性高的要求。
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使用FPGA和IP Core實(shí)現(xiàn)定制緩沖管理

在通信網(wǎng)絡(luò)系統(tǒng)中，流量管理的核心是緩存管理、隊(duì)列管理和調(diào)度程序。本文結(jié)合使用FPGA及IP Core闡述緩存管理的結(jié)構(gòu)、工作原理及設(shè)計(jì)方法目前硬件高速轉(zhuǎn)發(fā)技術(shù)的趨勢(shì)是將整個(gè)轉(zhuǎn)發(fā)分成兩個(gè)部分：PE(Protocol Engine，協(xié)議引擎)和TM(Traffic Management，流量管理)。其中PE完成協(xié)議處理，TM負(fù)責(zé)完成隊(duì)列調(diào)度、緩存管理、流量整形、QOS等功能，TM與轉(zhuǎn)發(fā)協(xié)議無(wú)關(guān)。隨著通信協(xié)議的發(fā)展及多樣化，協(xié)議處理部分PE在硬件轉(zhuǎn)發(fā)實(shí)現(xiàn)方面，普遍采用現(xiàn)有的商用芯片NP(Network
關(guān)鍵字： Core FPGA IP 單片機(jī) 嵌入式系統(tǒng) 通訊網(wǎng)絡(luò) 無(wú)線

使用一個(gè)FPGA便可實(shí)現(xiàn)的64通道下變頻器

RF Engines公司的ChannelCore64使設(shè)計(jì)者能夠用一個(gè)可對(duì)FPGA編程的IP核來(lái)替代多達(dá)16個(gè)DDC(直接下變頻器)ASIC，可顯著減少PCB面積，降低功耗而且增加靈活性。和原來(lái)的方法相比，新方法是降低成本的典型代表，隨著通道數(shù)目的增加，降低成本的需求愈加突出。在提供靈活性和簡(jiǎn)化設(shè)計(jì)的同時(shí)，這種方法也能降低功耗。ChannelCore64的應(yīng)用包括無(wú)線基站，衛(wèi)星地面站和其它多通道無(wú)線電接收器等。在這些系統(tǒng)應(yīng)用中，需要從一個(gè)頻帶非常寬的信號(hào)中提取很多具有不同帶寬的通道(或者信號(hào))，然后將整個(gè)
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基于單片機(jī)的FPGA并行配置方法

在當(dāng)今變化的市場(chǎng)環(huán)境中，產(chǎn)品是否便于現(xiàn)場(chǎng)升級(jí)、是否便于靈活使用，已成為產(chǎn)品能否進(jìn)入市場(chǎng)的關(guān)鍵因素。在這種背景下，altera公司的基于SRAM LUT結(jié)構(gòu)的FPGA器件得到了廣泛的應(yīng)用。這類(lèi)器件的配置數(shù)據(jù)存儲(chǔ)在SRAM中。由于SRAM的掉電易失性，系統(tǒng)每次上電時(shí)，必須重新配置數(shù)據(jù)，只有在數(shù)據(jù)配置正確的情況下系統(tǒng)才能正常工作。這種器件的優(yōu)點(diǎn)是可在線重新配置ICR（In-Circuit Reconfigurability），在線配置方式一般有兩類(lèi)：一是通過(guò)下載電費(fèi)由計(jì)算機(jī)直接對(duì)其進(jìn)行配置；二是通過(guò)微處理器對(duì)其
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基于FPGA的相檢寬帶測(cè)頻系統(tǒng)的設(shè)計(jì)

在電子測(cè)量技術(shù)中，頻率測(cè)量是最基本的測(cè)量之一。常用的測(cè)頻法和測(cè)周期法在實(shí)際應(yīng)用中具有較大的局限性，并且對(duì)被測(cè)信號(hào)的計(jì)數(shù)存在
關(guān)鍵字： FPGA MCU PCB設(shè)計(jì) 測(cè)量測(cè)試單片機(jī) 嵌入式系統(tǒng) PCB 電路板

AMI Semiconductor繼續(xù)領(lǐng)跑FPGA-to-ASIC轉(zhuǎn)換行業(yè)

現(xiàn)在轉(zhuǎn)換90nm Xilinx和Altera FPGA AMI Semiconductor, Inc. (AMIS) 今日宣布，它已具備將1.2伏90nm FPGA轉(zhuǎn)換為基于單元的130nm ASIC的能力。有了這種能力的支持，OEM就能從昂貴的高密FPGA原型制作轉(zhuǎn)到更節(jié)省成本的ASIC生產(chǎn)。 AMIS是首家供應(yīng)Altera和Xilinx 90nm FPGA所用嵌入式替換組件的公司，主要面向通
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CPLD在航空1l5V/400Hz高頻鏈逆變電源中的應(yīng)用

介紹了一種基于CPLD的，用于大功率航空逆變電源的，觸發(fā)電路的設(shè)計(jì)原理和設(shè)計(jì)方法。
關(guān)鍵字：逆變電源應(yīng)用高頻 1l5V/400Hz 航空 CPLD

賽靈思面向最新VIRTEX-5 LXT平臺(tái)

最新的8.2i升級(jí)了ISE，PlanAhead和Chipscope Pro設(shè)計(jì)軟件加速設(shè)計(jì)收斂并為Virtex-5 LXT FPGA提供增強(qiáng)的生產(chǎn)力。賽靈思公司今天宣布面向最新Virtex™-5 LXT FPGA平臺(tái)推出完整的邏輯設(shè)計(jì)解決方案，包含升級(jí)版集成軟件環(huán)境(ISE™)設(shè)計(jì)工具。Virtex™-5 LXT FPGA平臺(tái)是業(yè)內(nèi)第一款提供硬代碼PCI Express®
關(guān)鍵字： FPGA 邏輯設(shè)計(jì) 賽靈思

JTAG口及其對(duì)F1aSh的在線編程

本文介紹一種通過(guò)JTAG對(duì)Flash進(jìn)行的在線編程方法。
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用VHDL語(yǔ)言在CPLD上實(shí)現(xiàn)串行通信

引言隨著EDA技術(shù)得發(fā)展，CPLD已經(jīng)在許多方面得到了廣泛應(yīng)用，而串行通信是實(shí)現(xiàn)遠(yuǎn)程測(cè)控的重要手段。本文利用VHDL語(yǔ)言在CPLD上實(shí)現(xiàn)了串行通信，完全可以脫離單片機(jī)使用，克服了單片機(jī)的許多缺點(diǎn)。串口結(jié)構(gòu)及內(nèi)容本設(shè)計(jì)所采用的是異步通信方式，可以規(guī)定傳輸?shù)囊粋€(gè)數(shù)據(jù)是10位，其中最低位為啟動(dòng)位(邏輯0低電平)，最高位為停止位(邏輯1高電平)，中間8位是數(shù)據(jù)位。為了方便對(duì)數(shù)據(jù)進(jìn)行正確控制，選取發(fā)送(接受)每位數(shù)據(jù)用4個(gè)時(shí)鐘周期。為了能夠達(dá)到串行通信的波特率，例如4800B/s，則需把時(shí)鐘頻率設(shè)
關(guān)鍵字： CPLD VHDL 串行通信單片機(jī) 嵌入式系統(tǒng)

基于FPGA的IJF數(shù)字基帶編碼的實(shí)現(xiàn)

1 引言 20世紀(jì)80年代初，加拿大渥太華大學(xué)的費(fèi)赫教授（K.Feher）領(lǐng)導(dǎo)的科研小組發(fā)明了IJF－OQPSK調(diào)制技術(shù)。IJF－OQPSK中文名稱(chēng)叫做無(wú)碼間干擾和抖動(dòng)-交錯(cuò)正交相移鍵控。他是現(xiàn)代數(shù)字恒包絡(luò)調(diào)制技術(shù)中新型的調(diào)制技術(shù)之一。進(jìn)行這種調(diào)制時(shí)，首先要對(duì)數(shù)字基帶信號(hào)進(jìn)行IJF編碼，將其變換成一種無(wú)碼間干擾和抖動(dòng)、頻譜主瓣窄、具有快速滾降的基帶波形，然后再用OQPSK調(diào)制。這樣，調(diào)制后的基帶信號(hào)就具有了以下特點(diǎn)：以調(diào)波的相位平滑連續(xù)，而且每個(gè)號(hào)碼內(nèi)的相位變化不會(huì)超過(guò)π/2，以調(diào)波的包絡(luò)近于恒
關(guān)鍵字： FPGA IJF 單片機(jī) 調(diào)制技術(shù) 嵌入式系統(tǒng)

解決硬盤(pán)驅(qū)動(dòng)器能耗難題

今天，大多數(shù)開(kāi)發(fā)便攜式媒體播放器、PDA、智能電話和基于IP協(xié)議的語(yǔ)音電話等高檔電池供電消費(fèi)類(lèi)產(chǎn)品的設(shè)計(jì)人員都在使用某種或其他類(lèi)型的FPGA(現(xiàn)場(chǎng)可編程門(mén)陣列)。比較先進(jìn)的FPGA器件還集成了一個(gè)與外部邏輯連接在一起的嵌入式RAM，因此可以用來(lái)增加更先進(jìn)的功能。這種FPGA的一種典型應(yīng)用包括充當(dāng)系統(tǒng)處理器及其HDD(硬盤(pán)驅(qū)動(dòng)器)之間的橋接器件，利用RAM作為一個(gè)FIFO(先進(jìn)先出存儲(chǔ)器)將處理器存儲(chǔ)器與硬盤(pán)驅(qū)動(dòng)器加以區(qū)分，進(jìn)而有利于更快的數(shù)據(jù)傳輸。這種方法有一種顯著的節(jié)能優(yōu)勢(shì)：當(dāng)硬盤(pán)驅(qū)動(dòng)器運(yùn)行時(shí)，它需要汲
關(guān)鍵字： 0610_A FPGA PolarPro 消費(fèi)電子硬盤(pán)驅(qū)動(dòng) 雜志_技術(shù)長(zhǎng)廊存儲(chǔ)器消費(fèi)電子

東芝與聯(lián)華制造的Xilinx 65納米Virtex-5 FPGA元件

兩款由日本東芝與臺(tái)灣聯(lián)華電子制造的Xilinx 65納米Virtex-5 FPGA元件由Chipworks 率先披露元件的內(nèi)部結(jié)構(gòu) 分析報(bào)告現(xiàn)已接受客戶(hù)訂購(gòu) Chipworks 公司宣布，已分析Xilinx公司采用65納米制程的XC5VLX50Virtex-5 FPGA兩個(gè)元件樣本。其中一款元件由數(shù)位消費(fèi)市場(chǎng)65納米技術(shù)的領(lǐng)導(dǎo)廠商日本東芝公司制造；而另一款元件則由另一業(yè)界先鋒臺(tái)灣聯(lián)華電子制造，亦是Xilinx過(guò)去10多年來(lái)的主要晶圓代工伙伴。Chipwo
關(guān)鍵字： 65納米 FPGA Virtex-5 Xilinx 單片機(jī) 東芝聯(lián)華嵌入式系統(tǒng)

利用FPGA解決TMS320C54x與SDRAM的接口問(wèn)題

在DSP應(yīng)用系統(tǒng)中，需要大量外擴(kuò)存儲(chǔ)器的情況經(jīng)常遇到。例如，在數(shù)碼相機(jī)和攝像機(jī)中，為了將現(xiàn)場(chǎng)拍攝的諸多圖片或圖像暫存下來(lái)，需要將DSP處理后的數(shù)據(jù)轉(zhuǎn)移到外存中以備后用。從目前的存儲(chǔ)器市場(chǎng)看，SDRAM由于其性能價(jià)格比的優(yōu)勢(shì)，而被DSP開(kāi)發(fā)者所青睞。DSP與SDRAM直接接口是不可能的。 FPGA（現(xiàn)場(chǎng)可編程門(mén)陣列）由于其具有使用靈活、執(zhí)行速度快、開(kāi)發(fā)工具豐富的特點(diǎn)而越來(lái)越多地出現(xiàn)在現(xiàn)場(chǎng)電路設(shè)計(jì)中。本文用FPGA作為接口芯片，提供控制信號(hào)和定時(shí)信號(hào)，來(lái)實(shí)現(xiàn)DSP到SDRAM的數(shù)據(jù)存取。 1 SDRA
關(guān)鍵字： DSP FPGA SDRAM 單片機(jī) 嵌入式系統(tǒng) 存儲(chǔ)器