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基于PCI/CPCI總線的嵌入式實時智能通信系統(tǒng)
- 摘 要：本文描述了一種基于PCI/CPCI總線的嵌入式實時智能通訊設備的設計及實現(xiàn)，充分利用了PCI總線的高效能和嵌入式通訊控制器的強大功能，設計出了一種高速的智能通信設備。關鍵詞：嵌入式微控制器；CPLD；智能通信模塊；PCI目標設備接口芯片；PCI/CPCI總線 引言在計算機通信領域，串口被廣泛運用。在某些特殊的應用領域，將會用到特殊的串口通信進行數(shù)據(jù)通信和報文交換。本設計就是針對一些特殊用途的應用，即一些高速系統(tǒng)串口傳輸方式的設計。 嵌入式智能通信系統(tǒng)的實時性
- 關鍵字： CPLD PCI/CPCI總線 PCI目標設備接口芯片 嵌入式微控制器 智能通信模塊 模塊
ADSP-21062與工控機數(shù)據(jù)交換電路設計
- 摘 要：本文根據(jù)系統(tǒng)需要，在信號處理機和工控機之間使用雙口SRAM，利用ADSP-21062的可編程FLAG引腳控制雙口SRAM的左右端口高位地址，設計了高速數(shù)據(jù)交換電路。關鍵詞：PC104；雙口SRAM；數(shù)據(jù)交換；CPLD ADSP-21062是ADI公司的通用DSP芯片，它具有強大的浮點/定點數(shù)據(jù)運算能力和很高的處理速度。多片ADSP-21062可以以多種形式方便地聯(lián)結成并行處理器系統(tǒng)，適合進行實時數(shù)據(jù)采集和處理。本文利用多片ADSP-21062設計了連續(xù)波雷達信
- 關鍵字： CPLD PC104 數(shù)據(jù)交換 雙口SRAM 存儲器
基于PCI總線的高速實時數(shù)據(jù)采集系統(tǒng)
- 摘 要：本文介紹了一種基于PCI總線的高速實時數(shù)據(jù)采集系統(tǒng)的設計與實現(xiàn)方法，主要討論了高速數(shù)據(jù)采集的存儲與傳輸?shù)挠布鉀Q方案，以及該系統(tǒng)的控制邏輯的實現(xiàn)，最后給出了控制邏輯仿真波形。關鍵詞：PCI總線；CPCI總線；高速實時數(shù)據(jù)采集；FIFO；CPLD 引言目前的大多數(shù)雷達信號處理機都是采用自定義總線，不具有通用性，每進行一些系統(tǒng)功能的改變就需要大量的硬件改動。而CPCI總線作為一種新興的工業(yè)總線，其采用了PCI總線的電氣特性以及VME總線的物理特性，兼具了二者的優(yōu)點
- 關鍵字： CPCI總線 CPLD FIFO PCI總線 高速實時數(shù)據(jù)采集
DSP和FPGA在圖像傳輸系統(tǒng)中的應用和實現(xiàn)
- 摘 要：本文重點介紹基于DSP和FPGA、采用中頻數(shù)字化方法，以及QPSK擴頻調(diào)制技術來實現(xiàn)圖像的無線傳輸。對擴頻通信系統(tǒng)的同步問題提出了一種實現(xiàn)方法，并給出了部分實驗結果。關鍵詞：圖像傳輸；擴頻通信；同步；FPGA；DSP 視頻通信是目前計算機和通信領域的一個熱點。而無線擴頻與有線相比,有其固有的優(yōu)越性，如聯(lián)網(wǎng)方便、費用低廉等。所以開發(fā)無線擴頻實時圖像傳輸系統(tǒng)有很高的實用價值。 系統(tǒng)設計在短距離通信中，通?？梢栽谑瞻l(fā)端加入奇偶校驗、累加和校驗等出錯重發(fā)的防噪聲措施
- 關鍵字： DSP FPGA 擴頻通信 同步 圖像傳輸
256級灰度LED點陣屏顯示原理及基于FPGA的電路設計
- 摘 要：本文提出了一種LED點陣屏實現(xiàn)256級灰度顯示的新方法。詳細分析了其工作原理。并依據(jù)其原理，設計出了基于FPGA 的控制電路。關鍵詞：256級灰度；LED點陣屏；FPGA；電路設計 引言256級灰度LED點陣屏在很多領域越來越顯示出其廣闊的應用前景，本文提出一種新的控制方式，即逐位分時控制方式。隨著大規(guī)?？删幊踢壿嬈骷某霈F(xiàn)，由純硬件完成的高速、復雜控制成為可能。 逐位分時點亮工作原理所謂逐位分時點亮，即從一個字節(jié)數(shù)據(jù)中依次提取出一位數(shù)據(jù)，分8次點亮對應的像
- 關鍵字： 256級灰度 FPGA LED點陣屏 電路設計 發(fā)光二極管 LED
基于CPLD的高速超聲車距報警器設計
- 摘要：本文給出了一個基于CPLD高速超聲車距報警器系統(tǒng)設計。關鍵詞：車距報警器；CPLD；雙口RAM 引言 為減少汽車碰撞事故的發(fā)生，汽車碰撞技術在近年發(fā)展很快。汽車避撞技術首先需要解決的問題是汽車之間的安全距離，當汽車與汽車之間的距離小于安全距離時，就應該能夠自動報警。本文給出了高速防撞器的核心部分：車距報警器的設計方法。筆者設計了一款安裝于車前／車尾的便攜式系統(tǒng)，能在汽車停車、倒車以及行使過程中自動監(jiān)控汽車與其它汽車、人和障礙物之間的距離，如果距離小于規(guī)定的安全距離
- 關鍵字： CPLD
基于AD9430的數(shù)據(jù)采集系統(tǒng)設計
- 摘 要：本文介紹了高速ADC AD9430的功能，詳細說明了使用高速FPGA來控制AD9430構成高速(140MSPS)、高精度(12位)數(shù)據(jù)采集系統(tǒng)的設計方法，并給出了具體實現(xiàn)的系統(tǒng)框圖和測試結果。關鍵詞：數(shù)據(jù)采集；FPGA；AD9430引言結合實際任務的要求，本文提出了一種基于AD9430的高速數(shù)據(jù)采集系統(tǒng)，主要用于采集雷達回波。在這個系統(tǒng)中，選用高速邏輯器件控制A/D轉(zhuǎn)換和FIFO存儲，同時通過FPDP(Front Panel Data Port)總線將采集的數(shù)據(jù)發(fā)送出去。由
- 關鍵字： AD9430 FPGA 數(shù)據(jù)采集
基于PCI總線的實時DVB碼流接收系統(tǒng)的硬件設計
- 摘 要：本文介紹了基于PCI專用芯片PCI9054和CPLD的DVB碼流接收系統(tǒng)的硬件設計。該設計采用了PCI9054+CPLD的數(shù)字處理方案，并采用一種新的方法更高效地利用雙端口RAM，保證了高速、大容量數(shù)據(jù)流的實時處理。關鍵詞：DVB；PCI；CPLD；雙端口RAM；WDM模式 前言通過PC接收DVB(數(shù)字視頻廣播)碼流已成為一項新的多媒體數(shù)據(jù)接收技術。因此，設計基于PC平臺的DVB碼流接收卡，是數(shù)字廣播電視發(fā)展的需要。由于DVB傳輸流的平均傳輸速率為6
- 關鍵字： CPLD DVB PCI WDM模式 雙端口RAM 存儲器
基于FPGA的非對稱同步FIFO設計
- 摘 要：本文在分析了非對稱同步FIFO的結構特點及其設計難點的基礎上，采用VHDL描述語言，并結合FPGA，實現(xiàn)了一種非對稱同步FIFO的設計。關鍵詞：非對稱同步FIFO；VHDL；FPGA；DLL；BlockRAM引言FIFO是一種常用于數(shù)據(jù)緩存的電路器件，可應用于包括高速數(shù)據(jù)采集、多處理器接口和通信中的高速緩沖等各種領域。然而在某些應用，例如在某數(shù)據(jù)采集和處理系統(tǒng)中，需要通過同步FIFO來連接8位A/D和16位數(shù)據(jù)總線的MCU，但是由于目前同步FIFO器件的輸入與輸
- 關鍵字： BlockRAM DLL FPGA VHDL 非對稱同步FIFO 存儲器
基于FPGA的高速數(shù)字鎖相環(huán)的設計與實現(xiàn)
- 摘 要：本文提出了一種利用邊沿觸發(fā)鑒相縮短鎖相環(huán)捕獲時間的方案，并詳細介紹了該方案基于FPGA的實現(xiàn)方法。通過對所設計的鎖相環(huán)進行計算機仿真和硬件測試，表明該方案確實可以提高鎖相環(huán)的捕獲性能。關鍵詞：數(shù)字鎖相環(huán)(DPLL)；捕獲時間；FPGA；VHDL引言捕獲時間是鎖相環(huán)的一個重要參數(shù)，指的是鎖相環(huán)從起始狀態(tài)到達鎖定狀態(tài)所需時間。在一些系統(tǒng)中，如跳頻通信系統(tǒng)，由于系統(tǒng)工作頻率不斷地發(fā)生快速變化(每秒幾百次到幾千次，甚至高達上萬次)，要求鎖相環(huán)能夠?qū)π盘栂辔豢焖俨东@。因此
- 關鍵字： FPGA VHDL 捕獲時間 數(shù)字鎖相環(huán)(DPLL)
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