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          異步FIFO在DSP圖像采集系統(tǒng)中的應(yīng)用

          • 引言基于DSP的圖像采集與處理系統(tǒng)與傳統(tǒng)的PC端的系統(tǒng)相比,具有功耗低、攜帶方便、處理速度快的特點,被廣泛使用在圖像采集與處理領(lǐng)域。DSP(Digital Signal Process or)芯片也稱數(shù)字信號處理器,是TI公司推出的專
          • 關(guān)鍵字: 異步FIFO  TVP5150  DSP  中斷  CPLD  

          機載導(dǎo)彈一控四電動舵機控制器研究與設(shè)計

          • 電動舵機作為導(dǎo)彈飛行的執(zhí)行機構(gòu),其體積重量的減少有利于導(dǎo)彈性能的提升。為了減小體積重量和節(jié)約成本,電動舵機采用三相無刷直流電機+滾珠絲杠直連式結(jié)構(gòu),采用一個控制器來控制四路舵機。介紹了控制器的硬件結(jié)構(gòu)方案和控制策略,控制器以DSP+CPLD為核心架構(gòu),采用位置、速度雙閉環(huán)PI控制,實現(xiàn)單一控制器同時控制四套電動舵機相互獨立工作。實驗結(jié)果表明,控制器可以正常工作,舵機帶寬可達到25Hz。
          • 關(guān)鍵字: 電動舵機  DSP  CPLD  三相無刷直流電機  

          上海安路科技宣布國內(nèi)首款ELF系列非易失性CPLD產(chǎn)品開始批量供貨

          •   上海安路信息科技有限公司宣布在其主力FPGA產(chǎn)品EAGLE系列之外,再添CPLD產(chǎn)品ELF系列。本次增添的器件包括ELF300和ELF650,目前公司開始對這兩顆器件批量供貨。   ELF系列CPLD作為擁有軟、硬件完全知識產(chǎn)權(quán)的國內(nèi)首款非易失性無限重構(gòu)可編程邏輯器件,ELF的量產(chǎn)將打破國外巨頭在CPLD市場長期壟斷的局面。CPLD被廣泛應(yīng)用于消費類、通信、工控、加密、汽車、醫(yī)療、軍工航天等等多個領(lǐng)域。   上海安路銷售副總裁盧鵬表示:“ELF相比同等規(guī)模國外器件,將提供給客戶更好
          • 關(guān)鍵字: 上海安路  CPLD  

          基于CAN總線的多通道實時模擬器設(shè)計

          •   CAN總線與一般的串行通信總線相比,它的數(shù)據(jù)通信具有可靠性高,實時性高,靈活性強等優(yōu)點,不僅廣泛應(yīng)用于汽車行業(yè),而且擴展到了機械工業(yè)、機器人、數(shù)控機床等諸多領(lǐng)域。尤其在大量數(shù)據(jù)通信處理中,高可靠性及實時響應(yīng)的場合,單通道CAN總線不能滿足實際通信的要求。為此,介紹一種基于多通道實時CAN模擬器的設(shè)計方案。   步驟/方法   1   CAN總線與一般的串行通信總線相比,它的數(shù)據(jù)通信具有可靠性高,實時性高,靈活性強等優(yōu)點,不僅廣泛應(yīng)用于汽車行業(yè),而且擴展到了機械工業(yè)、機器人、數(shù)控機床等諸多領(lǐng)域。尤
          • 關(guān)鍵字: CAN  CPLD  

          微軟計劃以FPGA提升數(shù)據(jù)中心服務(wù)器效能

          • 微軟計劃以FPGA提升數(shù)據(jù)中心服務(wù)器效能, 微軟(Microsoft)正探索將現(xiàn)場可編程閘陣列(FPGA)導(dǎo)入其資料中心伺服器的可能性。雖然目前這還只是一個初步的概念,但它可望緩減目前在網(wǎng)路效能所面臨的挑戰(zhàn)。微軟伺服器工程副總裁Kushagra Vaid在日前舉行的Linley
          • 關(guān)鍵字: 微軟  FPGA  IP  嵌入式  PLD  CPLD  SoC  

          一種通用基于CPLD實現(xiàn)的CAN接口連接設(shè)計

          • 一種通用基于CPLD實現(xiàn)的CAN接口連接設(shè)計, 摘要:介紹一種基于CPLD實現(xiàn)的DSP或ARM處理器與CAN總線控制器SJA1000接口連接設(shè)計。通常DSP或ARM處理器都有獨立的地址和數(shù)據(jù)總線,而SJA1000采用的是地址、數(shù)據(jù)分時復(fù)用總線,它們不能直接連接。該設(shè)計主要是通過CP
          • 關(guān)鍵字: CPLD  CAN控制器  SJA1000T  ARM  DSP  微處理器  

          基于MAX 7 0 0 0A與CYUSB3014的USB3.0數(shù)據(jù)采集系統(tǒng)

          • 基于MAX 7 0 0 0A與CYUSB3014的USB3.0數(shù)據(jù)采集系統(tǒng)的設(shè)計, 0 引言目前高速數(shù)據(jù)采集技術(shù)越來越得到人們的重視,傳統(tǒng)的USB 2.0采集平臺理論帶寬只有480 Mbps,實際傳輸能力只有30 Mb/s左右,而USB 3.0采集平臺理論帶寬達到了5Gbps,能有效解決USB2.0采集系統(tǒng)的缺陷。目前一些
          • 關(guān)鍵字: USB3.0  CPLD  CYUSB3014  數(shù)據(jù)采集  

          羅姆推出FPGA用電源穩(wěn)壓器及模塊

          • 羅姆推出FPGA用電源穩(wěn)壓器及模塊, 近年來,電子設(shè)備(應(yīng)用)的多樣化與高性能化以驚人的速度不斷發(fā)展??梢哉f,這種趨勢使各產(chǎn)品的開發(fā)周期縮短,并給半導(dǎo)體技術(shù)帶來了巨大的發(fā)展空間。在這種背景下,被稱為FPGA的LSI為電子設(shè)備的開發(fā)作出了巨大貢獻,
          • 關(guān)鍵字: FPGA  IP  嵌入式  PLD  CPLD  

          FPGA實戰(zhàn)演練邏輯篇3:FPGA與CPLD

          • 盡管很多人聽說過FPGA和CPLD,但是關(guān)于FPGA與CPLD之間的區(qū)別,了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”,但是在技術(shù)上
          • 關(guān)鍵字: FPGA  實戰(zhàn)演練  CPLD  

          基于CPLD實現(xiàn)QPSK調(diào)制電路的設(shè)計

          • QPSK是數(shù)字通信系統(tǒng)中一種常用的多進制調(diào)制方式。其調(diào)制的基本原理:對輸入的二進制序列按每兩位碼元分為一組,用載波的四種相位表征它們。實際
          • 關(guān)鍵字: QPSK調(diào)制  CPLD  

          【E課題】FPGA/CPLD數(shù)字電路原理介紹

          •   當(dāng)產(chǎn)生門控時鐘的組合邏輯超過一級時,證設(shè)計項目的可靠性變得很困難。即使樣機或仿真結(jié)果沒有顯示出靜態(tài)險象,但實際上仍然可能存在著危險。通常,我們不應(yīng)該用多級組合邏輯去鐘控PLD設(shè)計中的觸發(fā)器。  圖1給出一個含有險象的多級時鐘的例子。時鐘是由SEL引腳控制的多路選擇器輸出的。多路選擇器的輸入是時鐘(CLK)和該時鐘的2分頻 (DIV2)。由圖1的定時波形圖看出,在兩個時鐘均為邏輯1的情況下,當(dāng)SEL線的狀態(tài)改變時,存在靜態(tài)險象。險象的程度取決于工作的條件。 多級邏輯的險象是可以去除的
          • 關(guān)鍵字: FPGA  CPLD  

          一種帶電流檢測非互補式PWM 產(chǎn)生電路設(shè)計

          •   摘 要: 高壓鈉燈是城市照明的重要設(shè)備, 其供電電源對照明節(jié)能的效果和鈉燈工作的可靠性具有十分重要的意義。針對交流調(diào)壓電源應(yīng)用于城市路燈節(jié)能照明這一特殊場合, 分析了其帶電流檢測的非互補式控制方式的工作過程, 并采用CPLD 設(shè)計了一種相應(yīng)的PWM 時序產(chǎn)生電路, 節(jié)能照明電源采用此種斬波時序電路后可以帶感性、阻性、容性負(fù)載, 工作穩(wěn)定?! ? 引 言  近年來, 城市的照明節(jié)能工作
          • 關(guān)鍵字: PWM  CPLD   

          FPGA實戰(zhàn)演練邏輯篇:FPGA與CPLD

          •   盡管很多人聽說過FPGA和CPLD,但是關(guān)于FPGA與CPLD之間的區(qū)別,了解的人可能不是很多。雖然FPGA與CPLD都是“可反復(fù)編程的邏輯器件”,但是在技術(shù)上卻有一些差異。簡單地說,F(xiàn)PGA就是將CPLD的電路規(guī)模、功能、性能等方面強化之后的產(chǎn)物。(特權(quán)同學(xué)版權(quán)所有)   一般而言, FPGA與CPLD之間的區(qū)別如表1.1所示。(特權(quán)同學(xué)版權(quán)所有)   表1.1 FPGA和CPLD的比較    ?   總而言之,F(xiàn)PGA和CPLD最大的區(qū)別是他們的存儲
          • 關(guān)鍵字: FPGA  CPLD  

          基于CPLD的光伏逆變器鎖相及保護電路設(shè)計

          •   0 引言   在光伏并網(wǎng)系統(tǒng)的逆變器電路中,對電網(wǎng)電壓的鎖相是一項關(guān)鍵技術(shù)。由于電力系統(tǒng)在工作時會產(chǎn)生較大的電磁干擾,因此,其簡單的鎖相方法很容易受到干擾而失鎖,從而導(dǎo)致系統(tǒng)無法正常運行。在這種情況下,設(shè)計采用對電網(wǎng)電壓進行過零檢測后再將信號送人CPLD,然后由CPLD實現(xiàn)對電網(wǎng)電壓進行數(shù)字鎖相的方法,可以有效地防止相位因干擾而發(fā)生抖動或者失鎖的現(xiàn)象,保證系統(tǒng)的正常運行。另外,本系統(tǒng)還使用CPLD對DSP產(chǎn)生的PWM波控制信號和系統(tǒng)運行時的各項參數(shù)進行監(jiān)控,一旦發(fā)現(xiàn)異常,立即使系統(tǒng)停機,并通知DSP
          • 關(guān)鍵字: 濾波器  CPLD  光伏逆變器  

          基于DSP+CPLD的伺服控制卡的設(shè)計

          •   0 引 言   隨著先進制造技術(shù)的迅速發(fā)展,對運動控制的精度要求也越來越高,而運動伺服控制系統(tǒng)的性能很大程度上取決于伺服控制算法,通過運動控制與智能控制的融合,從改進傳統(tǒng)的PID控制,到現(xiàn)代的最優(yōu)控制、自適應(yīng)控制、智能控制技術(shù),應(yīng)用先進的智能控制策略達到高質(zhì)量的運動控制效果,已經(jīng)成為當(dāng)前研究的一個熱點。   由于運動伺服控制系統(tǒng)中存在負(fù)載模型參數(shù)的變化,機械摩擦、電機飽和等非線性因素,造成受控對象的非線性和模型不確定性,使得需要依靠精確的數(shù)學(xué)模型,系統(tǒng)模型參數(shù)的常規(guī)PID控制很難獲得超高精度、快響
          • 關(guān)鍵字: DSP  CPLD  
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