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          CPLD在水下沖擊波記錄儀中的應(yīng)用

          • 1.引言 隨著大規(guī)模集成電路和單片機的迅速發(fā)展,復(fù)雜可編程邏輯器件(CPLD)具有使用靈活、可靠性高、功能強大的優(yōu)點,在電子產(chǎn)品設(shè)計中得到了廣泛的應(yīng)用。CPLD可實現(xiàn)在系統(tǒng)編程,重復(fù)多次,而且還兼容IEEE1149.1(JTAG)標(biāo)準(zhǔn)的測試激勵端和邊界掃描能力,使用CPLD器件進行開發(fā),不僅可以提高系統(tǒng)的集成化程度、可靠性和可擴充性,而且大大縮短產(chǎn)品的設(shè)計周期。由于CPLD采用連續(xù)連接結(jié)構(gòu),易于預(yù)測延時,從而使電路仿真更加準(zhǔn)確。CPLD是標(biāo)準(zhǔn)的大規(guī)模集成電路產(chǎn)品,可用于各種數(shù)字邏輯系統(tǒng)
          • 關(guān)鍵字: CPLD  測量  測試  沖擊波  記錄儀  

          基于CCD的圖像采集處理系統(tǒng)的研究

          • 基于CCD的圖像采集處理系統(tǒng)的研究 濟南山東大學(xué)信息科學(xué)與工程學(xué)院(250100) 黃素貞 尹立新 張國梁    摘 要:以CCD作為圖像傳感器,以CPLD作為圖像采集系統(tǒng)的控制核心,以DSP作為基本圖像處理單元,實現(xiàn)了圖像自動采集處理系統(tǒng),完成了圖像的快速采集、存儲及數(shù)據(jù)處理。不僅對系統(tǒng)的硬件設(shè)計和軟件設(shè)計進行了討論,而且對應(yīng)用的算法也進行了簡單的介紹。   關(guān)鍵詞:CPLD CCD A/D DSP 圖像處理   CCD是一種光電轉(zhuǎn)換式圖像傳感器。它利用光電轉(zhuǎn)換原理把圖像信息直接轉(zhuǎn)換成電信
          • 關(guān)鍵字: A/D  CCD  CPLD  DSP  圖像處理  

          蓄電池在線監(jiān)測系統(tǒng)的設(shè)計與實現(xiàn)

          • 蓄電池在電力系統(tǒng)中是一種必備的后備電源且數(shù)量較多, 其使用壽命和安全可靠性倍受用戶關(guān)注。但由于使用不當(dāng)或者不能及時維護,經(jīng)常會導(dǎo)致蓄電池組中個別蓄電池的過放電或者早期失效。過放電或者早期失效的個別蓄電池在后備電源投入使用時,會嚴(yán)重影響整個電池組的放電容量,甚至?xí)?dǎo)致整個供電系統(tǒng)的崩潰。因此,為保證在市電被切斷時用電設(shè)備能夠安全可靠運行,避免蓄電池在長期使用過程中因個別電池過放電或者失效而引發(fā)事故帶來經(jīng)濟損失,對蓄電池進行實時在線監(jiān)測和及時的故障診斷成為蓄電池維護工作的一個極為重要 方面。本文介紹的基于ST
          • 關(guān)鍵字: CPLD  工業(yè)控制  監(jiān)測系統(tǒng)  蓄電池  工業(yè)控制  

          FPGA與CPLD的區(qū)別

          • 管FPGA和CPLD都是可編程ASIC器件,有很多共同特點,但由于CPLD和FPGA結(jié)構(gòu)上的差異,具有各自的特點:①CPLD更適合完成各種算法和組合邏輯,FP GA更適合于完成時序邏輯。換句話說,FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適合于觸發(fā)器有限而乘積項豐富的結(jié)構(gòu)。②CPLD的連續(xù)式布線結(jié)構(gòu)決定了它的時序延遲是均勻的和可預(yù)測的,而FPGA的分段式布線結(jié)構(gòu)決定了其延遲的不可預(yù)測性。 ③在編程上FPGA比CPLD具有更大的靈活性。CPLD通過修改具有固定內(nèi)連電路的邏輯功能來編程,FPGA主要通過
          • 關(guān)鍵字: CPLD  FPGA  

          基于DSP和CPLD的低功耗多路數(shù)據(jù)處理系統(tǒng)設(shè)計

          • 引言 隨著電子技術(shù)的應(yīng)用和發(fā)展,數(shù)字信號處理內(nèi)容日益復(fù)雜,同時,很多情況下要求整個系統(tǒng)具有低功耗的特點。為滿足這種要求,DSP芯片設(shè)計技術(shù)也在向低功耗、高性能的方向發(fā)展。從處理速度來看,TMS320VC5502的運算能力已經(jīng)達到了600MMACS,即每秒鐘可以完成6億次乘加運算。從功耗來看,TMS320VC5502內(nèi)核電壓只有1.26V,整個芯片的功耗也大大降低了。本文介紹了基于TMS320VC5502和CPLD XC95144的低功耗多路數(shù)據(jù)處理系統(tǒng)。 模擬信號的輸入經(jīng)過50Hz陷波電路(濾除工頻
          • 關(guān)鍵字: ADS7805  CPLD  DSP  單片機  嵌入式系統(tǒng)  數(shù)據(jù)處理  

          基于CPLD的位同步時鐘提取電路設(shè)計

          • 引言 異步串行通信是現(xiàn)代電子系統(tǒng)中最常用的數(shù)據(jù)信息傳輸方式之一,一般情況下,為了能夠正確地對異步串行數(shù)據(jù)進行發(fā)送和接收,就必須使其接收與發(fā)送的碼元同步,位同步時鐘信號不僅可用來對輸入碼元進行檢測以保證收發(fā)同步,而且在對接收的數(shù)字碼元進行各種處理等過程中,也可以為系統(tǒng)提供一個基準(zhǔn)的同步時鐘。 本文介紹的位同步時鐘的提取方案,原理簡單且同步速度較快。整個系統(tǒng)采用VerilogHDL語言編寫,并可以在CPLD上實現(xiàn)。 位同步時鐘的提取原理 本系統(tǒng)由一個跳變沿捕捉模塊、一個狀態(tài)寄存器和一個可控計數(shù)器共三
          • 關(guān)鍵字: CPLD  串行通信  電源技術(shù)  模擬技術(shù)  同步時鐘  

          基于CPLD的雷達仿真信號設(shè)計實現(xiàn)

          • 引言 隨著新一代作戰(zhàn)飛機大量裝備現(xiàn)役,機載雷達設(shè)備的維修任務(wù)越來越繁重,現(xiàn)代化的仿真測試系統(tǒng)成為重要的維修設(shè)備。雷達信號的仿真又是測試系統(tǒng)中必不可少的。但采用函數(shù)/任意波發(fā)生器組成測試系統(tǒng),不僅增加系統(tǒng)成本,而且還給系統(tǒng)軟件設(shè)計增加不必要的負擔(dān)。為此,提出了一種基于CPLD的雷達仿真信號的實現(xiàn)方案,它能為機載雷達測試系統(tǒng)提供所需的多種典型的重頻脈沖及制導(dǎo)信號。 雷達仿真信號發(fā)生器的結(jié)構(gòu) 雷達仿真信號發(fā)生器主要由輸入輸出控制和產(chǎn)生仿真信號的CPLD芯片兩部分組成。輸入輸出控制信號是利用測試系統(tǒng)的
          • 關(guān)鍵字: CPLD  單片機  仿真信號  嵌入式系統(tǒng)  

          基于TMS320VC33-150的聲探測系統(tǒng)設(shè)計

          • 引言被動聲源探測定位技術(shù)是一種利用聲學(xué)傳聲器陣列和電子裝置接收運動目標(biāo)的輻射噪聲,以確定目標(biāo)所處位置的技術(shù)。本文正是基于聲探測技術(shù)原理和成熟的微電子技術(shù), 采用TI公司的32位浮點DSP芯片TMS320VC33-150來實現(xiàn)聲源目標(biāo)的探測定位算法,并輔之以ADC、CPLD、單片機等器件來實現(xiàn)聲源信號的采集、系統(tǒng)邏輯控制以及通信功能。對于數(shù)字電路的邏輯控制功能,本文選用了Altera公司的CPLD芯片EPM7128AETC100-10來實現(xiàn)。該芯片功耗低、資源豐富、內(nèi)部延時固定,有助于時序邏輯電路的設(shè)計。本
          • 關(guān)鍵字: CPLD  DSP  測量  測試  單片機  嵌入式系統(tǒng)  

          CPLD在航空1l5V/400Hz高頻鏈逆變電源中的應(yīng)用

          JTAG口及其對F1aSh的在線編程

          • 本文介紹一種通過JTAG對Flash進行的在線編程方法。
          • 關(guān)鍵字: CPLD    Flash    DSP  

          用VHDL語言在CPLD上實現(xiàn)串行通信

          • 引言 隨著EDA技術(shù)得發(fā)展,CPLD已經(jīng)在許多方面得到了廣泛應(yīng)用,而串行通信是實現(xiàn)遠程測控的重要手段。本文利用VHDL語言在CPLD上實現(xiàn)了串行通信,完全可以脫離單片機使用,克服了單片機的許多缺點。 串口結(jié)構(gòu)及內(nèi)容 本設(shè)計所采用的是異步通信方式,可以規(guī)定傳輸?shù)囊粋€數(shù)據(jù)是10位,其中最低位為啟動位(邏輯0低電平),最高位為停止位(邏輯1高電平),中間8位是數(shù)據(jù)位。為了方便對數(shù)據(jù)進行正確控制,選取發(fā)送(接受)每位數(shù)據(jù)用4個時鐘周期。為了能夠達到串行通信的波特率,例如4800B/s,則需把時鐘頻率設(shè)
          • 關(guān)鍵字: CPLD  VHDL  串行通信  單片機  嵌入式系統(tǒng)  

          FPGA設(shè)計的四種常用思想與技巧

          • 本文討論的四種常用FPGA/CPLD設(shè)計思想與技巧:乒乓操作、串并轉(zhuǎn)換、流水線操作、數(shù)據(jù)接口同步化,都是FPGA/CPLD...
          • 關(guān)鍵字: CPLD  ASIC  設(shè)計  

          基于MCU CPLD變壓器測試系統(tǒng)的設(shè)計與實現(xiàn)

          • 1 引言 BX型信號變壓器,BG型軌道變壓器和ZG型硅整流器作為鐵路信號電器設(shè)備的前端,其工作的穩(wěn)定性、準(zhǔn)確性直接關(guān)系到行車安全,變壓器的可靠檢測是嚴(yán)抓質(zhì)量的第一步,對于生產(chǎn)廠家而言,測試流程不允許抽樣,且測試結(jié)果應(yīng)留檔。本套測試系統(tǒng)用來測試鐵路變壓器的各種要求參數(shù),包括原邊空載電流、次邊空載電壓、次邊帶載電壓電流,變壓器絕緣電阻、原邊電壓頻率,測量結(jié)果精度要求3%,測試系統(tǒng)分為上下位機兩大部分,下位機運用智能儀表的設(shè)計思想,在MCU和CPLD控制基礎(chǔ)上對各種要求測試參數(shù)分別進行自動測試,上位機上采用
          • 關(guān)鍵字: CPLD  MCU  變壓器  電源技術(shù)  模擬技術(shù)  

          東芝新V30T gigabeat數(shù)字音頻播放器

          •  Altera公司宣布,東芝公司在其最新的gigabeat®便攜式媒體播放器中選用了MAX® II CPLD系列的無鉛型號。Altera® MAX II器件幫助東芝設(shè)計人員將開發(fā)時間縮短了幾個月,并及時推出gigabeat V30T,使其成為首款支持日本單波段(one-segment)電視和無線廣播服務(wù)的便攜式數(shù)字音頻/視頻播放器。    東芝公司數(shù)字媒體網(wǎng)絡(luò)子公司移動娛樂產(chǎn)品部開發(fā)和設(shè)計科首席專家Masatoshi&nb
          • 關(guān)鍵字: Altera  CPLD  gigabeat  II  MAX  V30T  東芝  數(shù)字音頻播放器  消費電子  消費電子  
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