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用于VHDL的DRAM控制器設計

80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場的上導產(chǎn)品之一，已廣泛應用于電腦終端、程控交換和工控等領域。在該嵌入式微處理器片內(nèi)，集成有DRAM RCU單元，即DRAM刷新控制單元。RCU單元可以自動產(chǎn)
關鍵字： 80C186XL CPLD DRAM控制器 VHDL

基于CPLD／FPGA的VHDL語言電路優(yōu)化設計

杜志傳，鄭建立(上海理工大學醫(yī)療器械與食品學院上海 200093)0 引言VHDL(Very High Speed Integrated Circuit Hardware Description Language)是IEEE工業(yè)標準硬件描述語言，是隨著可編程邏輯器件(PLD)的發(fā)展而發(fā)
關鍵字： VHDL CPLD／FPGA 電路設計優(yōu)化

FPGA與CPLD的辨別和分類

FPGA與CPLD的辨別和分類主要是根據(jù)其結構特點和工作原理。通常的分類方法是：將以乘積項結構方式構成邏輯行為的器件稱為CPLD，如Lattice的ispLSI系列、Xilinx的XC9500系列、Altera的MAX7000S系列和Lattice(原Vantis)
關鍵字： FPGA CPLD 辨識

基于嵌入式系統(tǒng)中DRAM控制器的CPLD解決方案

80C186XL16位嵌入式微處理器是Intel公司在嵌入式微處理器市場的上導產(chǎn)品之一，已廣泛應用于電腦終端、程控交換和工控等領域。在該嵌入式微處理器片內(nèi)，集成有DRAM RCU單元，即DRAM刷新控制單元。RCU單元可以自動產(chǎn)生
關鍵字：嵌入式系統(tǒng) DRAM控制器 CPLD

拆解安捷倫電源/測量單元(SMU)

Dave Jones在5年時間里，上傳了超過600個電子類的視頻。在每周二，Jones會拆解一個不錯的設備(當然，有時候沒有那么好)，Jones并不是簡單地把盒子破壞、打開，他會用他豐富的電子設計知識來說明這個設備是怎么設計
關鍵字：拆解 FPGA CPLD Xilinx 安捷倫

基于CPLD器件在時間統(tǒng)一系統(tǒng)中的應用

引言隨著電子技術的發(fā)展，對遙測信號的幀結構的可編程度、集成度的要求越來越高，用于時間統(tǒng)一系統(tǒng)的B碼源的設計也趨于高度集成化。為了適應現(xiàn)代靶場試驗任務的要求，我們采用Altera的CPLD器件，將用于產(chǎn)生B碼的各種
關鍵字： CPLD 時間統(tǒng)一系統(tǒng) IRIG－B碼

DSP與CPLD的輸電線路局部氣象監(jiān)測裝置設計

1 概述輸電線路的狀態(tài)直接決定著整個電網(wǎng)的安全穩(wěn)定運行，輸電線路微氣象參數(shù)的實時監(jiān)測能夠為電網(wǎng)正常調(diào)度、以及自然災害預測和控制提供必要的現(xiàn)場信息。輸電線路是電力系統(tǒng)的關鍵元件之一。為了安全、穩(wěn)定地運行，
關鍵字： DSP CPLD 輸電線路氣象監(jiān)測

基于CPLD的CCD信號發(fā)生器的研究

1、引言CCD (Charge Coupled Devices)電荷藕合器件是20世紀70年代初發(fā)展起來的新型半導體器件。目前CCD作為光電傳感器由于其具有體積小、重量輕、功耗小、工作電壓低和抗燒毀等優(yōu)點以及在分辨率、動態(tài)范圍、靈敏度
關鍵字： CPLD CCD 信號發(fā)生器

基于脈沖信號源的CPLD方法實現(xiàn)

單片機產(chǎn)生的脈沖信號源由于是靠軟件實現(xiàn)的，所以輸出頻率及步進受單片機時鐘頻率、指令數(shù)和指令執(zhí)行周期的限制。文中介紹了一種以CPLD為核心的脈沖信號源，脈沖信號源的參數(shù)(頻率、占空比)由工控機通過I/O板卡設置，
關鍵字：脈沖信號源 CPLD 單片機

CPLD電梯運行控制器VHDL

西安航空職業(yè)技術學院李軍法1 引言隨著社會的發(fā)展。使用電梯越來越普遍，已從原來只在商業(yè)大廈、賓館過渡到在辦公室、居民樓等多種建筑中，并且對電梯功能的要求也不斷提高，其相應控制方式也在不斷發(fā)生變化。電梯的
關鍵字： CPLD 電梯運行控制器 VHDL

CPLD DDS正交信號源濾波器

桂林電子科技大學韓劍李德明馮雪1 引言由于傳統(tǒng)的多波形函數(shù)信號發(fā)生器需采用大量分離元件才能實現(xiàn)，且設計復雜，這里提出一種基于CPLD的多波形函數(shù)信號發(fā)生器。它采用CPLD作為函數(shù)信號發(fā)生器的處理器，以單片機和
關鍵字： CPLD DDS 單片機

FPGA與CPLD的概念及其區(qū)別

一、FPGA與CPLD的基本概念1.CPLDCPLD主要是由可編程邏輯宏單元(LMC，Logic Macro Cell)圍繞中心的可編程互連矩陣單元組成，其中LMC邏輯結構較復雜，并具有復雜的I/O單元互連結構，可由用戶根據(jù)需要生成特定的電路結
關鍵字： FPGA CPLD

基于JTAG接口的內(nèi)建修調(diào)電路的設計

摘要：為減小基準電壓源的誤差，提高集成電路精度，設計了一種基于JTAG接口的熔絲燒斷修調(diào)電路，著重分析JTAG接口及修調(diào)技術的具體實現(xiàn)。通過調(diào)整電路內(nèi)部結構，使基準電壓在-40到85度的范圍內(nèi)誤差不超過100ppm，并通
關鍵字： JTAG接口修調(diào)技術熔絲基準電壓

CPLD 實現(xiàn)DDS 信號源的設計

中文摘要:利用CPLD 在高速數(shù)據(jù)處理方面的特點設計出以VHDL 硬件描述語言為設計輸入, 以AL TERA 公司的 EPM 7256 芯片為設計載體, 基于DDS 技術的任意波形信號發(fā)生器。該信號發(fā)生器能同時輸出兩路信號, 輸出信號的頻
關鍵字： CPLD DDS 信號源設計

東亞LTE設備需求強勁　FPGA喜迎4G商機

東亞地區(qū)長程演進計畫(LTE)設備需求，驅(qū)動現(xiàn)場可編程閘陣列(FPGA)業(yè)者營收攀升。2014年中國大陸及臺灣陸續(xù)啟動LTE商轉(zhuǎn)，帶動龐大的LTE設備購置及基礎建設投資潮，深耕通訊領域有成的FPGA業(yè)者也趁著這波潮流搭上順風
關鍵字： 4G LTE FPGA IP 嵌入式 PLD CPLD

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cpld-jtag接口介紹

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cpld-jtag接口電路

利用CPLD實現(xiàn)多路數(shù)據(jù)采集
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采用CPLD電器定時開關控制系統(tǒng)電路
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