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FPGA和ARM的Profibus-DP主站通信平臺設計
- 摘要：提出一個使用FPGA和ARM微控制器實現(xiàn)Profibus-DP主站(1類)通信平臺的解決方案；解析了Profibus-DP通信協(xié)議，重點是令牌輪轉協(xié)議；給出了該主站通信平臺的系統(tǒng)構建。該通信平臺可以獨立實現(xiàn)Profibus-DP主站(1類)
- 關鍵字： Profibus-DP FPGA ARM 通信
基于CPLD/FPGA的VHDL語言電路優(yōu)化設計
- VHDL(VeryHighSpeedIntegratedCircuitHardwareDescriptionLanguage)是IEEE工業(yè)標準硬件描述語言...
- 關鍵字： CPLD FPGA VHDL 電路優(yōu)化設計
基于CPLD的函數(shù)信號發(fā)生器設計
- 摘要：針對傳統(tǒng)信號源精度低的特點，提出一種新的函數(shù)信號發(fā)生器設計方案。這里介紹的函數(shù)信號發(fā)生器由CPLD、單片機控制模塊、鍵盤、LED顯示、D／A轉換模塊組成。采用直接數(shù)字頻率合成(DDFS)技術，用單片機控制CPLD的
- 關鍵字： CPLD 函數(shù)信號發(fā)生器
基于CPLD的數(shù)據(jù)采集與顯示接口電路仿真設計
- 摘要：常規(guī)數(shù)據(jù)采集與顯示方法是應用CPU或DSP通過軟件控制數(shù)據(jù)采集的模／數(shù)轉換，這樣將會頻繁中斷系統(tǒng)的運行，從而降低系統(tǒng)的運算速度，數(shù)據(jù)采集的速度也將受到限制。通過CPLD實現(xiàn)由硬件控制模／數(shù)轉換和數(shù)據(jù)顯示，
- 關鍵字： CPLD 數(shù)據(jù)采集 電路 仿真設計
基于CPLD的多次重觸發(fā)存儲測試系統(tǒng)設計
- 摘要：提出一種基于CPLD的多次重觸發(fā)存儲測試系統(tǒng)設計方案，詳細介紹系統(tǒng)硬件設計以及CPLD內部控制原理，并對CPLD控制電路仿真。該系統(tǒng)體積小、功耗低，能夠實時記錄多次重觸發(fā)信號，每次信號記錄均有負延遲，讀取出
- 關鍵字： CPLD 觸發(fā) 存儲測試 系統(tǒng)設計
基于PLC與PROFIBUS-DP總線的電力參數(shù)監(jiān)控系統(tǒng)
- 1 引言
現(xiàn)場總線是用于現(xiàn)場儀表與控制系統(tǒng)和控制室之間的一種全分散、全數(shù)字化、智能、雙向、互聯(lián)、多變量、多點、多站的通信網(wǎng)絡。目前，現(xiàn)場總線種類繁多，還沒有統(tǒng)一的標準，每種總線都有其獨特的產(chǎn)生 - 關鍵字： 參數(shù) 監(jiān)控系統(tǒng) 電力 總線 PLC PROFIBUS-DP 基于
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