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DSP外部Flash存儲器在線編程的軟硬件設計

摘要：詳細介紹DSP與Flash存儲器的兩種硬件接口方式及在線編程，分析了兩種硬件接口方式下在線編程的區(qū)別，給出了相應的在線編程核心代碼并在實際電路上測試通過，可作為DSP嵌入式系統(tǒng)設計的參考。
關鍵詞：在線編程
關鍵字：編程軟硬件設計在線存儲器外部 Flash DSP

基于FPGA的UART設計與實現(xiàn)

介紹了應用現(xiàn)場可編程門陣列(FPGA)設計和實現(xiàn)通用異步收發(fā)器UART的方法。采用有限狀態(tài)機模型形式化描述了UART的功能，在此基礎上用硬件描述語言VHDL編程實現(xiàn)了UART，并使用QuartusⅡ軟件中的嵌入式邏輯分析儀SignalTapⅡ對數(shù)據(jù)傳輸進行了檢測，驗證了設計的正確性。
關鍵字： FPGA UART

OMAP3平臺移動多媒體的視頻解碼方案

摘要：對標準的視頻編解碼標準(如H．264和AVS標準)的核心技術進行了分析，提出一種基于TI公司的OMAP3530處理器平臺的通用視頻解碼方案。該方案充分利用了OMAP3530的硬件結構特點，特別是2D／3D圖形圖像加速器的特點，
關鍵字：解碼方案視頻多媒體平臺移動 OMAP3 ARM DSP USB

基于LabVIEW和DSP技術的FFT頻譜分析儀

1虛擬儀器概念和特點虛擬儀器是虛擬技術在儀器儀表領域中的一個重要應用。它是日益發(fā)展的計算...
關鍵字：頻譜分析儀 LabVIEW DSP FFT

基于WCDMA速率適配算法的FPGA設計實現(xiàn)

關鍵字：編碼復接速率適配 FPGA 鑿孔圖樣保留比特搬移

基于FPGA的短波發(fā)射機自動調諧系統(tǒng)的設計

1．前言短波發(fā)射主要用于各廣播電臺之間，各核潛艇之間的相互通信。發(fā)射機主要由電控邏輯裝置、過荷保...
關鍵字： FPGA 短波發(fā)射機自動調諧系統(tǒng)

基于FPGA的8B／10B編解碼設計

摘要：為提高8B／10B編解碼的工作速度和簡化邏輯方法，提出一種基于FPGA的8B／10B編解碼系統(tǒng)設計方案。與現(xiàn)有的8B／10B編解碼方案相比，該方案是一種利用FPGA實現(xiàn)8B／lOB編解碼的模塊方法，接收模塊在收到外部發(fā)送的
關鍵字： FPGA 10B 編解碼

基于WCDMA速率適配算法的FPGA設計

基于WCDMA速率適配算法的FPGA設計,隨著因特網(wǎng)爆炸性的增長以及各種無線業(yè)務需求的增加，傳統(tǒng)的無線通信網(wǎng)已經(jīng)越來越無法適應人們的需要。因此，以大容量、高數(shù)據(jù)率和承載多媒體業(yè)務為目的的第三代移動通信系統(tǒng)(IMT-2000)應運而生。碼分多址(CDMA)由于
關鍵字： FPGA 設計算法適配 WCDMA 速率基于

Altera Stratix V FPGA提供RLDRAM 3存儲器支持

　　Altera公司今天發(fā)布Stratix® V系列FPGA，適用于支持Micron技術公司的下一代低延時DRAM (RLDRAM® 3存儲器)。Stratix V FPGA采用新的存儲器體系結構，降低延時，高效實現(xiàn)FPGA業(yè)界最好的系統(tǒng)性能。Stratix V FPGA為網(wǎng)絡設備生產(chǎn)商提供存儲器接口解決方案，支持在互聯(lián)網(wǎng)上迅速有效的傳送視頻、語音和數(shù)據(jù)。　　Micron公司業(yè)務開發(fā)高級經(jīng)理Bruce Franklin表示：“Micron的下一代RLDRAM 3存儲器專門設
關鍵字： Altera Stratix FPGA

2010 TI 亞洲技術研討會開幕

　　2010年8月4日，深圳訊，德州儀器 (TI) 2010亞洲技術研討會 (TI Asia Technology Days 2010)中國區(qū)分會在深圳開幕。為期一天的研討會不僅提供了超過 30堂覆蓋電源供應設計、模擬設計、微控制器 (MCU)、微處理器 (MPU) 和數(shù)字信號處理器 (DSP) 等方面的技術與應用解決方案演講，還提供了超過30個產(chǎn)品和應用的展示供與會嘉賓體驗最新的技術與創(chuàng)新。除深圳外，此次 TI 亞洲技術研討會，還將分別于8月6日、8月9日在上海和北京舉行。　　已舉辦多年的TI 技術
關鍵字： TI MCU MPU DSP

基于DSP的語音識別計算器設計

摘要：為解決特殊群體使用計算器困難的問題，設計了一種基于TMS320VC5509 DSP的可語音識別的計算器系統(tǒng)。該計算器系統(tǒng)的核心是采用HMM算法建立語音識別模型。通過對實時語音信號(數(shù)字、運算符號等語音)進行處理，將得
關鍵字：計算器設計識別語音 DSP 基于 DSP

基于FPGA的IRIG-B(DC)碼產(chǎn)生電路設計

摘要：提出了一種IRIG-B(DC)碼產(chǎn)生電路的設計方法。采用Altera公司低功耗Cyclone FPGA系列中的EPlC6T144、8段數(shù)碼管、晶體振蕩器和MAX3232E等器件構成硬件電路、使用VHDL語言設計IRIG-B直流時間碼的軟件。為了設置和
關鍵字： IRIG-B FPGA DC 產(chǎn)生電路

基于FPGA的PCI硬件加解密卡設計

摘要：提出一種基于FPGA的PCI硬件加解密卡的設計方案，用硬件加解密取代了傳統(tǒng)的軟件加解密，將加解密模塊和PCI接口模塊集成在一個FPGA芯片內實現(xiàn)。分析了PCI加解密卡的軟硬件的結構和原理，詳細介紹了DESX加解密算法
關鍵字： FPGA PCI 硬件加解密

基于GIO/FVID的DSP視頻驅動程序設計

關鍵字：視頻設備驅動程序 TMS320F2812 DSP/BIOS GIO/FVID模型

基于CPLD／FPGA的CMI編碼設計與實現(xiàn)

根據(jù)CMI碼的特性，介紹了一種新的編程思路實現(xiàn)CMI編碼，在Max+PlusⅡ開發(fā)平臺上使用VHDL編程實現(xiàn)CMI編碼，并得到仿真波形。實驗結果表明，這種編程思路簡單、清晰。在產(chǎn)生7位偽隨機序列的前提下，分別對“O”，“1”進行編碼。這種思路為其他碼型設計提供了參考。
關鍵字： CPLD FPGA CMI 編碼

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