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多核DSP結(jié)構(gòu)與超核DSP結(jié)構(gòu)
- Internet爆炸性的增長，線路網(wǎng)絡(luò)與分組網(wǎng)絡(luò)的加速融合，對(duì)通信設(shè)備和應(yīng)用提出了一系列新的要求。 目前的線路交換技術(shù)是在Internet時(shí)代之前很久設(shè)計(jì)的，由于它們只對(duì)通話業(yè)務(wù)進(jìn)行優(yōu)化，已不能支持當(dāng)今成指數(shù)增長的數(shù)據(jù)業(yè)務(wù)。為此，服務(wù)提供商正在部署分組網(wǎng)絡(luò)（Internet協(xié)議）和信元網(wǎng)絡(luò)（ATM），并從老式設(shè)備轉(zhuǎn)向以分組交換為中心的軟交換技術(shù)和媒介網(wǎng)關(guān)。
- 關(guān)鍵字： 多核 DSP 超核
淺析SoC時(shí)代的多核DSP產(chǎn)品
- 數(shù)字信號(hào)處理器（DSP） 是對(duì)數(shù)字信號(hào)進(jìn)行高速實(shí)時(shí)處理的專用處理器。在當(dāng)今的數(shù)字化的背景下，DSP已經(jīng)成為電子工業(yè)領(lǐng)域增長最迅速的產(chǎn)品之一。 據(jù)世界半導(dǎo)體貿(mào)易統(tǒng)計(jì)組織 （WSTS）發(fā)布的統(tǒng)計(jì)和預(yù)測(cè)報(bào)告顯示，1996～2005年，全球DSP市場(chǎng)將一直保持穩(wěn)步增長，2005年的增長率將達(dá)34%。因此，全球DSP市場(chǎng) 的前景非常廣闊，DSP已成為數(shù)字通信、智能控制
- 關(guān)鍵字： SoC 多核 DSP
FPGA基軟件無線電(04-100)
- 軟件無線電技術(shù)給正在開發(fā)無線電架構(gòu)的工程師帶來力量。編程中頻(IF)、帶寬、調(diào)制、編碼模式和其他無線電功能的能力廣泛引起注意。除了提供所有這些靈活性外，軟件無線電必須改善靈敏度，動(dòng)態(tài)范圍和鄰信道抑制性能。軟件無線電仍然是無線電，但它必須比被正在替代的通常無線電執(zhí)行的更好。 現(xiàn)場(chǎng)可編程陣列(FPGA)技術(shù)先進(jìn)之處在于緊湊的占位空間能夠高速處理，同時(shí)也保持軟件無線電技術(shù)的靈活性和可編程性。FPGA在高速、計(jì)算密集、可重新配置應(yīng)用(FFT、FIR和其他乘法—累加運(yùn)算)中是受歡迎的。從FPG
- 關(guān)鍵字： FPGA 無線電
FPGA 電路設(shè)計(jì): 如何應(yīng)對(duì)電源相關(guān)問題的挑戰(zhàn)
- 引言 在設(shè)計(jì)可編程門陣列(FPGA)電路時(shí)，必須極端重視電源問題，從而使最終產(chǎn)品能在所有可能的條件下無缺陷工作并處于最優(yōu)狀態(tài)。FPGA 電路電源有兩項(xiàng)需考慮的問題: FPGA 電路上電要求和電路功耗分析。這篇文章針對(duì)這兩方面的要求，討論您可能遇到的問題，以及解決方案。 目前FPGA電路設(shè)計(jì)所面臨的問題 FPGA電路通常需要多路電源輸入。為優(yōu)化開機(jī)時(shí)的電流拖曳，防止鎖死和永久性的電路損壞，同時(shí)也為了防止開機(jī)接通時(shí)的毛刺干擾和降低開機(jī)接通的功耗，這些電源輸入必須具有精確的上電序列以及正確
- 關(guān)鍵字： FPGA
在FPGA中集成高速串行收發(fā)器面臨的挑戰(zhàn)(04-100)
- Altera公司對(duì)PCI Express，串行Rapid I/O和SerialLite等串行標(biāo)準(zhǔn)和協(xié)議的認(rèn)可，將促進(jìn)具有時(shí)鐘和數(shù)據(jù)恢復(fù)(CDR)功能的高速串行收發(fā)器的應(yīng)用。這些曾在4或8位ASSP中使用的收發(fā)器現(xiàn)在可以集成在高端FPGA中。帶有嵌入式收發(fā)器的FPGA占據(jù)更小的電路板空間，具有更高的靈活性和無需接口處理的兩芯片方案等優(yōu)勢(shì)，因此，采用這種FPGA對(duì)電路板設(shè)計(jì)者是很具有吸引力的選擇。 在FPGA中集成收發(fā)器使得接口電路處理工作由電路板設(shè)計(jì)者轉(zhuǎn)向芯片設(shè)計(jì)者。本文闡述在一個(gè)FPGA中集成1
- 關(guān)鍵字： Altera FPGA ASSP ASIC
FPGA到高速DRAM的接口設(shè)計(jì)(04-100)
- FPGA做為系統(tǒng)的核心元件正在更多的用于網(wǎng)絡(luò)、通信、存儲(chǔ)和高性能計(jì)算應(yīng)用中，在這些應(yīng)用中都需要復(fù)雜的數(shù)據(jù)處理。 所以，現(xiàn)在FPGA支持高速、外部存儲(chǔ)器接口是必須遵循的?，F(xiàn)在的FPGA具有直接接口各種高速存儲(chǔ)器件的專門特性。本文集中描述高速DRAM到FPGA的接口設(shè)計(jì)。 設(shè)計(jì)高速外部存儲(chǔ)器接口不是一件簡單的任務(wù)。例如，同步DRAM已發(fā)展成高性能、高密度存儲(chǔ)器并正在用于主機(jī)中。最新的DRAM存儲(chǔ)器—DDR SDRAM，DDR2和RLDRAM II支持頻率范圍達(dá)到133MHz(260
- 關(guān)鍵字： Altera FPGA DRAM
基于FPGA的液晶顯示控制器設(shè)計(jì)
- 液晶顯示器由于具有低壓、微功耗、顯示信息量大、體積小等特點(diǎn)，在移動(dòng)通信終端、便攜計(jì)算機(jī)、GPS衛(wèi)星定位系統(tǒng)等領(lǐng)域有廣泛用途，成為使用量最大的顯示器件。液晶顯示控制器作為液晶驅(qū)動(dòng)電路的核心部件通常由集成電路組成，通過為液晶顯示系統(tǒng)提供時(shí)序信號(hào)和顯示數(shù)據(jù)來實(shí)現(xiàn)液晶顯示。本設(shè)計(jì)是一種基于FPGA(現(xiàn)場(chǎng)可編程門陣列)的液晶顯示控制器。與集成電路控制器相比，F(xiàn)PGA更加靈活，可以針對(duì)小同的液晶顯示模塊更改時(shí)序信號(hào)和顯示數(shù)據(jù)。FPGA的集成度、復(fù)雜度和面積優(yōu)勢(shì)使得其日益成為一種頗具吸引力的高性價(jià)比ASIC替代方案
- 關(guān)鍵字： FPGA 液晶
基于SoC的AC'97技術(shù)硬件設(shè)計(jì)
- 引言 符合Audio Codec'97協(xié)議(簡稱AC'97，是由Intel公司提出的數(shù)字音頻處理協(xié)議)的音頻控制器不但廣泛應(yīng)用于個(gè)人電腦聲卡，并且為個(gè)人信息終端設(shè)備的SOC(如Intel的PXA250)提供音頻解決方案。本文設(shè)計(jì)的音頻控制器可為DSP內(nèi)核提供數(shù)字音頻接口。全文在介紹音頻控制器結(jié)構(gòu)的同時(shí)，著重強(qiáng)調(diào)其與內(nèi)核之間數(shù)據(jù)的協(xié)調(diào)傳輸，并給出基于FPGA實(shí)現(xiàn)SoC內(nèi)核仿真環(huán)境對(duì)音頻控制器進(jìn)行功能測(cè)試的方法。 音頻控制器的結(jié)構(gòu)和原理 AC'97系統(tǒng)由音頻編解碼器(Codec)和音頻控
- 關(guān)鍵字： 數(shù)字音頻 接口 DSP FPGA SoC 內(nèi)存
四種常用FPGA/CPLD設(shè)計(jì)思想與技巧之流水線操作
- FPGA/CPLD設(shè)計(jì)思想與技巧之流水線操作本系列討論的四種常用FPGA/CPLD設(shè)計(jì)思想與技巧：乒乓操作、串并轉(zhuǎn)換、流...
- 關(guān)鍵字： CPLD設(shè)計(jì) FPGA 流水線操作 設(shè)計(jì)思想 串并轉(zhuǎn)換 RAKE接收機(jī) 單流 設(shè)計(jì)手段 流水線設(shè)計(jì) 操作時(shí)間
四種常用FPGA/CPLD設(shè)計(jì)思想與技巧之乒乓操作
- FPGA
- 關(guān)鍵字： CPLD設(shè)計(jì) FPGA 乒乓 Xilinx Altera Lattice actel 操作 系統(tǒng)設(shè)計(jì) 思想
FPGA可滿足SMPTE視頻標(biāo)準(zhǔn)對(duì)更高速率的需求
- 主題：FPGA可滿足SMPTE視頻標(biāo)準(zhǔn)對(duì)更高速率的需求SMPTE又制定了通常稱為SMPTE292M的標(biāo)準(zhǔn)，支持非壓縮的HDTV視...
- 關(guān)鍵字： SMPTE FPGA 視頻格式 視頻轉(zhuǎn)換 速率 串行傳輸 數(shù)字電影標(biāo)準(zhǔn) HD 模擬音頻 視頻內(nèi)容
FPGA在多制式視頻轉(zhuǎn)換系統(tǒng)中的應(yīng)用
- FPGA
- 關(guān)鍵字： FPGA 視頻轉(zhuǎn)換 多制式 Xilinx Altera Lattice CPLD actel 系統(tǒng)設(shè)計(jì) kinsen
一種基于DSP實(shí)現(xiàn)的LCD液晶屏顯示技術(shù)
- ?１引 言 隨著電子產(chǎn)品集成化的發(fā)展．液晶顯示屏在便攜式儀器中實(shí)現(xiàn)圖像或文字的顯示應(yīng)用更為廣泛。同時(shí)在當(dāng)今信息時(shí)代，數(shù)字圖像處理技術(shù)對(duì)實(shí)時(shí)性、運(yùn)算量大的要求越來越高，所以高運(yùn)算速度的DSP芯片在數(shù)字圖像處理領(lǐng)域得到了廣泛的應(yīng)用；其使數(shù)據(jù)采集、控制與人機(jī)界面融為一體，由于DSP處理速度快，整個(gè)系統(tǒng)能夠由一片DSP芯片控制．體積更小、功耗更低、更便于攜帶［1］。目前大多數(shù)液晶控制器的接[1電路及驅(qū)動(dòng)程序主要是針對(duì)單片機(jī)設(shè)計(jì)的［2］，DSP的液晶屏接口電路參考資料相對(duì)較少，而在實(shí)際應(yīng)用中，單片機(jī)
- 關(guān)鍵字： LCD DSP
在Virtex-5 FPGA中使用CRC硬模塊
- 數(shù)據(jù)損壞是與數(shù)據(jù)傳輸和存儲(chǔ)有關(guān)的首要問題。只要是在通道上傳輸數(shù)據(jù)，就總會(huì)有出現(xiàn)某些錯(cuò)誤的有限概率。 關(guān)鍵是接收模塊要能區(qū)分無錯(cuò)消息和有錯(cuò)消息。檢錯(cuò)有多種方法，其中大多數(shù)都是專門為此目的引入冗余位。數(shù)據(jù)通信中常用的檢錯(cuò)方法包括奇偶碼、漢明碼和循環(huán)冗余校驗(yàn)(CRC)，其中CRC使用最廣泛。 CRC根據(jù)一個(gè)給定的數(shù)據(jù)位組算出，然后在傳輸或存儲(chǔ)之前附加到數(shù)據(jù)幀尾部。接收或檢索到幀后，對(duì)其內(nèi)容重新計(jì)算CRC，以此來驗(yàn)證其有效性，確保數(shù)據(jù)無誤。 本文簡述CRC計(jì)算所依據(jù)的原理，并且探討用線性反饋
- 關(guān)鍵字： FPGA
基于FPGA的數(shù)字音頻廣播信道編碼器的實(shí)現(xiàn)
- 摘要：介紹了數(shù)字音頻廣播(DAB)信道編碼的原理和關(guān)鍵技術(shù)，并應(yīng)用單片F(xiàn)LEX10K100系列FPGA實(shí)現(xiàn)DAB信道編碼器。 關(guān)鍵詞：數(shù)字音頻廣播(DAB) 信道編碼 FPGA 1 數(shù)字音頻廣播(DAB)發(fā)射系統(tǒng)及信道編碼器 DAB是繼調(diào)幅和調(diào)頻廣播之后的第三代廣播體系。與模擬廣播相比它不僅可以提供高質(zhì)量的聲音信號(hào)(CD音質(zhì))，也可以提供數(shù)據(jù)、圖像等多種其他附加服務(wù)。它可以保護(hù)在高速移動(dòng)接收時(shí)的聲音質(zhì)量，具有很強(qiáng)的抗干擾能力，在同要瓣頻帶寬度和環(huán)境下，DAB可以提供高質(zhì)量的多種多樣的
- 關(guān)鍵字： 數(shù)字音頻 FPGA DAB 編碼器
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