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dsp　鐵路道口圖像監(jiān)控系統(tǒng) 文章進入dsp　鐵路道口圖像監(jiān)控系統(tǒng)技術社區(qū)

FPGA+DSP實時三維圖像信息處理系統(tǒng)

　　三維圖像信息處理一直是圖像視頻處理領域的熱點和難點，目前國內外成熟的三維信息處理系統(tǒng)不多，已有的系統(tǒng)主要依賴高性能通用PC完成圖像采集、預處理、重建、構型等囊括底層和高層的處理工作。三維圖像處理數據量特別大、運算復雜，單純依靠通用PC很難達到實時性要求，不能滿足現行高速三維圖像處理應用。　　本系統(tǒng)中，采用FPGA實現底層的信號預處理算法，其處理數據量很大，處理速度高，但算法結構相對比較簡單，可同時兼顧速度和靈活性。高層處理算法數據量較少、算法結構復雜，可采用運算速度快、尋址方式靈活、通信機制強大的
關鍵字： FPGA DSP 三維圖像信息處理 EVIP PCI

EDGE手機基帶處理設計的幾種實現方法評估

在無線市場上，EDGE協(xié)議已迅速為業(yè)者所接受，EDGE手機設計中支持多時隙傳輸、多種調制解調器/語音編譯碼器是基...
關鍵字： EDGE系統(tǒng) 基帶 DSP 語音編碼器 GMSK 形狀因子算術邏輯單元信道質量頻率誤差音頻電路

基于DSP Builder的14階FIR濾波器的設計

數字濾波器在數字信號處理的各種應用中發(fā)揮著十分重要的作用，他是通過對采樣數據信號進行數學運算處理來達到頻域濾波的目的。數字濾波器既可以是有限長單脈沖響應(FIR)濾波器也可以是無限長單脈沖響應(IIR)濾波器。在維納濾波器理論發(fā)明的早期，人們使用IIR濾波器，但現在更多是使用FIR濾波器。本文按照Matlab／Simulink／DSP Builder／QuartusⅡ流程，設計一個FIR濾波器。Altera DSP Builder是連接Simulink和QuartusⅡ開發(fā)軟件的DSP開發(fā)工具。在DSP
關鍵字：濾波器設計 FIR Builder DSP 基于

異步 DSP 核心設計: 更低功耗，更高性能

這一新技術的主要推動力來自硅技術的發(fā)展狀況。隨著硅產品的結構縮小到 90 納米以內，降低功耗就已成為首要事務。異步設計具有功耗低、電路更可靠等優(yōu)點，被看作是滿足這一需要的途徑。
關鍵字：功耗高性能設計核心 DSP 異步

用8位微處理器實現數字低通濾波器設計

電子產品世界,為電子工程師提供全面的電子產品信息和行業(yè)解決方案,是電子工程師的技術中心和交流中心,是電子產品的市場中心,EEPW 20年的品牌歷史,是電子工程師的網絡家園
關鍵字： 8位微處理器 DSP 數字低通濾波器

什么是DSP及DSP技術詳解

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關鍵字：數字信號處理 DSP

基于DSP多處理器實時開發(fā)環(huán)境的設計

本文通過研究提出了一種多處理器實時開發(fā)環(huán)境的設計思想，它可以支持多種型號處理器的同時開發(fā)，使系統(tǒng)級開發(fā)變得簡單易行。
關鍵字：環(huán)境設計開發(fā) 實時 DSP 處理器基于

DSP應用系統(tǒng)中的硬件接口電路設計

介紹了DSP應用系統(tǒng)的硬件接口電路：包括電平變換電路、仿真器JTAG接口電路、以及可擴展的硬件接口（如A/D、D/A、SRAM）等的設計方法，并給出了接口電路在設計時須注意的幾個問題。
關鍵字： DSP 應用系統(tǒng) 電路設計硬件接口

一種基于DSP平臺的快速H.264編碼算法的設計

　　視頻壓縮編碼標準H.264／AVC是由ISO／IEC和ITU-T組成的聯(lián)合視頻專家組(JVT)制定的，他引進了一系列先進的視頻編碼技術，如4×4整數變換、空域內的幀內預測，多參考幀與多種大小塊的幀間預測技術等，標準一經推出，就以其高效的壓縮性能和友好的網絡特性受到業(yè)界的廣泛推崇。特別是在2004年7月JVT組織做了重要的保真度范圍擴展的補充后，更加擴大了標準的應用范圍，但同時巨大的運算量卻成為其廣泛應用的瓶頸?？紤]到H.264協(xié)議實現的復雜度，本文的思路是：一方面提高硬件處理速度和能力，采
關鍵字： DSP 編碼算法視頻壓縮編碼編碼器 ARM CPU

合眾達推出達芬奇音視頻應用解決方案

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關鍵字： DSP 合眾達

在采用FPGA設計DSP系統(tǒng)中仿真的重要性

仿真是所有系統(tǒng)成功開發(fā)的基礎。通過在不同條件、參數值和輸入情況下對系統(tǒng)進行高級行為仿真，工程師可以迅速找到、分離并糾正系統(tǒng)的設計問題。因為在這一階段，比較容易區(qū)分設計問題和編程問題。通過在系統(tǒng)級工作，設計人員可以確定這一階段的問題是來自設計缺陷，而不是編程問題。此外，在信號處理系統(tǒng)設計中使用基于模型的方法大大縮短了“錯誤診斷延遲”時間――從設計中出現錯誤到發(fā)現錯誤并分離錯誤的時間。
關鍵字：真的重要性系統(tǒng) DSP FPGA 設計采用

32位DSP兩級cache的結構設計

采用自頂向下的流程設計了一款32位DSP的cache。該cache采用兩級結構，第一級采用哈佛結構，第二級采用普林斯頓結構。本文詳細論述了該cache的結構設計及采用的算法。
關鍵字：結構設計 cache 兩級 DSP 32位

ADSP-21262型DSP的監(jiān)控設計

　　1 引言　　隨著數字信號處理理論的日趨完善和超大規(guī)模集成電路技術的飛速發(fā)展,在各種實時處理應用需求的推動下,數字信號處理器(DSP)也得到了越來越廣泛的應用。　　DSP的監(jiān)控是DSP開發(fā)和應用中十分重要的環(huán)節(jié)。目前在DSP的開發(fā)過程中,最常用的方式是通過購買處理器的JTAG仿真器和開發(fā)軟件包實現對DSP的調試和監(jiān)控。JTAG調試工具的功能十分強大,對于不熟悉DSP內部結構和細節(jié)的開發(fā)者而言是一種非常不錯的選擇。但是此種方法也有其缺陷：首先,開發(fā)成本比較昂貴,一般購買正版仿真器和軟件包的價格都在
關鍵字： DSP 監(jiān)控 JTAG PC

基于DSP的音頻會議信號合成算法研究

　　隨著在數字信號處理(DSP)算法和芯片處理能力以及通信網絡結構優(yōu)化等方面的不斷發(fā)展，現代化通信已經迅速普及。音頻會議是眾多通信系統(tǒng)的必備功能。有多個用戶參與的音頻會議，最簡單的模式可以使用令牌控制下的互斥模式，使只有擁有發(fā)言權的那個與會者才可以講話。在這種模式下，每個與會者某一時刻只能聽到一路音頻信號，這種“半雙工”模式對于音頻會議是不方便和不實際的。　　真正的電話會議應當仿真多個與會者在一個會議室進行對話的情形。但是由于與會終端在物理上并不在一起，而每個終端只有一套音頻輸
關鍵字： DSP 音頻會議音頻輸出 ITU-T 有無聲檢測

視頻監(jiān)控系統(tǒng)中ARM與DSP的HPI接口設計

　　1 引言　　隨著網絡技術、圖像處理技術及嵌入式技術日趨成熟，視頻監(jiān)控技術得到廣泛的應用。銀行、工廠、政府、學校等部門，都設置有監(jiān)控系統(tǒng)。尤其是在國際上一系列恐怖事件后，人們更感到監(jiān)控系統(tǒng)的重要。而且要求視頻監(jiān)控設備有高清晰的視頻效果的同時，還能對現場進行實時控制。所以，此類設備不但要有更高的數據處理能力和處理精度，還要有強大的系統(tǒng)控制、管理能力以及高速的網絡數據傳輸速率。　　目前，市面上主流的視頻監(jiān)控設備，大致可以分成兩類，一是基于通用微處理器，二是基于數字信號處理器DSP。兩種芯片在功能上有
關鍵字： ARM DSP HPI 視頻監(jiān)控

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dsp　鐵路道口圖像監(jiān)控系統(tǒng)介紹

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一種基于DSP和USB的指紋識別系統(tǒng)設計
基于FPGA+DSP遠程監(jiān)控器設計與實現
采用DSP和STM32的雙核智能電液伺服控制器
基于DSP的漢字語音識別系統(tǒng)

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