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基于京微雅格低功耗FPGA的8b/10b SERDES的接口設(shè)計
- 摘要 串行接口常用于芯片至芯片和電路板至電路板之間的數(shù)據(jù)傳輸。隨著系統(tǒng)帶寬不斷增加至多吉比特范圍，并行接口已經(jīng)被高速串行鏈接，或SERDES (串化器/ 解串器)所取代。起初， SERDES 是獨立的ASSP 或ASIC 器件。在過去幾年中已經(jīng)看到有內(nèi)置SERDES 的FPGA 器件系列，但多見于高端FPGA芯片中，而且價格昂貴。 本方案是以CME最新的低功耗系列FPGA的HR03為平臺，實現(xiàn)8/10b的SerDes接口，包括SERDES收發(fā)單元，通過完全數(shù)字化的方法實現(xiàn)SERDES的CD
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零基礎(chǔ)學FPGA（十一）一步一腳印之基于FIFO的串口發(fā)送機設(shè)計全流程及常見錯誤詳解
- 記得在上幾篇博客中，有幾名網(wǎng)友提出要加進去錯誤分析這一部分，那我們就從今天這篇文章開始加進去我在消化這段代碼的過程中遇到的迷惑，與大家分享。 今天要寫的是一段基于FIFO的串口發(fā)送機設(shè)計，之前也寫過串口發(fā)送的電路，這次寫的與上次的有幾分類似。這段代碼也是我看過別人寫過的之后，消化一下再根據(jù)自己的理解寫出來的，下面是我寫這段代碼的全部流程和思路，希望對剛開始接觸的朋友來說有一點點的幫助，也希望有經(jīng)驗的朋友給予寶貴的建議。 首先來解釋一下FIFO的含義，F(xiàn)IFO就是First Input Fi
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美高森美發(fā)布領(lǐng)先的FPGA新產(chǎn)品概覽
- 1. 超安全SmartFusion2? SoC FPGA和 IGLOO2? FPGA 美高森美的超安全SmartFusion2? SoC FPGA和 IGLOO2? FPGA器件，無論在器件、設(shè)計和系統(tǒng)層次上的安全特性都比其他領(lǐng)先FPGA制造商更先進。新的數(shù)據(jù)安全特性現(xiàn)已成為美高森美主流SmartFusion2 SoC FPGA和 IGLOO2 FPGA器件的一部分，可讓開發(fā)人員充分利用器件本身所具有的同級別器件中的最低功耗,高可靠性和最佳安全技術(shù)，以期構(gòu)建高度差
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達芬奇技術(shù)在視頻和機器人方面應(yīng)用案例及技術(shù)文獻匯總
- 本文介紹達芬奇技術(shù)的解讀文獻及應(yīng)用案例，供大家參考。 解讀達芬奇技術(shù) 達芬奇技術(shù)是一種數(shù)字圖像、視頻、語音、音頻信號處理的新平臺，一經(jīng)推出，就受到熱烈歡迎，以其為基礎(chǔ)的應(yīng)用開發(fā)層出不窮。該技術(shù)是一種內(nèi)涵豐富的綜合體，包含達芬奇處理器、軟件、開發(fā)環(huán)境、算法庫和其他技術(shù)支持等。正因為涉及的技術(shù)面廣，因此有比較高的技術(shù)門檻。 視頻跟蹤算法在Davinci SOC上的實現(xiàn)與優(yōu)化 本文在基于雙核DM6446的系統(tǒng)平臺上，利用改進后的跟蹤算法實現(xiàn)了智能目標跟蹤系統(tǒng)。該算法可以成功跟蹤目標，
- 關(guān)鍵字： DSP ARM DM6446
視頻跟蹤算法在Davinci SOC上的實現(xiàn)與優(yōu)化
- 引言 目標跟蹤作為計算機視覺的一個極具挑戰(zhàn)性的研究任務(wù)，已被廣泛的應(yīng)用在人機交互、智能監(jiān)控、醫(yī)學圖像處理等領(lǐng)域中。目標跟蹤的本質(zhì)是在圖像序列中識別出目標的同時對其進行精確定位。為了克服噪聲、遮擋、背景的改變等對目標識別帶來的困難，出現(xiàn)了很多的跟蹤算法。 因為目標跟蹤算法需要處理的數(shù)據(jù)量大、運算復雜，需要性能強大的處理器才能實時處理。我們選用TI推出的最新產(chǎn)品TMS320DM6446實現(xiàn)算法。TMS320DM6446是一款高度集成的片上系統(tǒng)，集成了可以運行頻率高達594MHz的C64x+ D
- 關(guān)鍵字： DSP Davinci SOC
解讀達芬奇技術(shù)
- 達芬奇技術(shù)是一種數(shù)字圖像、視頻、語音、音頻信號處理的新平臺，一經(jīng)推出，就受到熱烈歡迎，以其為基礎(chǔ)的應(yīng)用開發(fā)層出不窮。該技術(shù)是一種內(nèi)涵豐富的綜合體，包含達芬奇處理器、軟件、開發(fā)環(huán)境、算法庫和其他技術(shù)支持等。正因為涉及的技術(shù)面廣，因此有比較高的技術(shù)門檻。 前言 數(shù)字視頻技術(shù)無疑將重塑整個電子行業(yè)的面貌。當然，數(shù)字視頻技術(shù)也正在使我們的視頻體驗、傳輸以及交互方式發(fā)生著深刻的變化。 其已開始進入我們的汽車、計算機、移動電話以及網(wǎng)絡(luò)。 不過，帶來高品質(zhì)的娛樂享受僅是精彩剛剛開始! 過去，工程師
- 關(guān)鍵字： 達芬奇技術(shù) DSP
達芬奇技術(shù)簡化數(shù)字視頻設(shè)計
- 數(shù)字視頻技術(shù)無疑將重塑整個電子行業(yè)的面貌。當然，數(shù)字視頻技術(shù)也正在使我們的視頻體驗、傳輸以及交互方式發(fā)生著深刻的變化，開始進入汽車、計算機、移動電話及網(wǎng)絡(luò)。過去，工程師們在實施數(shù)字視頻時選擇非常有限，硬連線以及基于ASIC的方案總是限制著器件的用途、功能，以及它們的自適應(yīng)性;雖然專用器件的靈活性稍高于ASIC，但是，面對日新月異的多媒體標準與應(yīng)用，它們的效用仍然很有限;而且缺少具有足夠性能、成本足夠低、靈活性足夠高的數(shù)字視頻開發(fā)平臺。 為了解決這些難題，德州儀器公司提供了一種很好的解決方案，即基
- 關(guān)鍵字： 達芬奇 DSP ARM9
基于OMAP的設(shè)計匯總，包括示波器、監(jiān)護儀、人機接口等
- 德州儀器 (TI) 公司的開放式多媒體應(yīng)用平臺OMAP(Open Multimedia Application Platform)是一種為滿足移動多媒體信息處理及無線通信應(yīng)用開發(fā)出來的高性能、高集成度嵌入式處理器。本文介紹基于OMAP經(jīng)典設(shè)計匯總，供大家參考。 OMAP5912雙核通信及其數(shù)字音頻系統(tǒng)實現(xiàn) OMAP平臺因其特有的雙核結(jié)構(gòu)，廣泛應(yīng)用于實時多媒體影音數(shù)據(jù)處理、語音識別系統(tǒng)、網(wǎng)絡(luò)通信等領(lǐng)域。筆者以O(shè)MAP5912平臺的數(shù)字音頻系統(tǒng)為例介紹雙核通信的具體應(yīng)用，希望能對使用OMAP的
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基于OMAP的無線傳感網(wǎng)節(jié)點處理器的設(shè)計與實現(xiàn)
- 無線傳感網(wǎng)絡(luò)是計算技術(shù)、通信技術(shù)和傳感器技術(shù)相結(jié)合的產(chǎn)物。傳感網(wǎng)應(yīng)用場合非常廣泛，節(jié)點也可以搭載不同類型的傳感器。當節(jié)點自身搭載的傳感器為震動、磁傳感器時，采集到的數(shù)據(jù)量較小，處理簡單，目前的傳感網(wǎng)節(jié)點(如Mica節(jié)點)就可以滿足需要。但當節(jié)點集成圖像傳感器、紅外傳感器等大數(shù)據(jù)量傳感器對傳感數(shù)據(jù)網(wǎng)絡(luò)的實時要求相當高時，現(xiàn)有的節(jié)點受處理及存儲能力的限制無法滿足要求。 本文主要分析在設(shè)計較高處理及存儲能力傳感節(jié)點時，如何滿足傳感網(wǎng)節(jié)點低功耗和高處理能力間的平衡關(guān)系，并介紹基于OMAP處理器的節(jié)點處理
- 關(guān)鍵字： OMAP DSP
FPGA時序約束的6種方法
- 對自己的設(shè)計的實現(xiàn)方式越了解，對自己的設(shè)計的時序要求越了解，對目標器件的資源分布和結(jié)構(gòu)越了解，對EDA工具執(zhí)行約束的效果越了解，那么對設(shè)計的時序約束目標就會越清晰，相應(yīng)地，設(shè)計的時序收斂過程就會更可控。 下文總結(jié)了幾種進行時序約束的方法。按照從易到難的順序排列如下： 0.核心頻率約束 這是最基本的，所以標號為0. 1.核心頻率約束+時序例外約束 時序例外約束包括FalsePath、MulticyclePath、MaxDelay、MinDelay.但這還不是最完整的時序約束
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從硬件角度討論FPGA開發(fā)框架
- FPGA采用了邏輯單元陣列概念，內(nèi)部包括可配置邏輯模塊、輸出輸入模塊和內(nèi)部連線三個部分。每一塊FPGA芯片都是由有限多個帶有可編程連接的預定義源組成來實現(xiàn)一種可重構(gòu)數(shù)字電路。 長久以來新型FPGA的功能和性能已經(jīng)為它們贏得系統(tǒng)中的核心位置，成為許多產(chǎn)品的主要數(shù)據(jù)處理引擎。 鑒于FPGA在如此多應(yīng)用中的重要地位，采取正式且注重方法的開發(fā)流程來處理FPGA設(shè)計比以往更加重要。該流程旨在避免開發(fā)周期后期因發(fā)現(xiàn)設(shè)計缺陷而不得不進行費時費錢的設(shè)計修改，而且該缺陷還可能對項目進度計劃、成本和質(zhì)量造成災(zāi)
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【從零開始走進FPGA】美好開始——我流啊流啊流
- 按照基于Windows的語言(C、C++、C#)等編程語言的初學入門教程，第一個歷程應(yīng)該是“Hello World!”的例程。但由于硬件上的驅(qū)動難易程度，此例程將在在后續(xù)章程中推出。硬件工程師學習開發(fā)板的第一個例程：流水燈，一切美好的開始。 本章將會在設(shè)計代碼的同時，講解Quartus II 軟件的使用，后續(xù)章節(jié)中只講軟件的思想，以及解決方案，不再做過多的累贅描述。 一、Step By Step 建立第一個工程 (1)建立第一個工程，F(xiàn)ile-New-New
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基于FPGA的跨時鐘域信號處理——MCU
- 說到異步時鐘域的信號處理，想必是一個FPGA設(shè)計中很關(guān)鍵的技術(shù)，也是令很多工程師對FPGA望而卻步的原因。但是異步信號的處理真的有那么神秘嗎?那么就讓特權(quán)同學和你一起慢慢解開這些所謂的難點問題，不過請注意，今后的這些關(guān)于異步信號處理的文章里將會重點從工程實踐的角度出發(fā)，以一些特權(quán)同學遇到過的典型案例的設(shè)計為依托，從代碼的角度來剖析一些特權(quán)同學認為經(jīng)典的跨時鐘域信號處理的方式。這些文章都是即興而寫，可能不會做太多的分類或者歸納，也有一些特例，希望網(wǎng)友自己把握。 另外，關(guān)于異步時鐘域的話題，推薦大家
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跨越鴻溝：同步世界中的異步信號
- 只有最初級的邏輯電路才使用單一的時鐘。大多數(shù)與數(shù)據(jù)傳輸相關(guān)的應(yīng)用都有與生俱來的挑戰(zhàn)，即跨越多個時鐘域的數(shù)據(jù)移動，例如磁盤控制器、CDROM/DVD 控制器、調(diào)制解調(diào)器、網(wǎng)卡以及網(wǎng)絡(luò)處理器等。當信號從一個時鐘域傳送到另一個時鐘域時，出現(xiàn)在新時鐘域的信號是異步信號。 在現(xiàn)代 IC、ASIC 以及 FPGA 設(shè)計中，許多軟件程序可以幫助工程師建立幾百萬門的電路，但這些程序都無法解決信號同步問題。設(shè)計者需要了解可靠的設(shè)計技巧，以減少電路在跨時鐘域通信時的故障風險。 基礎(chǔ) 從事多時鐘設(shè)計的第一
- 關(guān)鍵字： FPGA 異步信號 FIFO
零基礎(chǔ)學FPGA（十）初入江湖之i2c通信
- 相信學過單片機的同學對I2C總線都不陌生吧，今天我們來學習怎么用verilog語言來實現(xiàn)它，并在FPGA學習版上顯示。 i2c總線在近年來微電子通信控制領(lǐng)域廣泛采用的一種新型的總線標準，他是同步通信的一種特殊方式，具有接口少，控制簡單，器件封裝形式小，通信速率高等優(yōu)點。在主從通信中，可以有多個i2c總線器件同時接到i2c總線上，所有與i2c兼容的器件都有標準的接口，通過地址來識別通信對象，使他們可以經(jīng)由i2c總線互相直接通信。 i2c總線由兩條線控制，一條時鐘線SCL，一條數(shù)據(jù)線SDA，這
- 關(guān)鍵字： FPGA i2c verilog
dsp＋fpga介紹
您好，目前還沒有人創(chuàng)建詞條dsp＋fpga!
歡迎您創(chuàng)建該詞條，闡述對dsp＋fpga的理解，并與今后在此搜索dsp＋fpga的朋友們分享。 創(chuàng)建詞條
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