- CS4235在DSP嵌入式系統(tǒng)的應(yīng)用研究,引 言
目前,由于采用的錄放音芯片結(jié)構(gòu)簡單、采樣率過低而使得嵌入式系統(tǒng)中的音質(zhì)效果比較差,遠遠滿足不了人們對高檔生活、學(xué)習(xí)用嵌入式系統(tǒng)的要求。如果能將聲卡技術(shù)應(yīng)用到嵌入式系統(tǒng)中,由于聲卡的強大
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應(yīng)用 研究 系統(tǒng) 嵌入式 DSP CS4235
- 基于DSP TMS320C6416的數(shù)字下變頻技術(shù),數(shù)字下變頻器有多種芯片可供選擇,如Harris公司Gray-Chip公司的產(chǎn)品。然而這些器件無法滿足雷達對抗偵察數(shù)字接收機高多DSP的數(shù)字下變頻器。本文以某雷達對抗偵察數(shù)字接收機為例,介紹一種基于TI公司的DSP TMS320C641
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變頻 技術(shù) 數(shù)字 TMS320C6416 DSP 基于
- 摘要:差分跳頻(DFH)是一種新的短波跳頻技術(shù),它主要歸結(jié)為一種G函數(shù)算法,這種G函數(shù)集跳頻圖案、信息調(diào)制與解調(diào)于一體。它的通信機理與常規(guī)跳頻完全不同,較好的解決了數(shù)據(jù)速率和跟蹤、干擾等問題,代表了當(dāng)前短波通
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FPGA 短波差分 跳頻信號 發(fā)生器
- 本文中,我們主要討論小靈通網(wǎng)絡(luò)(PHS,P網(wǎng))的優(yōu)化和雙模手機對小靈通網(wǎng)絡(luò)的影響。無線網(wǎng)絡(luò)優(yōu)化包括終端、基站和核心網(wǎng)的優(yōu)化,GSM(G網(wǎng))和3G(C網(wǎng),包括2G的IS-95)都有較完善的網(wǎng)絡(luò)優(yōu)化方案。
當(dāng)前,國內(nèi)存在GSM、
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優(yōu)化 分析 網(wǎng)絡(luò) 小靈通 雙模 手機 DSP
- 隨著電力電子技術(shù)、電機控制理論和微控制器的不斷發(fā)展,現(xiàn)代交流調(diào)速技術(shù)在國民經(jīng)濟中得到了廣泛應(yīng)用。目前,高...
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DSP CPLD 電機控制
- 全球可編程平臺領(lǐng)導(dǎo)廠商賽靈思公司 (Xilinx, Inc. (NASDAQ:XLNX) )在 2011 年 NIWeek 大會期間宣布,美國國家儀器公司 (NI) 推出采用賽靈思旗艦型Spartan?-6 FPGA的業(yè)界首款多核、性能最高的 NI CompactRIO 系統(tǒng)和最小型化的 NI Single-Board RIO器件,進一步豐富了其可重配置 I/O (RIO) 高級控制與監(jiān)控產(chǎn)品系列。
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賽靈思 Spartan-6 FPGA
- 基于Verilog簡易UART的FPGA/CPLD實現(xiàn),目標(biāo):在xo640上實現(xiàn)一個簡單的Uart,能夠解析串口數(shù)據(jù),并在寄存器中存儲,用FIFO實現(xiàn)數(shù)據(jù)的傳遞。那么后期可以通過開發(fā)板上的串口經(jīng)CPLD訪問各種數(shù)據(jù)。比如PC=CPLD=EEPROM等等,極大方便后期的開發(fā)和調(diào)試。
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FPGA/CPLD 實現(xiàn) UART 簡易 Verilog 基于
- 摘要:FPGA既具有門陣列的高邏輯密度和高可靠性,又具有可編程邏輯器件的用戶可編程性,可以減少系統(tǒng)的設(shè)計和維護風(fēng)險,降低產(chǎn)品成本,縮短設(shè)計周期。文中給出了利用FPGA設(shè)計漢明距離的計算電路,同時給出與通過有效
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FPGA 漢明距離 電路
- 基于FPGA嵌入式系統(tǒng)的雷達目標(biāo)模擬器的設(shè)計,人為地對雷達進行測試時,有時只對雷達的某個和某些參數(shù)感興趣,希望在回波中表征感興趣的參數(shù)強一些,這時就應(yīng)該在回波中去掉雜波和噪聲的影響,而這在實際的外場試飛過程中是不可能實現(xiàn)的,這也是雷達信號模擬器對
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目標(biāo) 模擬器 設(shè)計 雷達 系統(tǒng) FPGA 嵌入式 基于
- 摘要:以某光電跟蹤產(chǎn)品雙DSP系統(tǒng)為例,詳細介紹了RS 422通信設(shè)計。該系統(tǒng)設(shè)計選用Maxim公司提供的Max490ESA作為接口芯片。給出了其硬件接口原理圖,并分別從DSP和PC機兩方面詳細介紹了RS 422通信程序的設(shè)計,具體給
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RS422 通信 設(shè)計 系統(tǒng) DSP 跟蹤 產(chǎn)品 光電
- MCU+DSP雙處理器的嵌入式平臺構(gòu)建,自動化控制要求實時采集數(shù)據(jù),快速控制,多樣分析,通信靈活,雖然采用單個處理器構(gòu)成的硬件平臺不能滿足要求。采用以MCU+DSP雙處理器為核心的硬件平臺則是較合理的設(shè)計方案。利用DSP實現(xiàn)數(shù)據(jù)實時采集、分析、計算;M
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平臺 構(gòu)建 嵌入式 處理器 DSP MCU
- 基于CPCI接口DSP板的雷達目標(biāo)模擬器,提出一種基于CPCI接口DSP板的C波段雷達目標(biāo)模擬器。探測回波模擬,采用軟硬件相結(jié)合的方法。由主控計算機根據(jù)雷達工作參數(shù)預(yù)先設(shè)定并計算目標(biāo)數(shù)據(jù),然后將數(shù)據(jù)加載到硬件電路中。硬件電路實時合成雷達回波信號并輸出
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目標(biāo) 模擬器 雷達 DSP CPCI 接口 基于
- 引言 目前,市場上的中小規(guī)模LED顯示系統(tǒng),一般采用傳統(tǒng)的單片機作為主控芯片。對LED大屏幕顯示屏來說,由于數(shù)據(jù)傳輸量大,要求掃描速度快,而單片機內(nèi)部的資源較少、運行速度較慢,難于滿足系統(tǒng)要求。以FPGA
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顯示屏 控制系統(tǒng) 圖文 LED MCU FPGA 基于
- 摘要:在現(xiàn)代數(shù)字通信系統(tǒng)中,為了擴大信道的傳輸容量提高信號傳輸效率,常采用數(shù)字復(fù)接的技術(shù)。在分析了PCM30/32...
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FPGA PCM30 信號同步
- 研究了雷達多目標(biāo)模擬系統(tǒng)中數(shù)字射頻存儲(DRFM)單元的設(shè)計與實現(xiàn),根據(jù)模擬系統(tǒng)的設(shè)計要求, 提出一種基于高性能 FPGA數(shù)字射頻存儲單元設(shè)計方法;著重闡述了數(shù)字射頻存儲單元的設(shè)計思路, 給出了系統(tǒng)的設(shè)計方案, 并對系統(tǒng)中雷達模擬目標(biāo)的各功能模塊進行了分析,實驗結(jié)果表明,所設(shè)計的DRFM滿足設(shè)計系統(tǒng)要求。
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FPGA DRFM 雷達 多目標(biāo)
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